[发明专利]驱动电路以及移位寄存电路有效
申请号: | 201510508176.2 | 申请日: | 2015-08-18 |
公开(公告)号: | CN105161061B | 公开(公告)日: | 2017-11-10 |
发明(设计)人: | 郝思坤 | 申请(专利权)人: | 深圳市华星光电技术有限公司;武汉华星光电技术有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G11C19/28 |
代理公司: | 深圳市威世博知识产权代理事务所(普通合伙)44280 | 代理人: | 何青瓦 |
地址: | 518006 广东省深圳市光明新区公*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 驱动 电路 以及 移位 寄存 | ||
技术领域
本发明涉及液晶显示技术领域,特别是涉及一种驱动电路以及移位寄存电路。
背景技术
GOA(Gate Driver On Array)电路是利用现有的液晶显示器的Array制程将栅极扫描驱动电路制作在Array基板上,以实现逐行扫描的驱动方式。其具有降低生产成本和窄边框设计的优点,为多种显示器所使用。GOA电路要具有两项基本功能:第一是输入栅极驱动脉冲,驱动面板内的栅极线,打开显示区内的TFT(Thin Film Transistor,薄膜场效应晶体管),由栅极线对像素进行充电;第二是移位寄存,当第n个栅极驱动脉冲输出完成后,可以通过时钟控制进行n+1个栅极驱动脉冲的输出,并依此传递下去。
GOA电路包括上拉电路(Pull-up circuit)、上拉控制电路(Pull-up control circuit)、下拉电路(Pull-down circuit)、下拉控制电路(Pull-down control circuit)以及负责电位抬升的上升电路(Boost circuit)。具体地,上拉电路主要负责将输入的时钟讯号(Clock)输出至薄膜晶体管的栅极,作为液晶显示器的驱动信号。上拉控制电路负责控制上拉电路的打开,一般是由上级GOA电路传递来的信号作用。下拉电路负责在输出扫描信号后,快速将扫描信号拉低为低电位,即薄膜晶体管的栅极的电位拉低为低电位;下拉保持电路则负责将扫描信号和上拉电路的信号(通常称为Q点)保持在关闭状态(即设定的负电位),通常有两个下拉保持电路交替作用。上升电路则负责Q点电位的二次抬升,这样确保上拉电路的G(N)正常输出。
不同的GOA电路可以使用不同的制程。LTPS(Low Temperature Poly-silicon,低温多晶硅)制程具有高电子迁移率和技术成熟的优点,目前被中小尺寸显示器广泛使用。CMOS(Complementary Metal Oxide Semiconductor,互补金属氧化物半导体)LTPS制程具有低功耗、电子迁移率高、噪声容限宽等优点。而现有技术的GOA电路的制程不能适用于CMOS制程,功耗高。
发明内容
本发明实施例提供了一种驱动电路以及移位寄存电路,以适用于CMOS制程,功耗低、噪声容限宽。
本发明提供一种驱动电路,其包括多个级联设置的移位寄存电路,每一移位寄存电路包括时钟控制传输电路以及锁存电路,其中时钟控制传输电路由第一时钟脉冲进行触发将n-2级的Q点的驱动脉冲传输至锁存电路,并由锁存电路进行锁存,锁存电路进一步由第二时钟脉冲进行触发进而输出栅极驱动脉冲和Q点的驱动脉冲。
其中,时钟控制传输电路和或非门锁存电路分别为上升沿触发。
其中,锁存电路至少包括第一传输门、第二传输门、第一反相器和第二反相器以及或非门,其中第一传输门的第一控制端和第二传输门的第二控制端连接时钟控制传输电路的输出端,第一传输门的输入端连接n-2级的Q点,第一传输门的第二控制端和第二传输门的第一控制端均连接第一时钟脉冲,第一传输门的输出端连接第二传输门的输入端和第一反相器的输入端,第一反相器的输出端与第二反相器的输入端连接,第二反相器的输出端与第二传输门的输出端均连接或非门的第一输入端,或非门的第二输入端连接第二时钟脉冲。
其中,时钟控制传输电路在传输第一时钟脉冲的过程中对第一时钟脉冲进行反相。
其中,第二反相器的输出端输出Q点的驱动脉冲。
其中,锁存电路进一步包括与或非门的输出端连接的多级反相电路。
其中,多级反相电路的包括三个反相器。
其中,在第一级的移位寄存电路和第二级的移位寄存电路中,第一传输门的输入端连接STV脉冲。
本发明还提供一种移位寄存电路,其包括时钟控制传输电路以及锁存电路,其中时钟控制传输电路由第一时钟脉冲进行触发将n-2级的Q点的驱动脉冲传输至锁存电路,并由锁存电路进行锁存,锁存电路进一步由第二时钟脉冲进行触发进而输出栅极驱动脉冲和Q点的驱动脉冲。
其中,锁存电路进一步包括与或非门的输出端连接的多级反相电路。
通过上述方案,本发明的有益效果是:本发明通过时钟控制传输电路由时钟信号的第一时钟脉冲进行触发将n-2级的Q点的驱动脉冲传输至锁存电路,并由锁存电路进行锁存,锁存电路进一步由第二时钟脉冲进行触发进而输出驱动脉冲,能够适用于CMOS制程,功耗低、噪声容限宽。
附图说明
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