[发明专利]闪存及闪存内部数据的存取控制方法有效

专利信息
申请号: 201510386762.4 申请日: 2015-07-03
公开(公告)号: CN106326138B 公开(公告)日: 2019-11-05
发明(设计)人: 周博;郭平日;李奇峰;杨云 申请(专利权)人: 比亚迪股份有限公司
主分类号: G06F12/02 分类号: G06F12/02
代理公司: 北京清亦华知识产权代理事务所(普通合伙) 11201 代理人: 张大威
地址: 518118 广东省*** 国省代码: 广东;44
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摘要:
搜索关键词: 闪存 控制模块 存储器本体 第一数据 访问地址 匹配 读取 存取控制 内部数据 存储 存储器存取 嵌入式系统 出错概率 单元存储 控制逻辑 快速读取 闪存数据 数据传输 数据中转 外部系统 直接读取 直接交互 表单元 数据组
【说明书】:

在本发明公开的闪存中,存储器本体存储第一数据及第一数据的第一地址,数据组单元存储第二数据,地址表单元存储第二数据在存储器本体的第二地址。控制模块判断访问地址是匹配第一地址还是第二地址,若访问地址匹配第一地址,控制模块根据存储器存取控制逻辑读取第一数据。若访问地址匹配第二地址,控制模块直接读取第二数据。上述闪存中,对于第二数据,控制模块能够快速读取,不仅使嵌入式系统读取闪存数据的速度得到提升,同时,还能减少外部系统和存储器本体的直接交互,减少数据中转次数和过程长度,减少数据传输的出错概率。本发明还公开一种闪存内部数据的存取控制方法。

技术领域

本发明涉及数据存取领域,更具体而言,涉及一种闪存及一种闪存内部数据的存取控制方法。

背景技术

嵌入式系统的内部闪存的存取速度和存取空间利用率往往限制了嵌入式系统的性能和效率,高效的闪存数据存取控制方法能够大幅提高系统程序运行和数据处理的效率指标。当前嵌入式系统中闪存的数据存取控制方法普遍统一,即依据闪存存储器本身的存取时序特性,设计相应的存储器存取时序控制逻辑,进行一般的存取读写操作;该数据存取时序尽量设计为存储器要求的时序时间花费的最小值,以提高存储器访问效率。或者,在相对存取速度较低的闪存存储器外部增加缓存逻辑,使一次闪存数据的存取操作能存取多笔数据,使得该笔数据之后的多笔存取操作仅借助缓存快速实现,已达到提高闪存存取效率的目的。

但是,上述闪存数据的存取控制方式,具有一定的不足之处:其中当前控制方式的效率依赖于闪存存储器本体的时序控制特性,最快访问速度也必须满足存储器本身的最小访问时间要求;同时,使用缓存方式来提高系统的存取速度,需要额外的数据缓存控制算法和额外的缓存存储空间,而且缓存控制算法的不当反而会有存取效率降低的可能。进一步地,上述控制方法在一定程度上限制了闪存存储器存储空间的有效利用,并没有根据闪存数据的存储特性高效地利用闪存存储空间。

发明内容

本发明旨在至少解决现有技术中存在的技术问题之一。为此,本发明需要提供一种闪存及一种闪存内部数据的存取控制方法。

一种闪存,包括存储器本体、地址表单元、数据组单元及控制模块,该存储器本体用于存储第一数据及该第一数据的第一地址,该数据组单元用于存储第二数据,该地址表单元存储该第二数据在该存储器本体的第二地址;

该控制模块用于判断访问地址是匹配该第一地址还是该第二地址,若该访问地址匹配该第一地址,该控制模块用于根据存储器存取控制逻辑读取该第一数据。若该访问地址匹配该第二地址,该控制模块用于直接读取该第二数据。

上述闪存中,对于第二数据,控制模块能够快速读取,不仅使嵌入式系统读取闪存数据的速度得到提升,同时,还能减少外部系统和存储器本体的直接交互,减少数据中转次数和过程长度,减少数据传输的出错概率。

在一个实施方式中,该控制模块包括地址判断单元及数据导出控制单元,该地址判断单元用于接收该访问地址及判断该访问地址是匹配该第一地址还是该第二地址。该数据导出控制单元用于直接读取该第二数据及根据该存储器存取控制逻辑读取该第一数据。

在一个实施方式中,该存储器本体用于存储第三数据及该第三数据的第三地址,该第三地址为该第二地址的镜像地址,该第三数据是该存储器本体释放该第二数据后的存储空间所存储的数据。该控制模块用于判断该访问地址是否匹配该第三地址。若是,该控制模块用于根据该存储器存取控制逻辑存储或读取该第三数据。

在一个实施方式中,该第二数据的数量大于该第一数据的数量,及大于该第三数据的数量。

在一个实施方式中,该第二数据为数据值出现次数最多的数据。

一种闪存内部数据的存取控制方法,该闪存包括存储器本体、地址表单元、数据组单元及控制模块,该存储器本体用于存储第一数据及该第一数据的第一地址,该数据组单元用于存储第二数据,该地址表单元存储该第二数据在该存储器本体的第二地址。该闪存内部数据的存取控制方法包括以下步骤:

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