[实用新型]一种串化-解串电路有效
| 申请号： | 201420851213.0 | 申请日： | 2014-12-26 |
| 公开（公告）号： | CN204465514U | 公开（公告）日： | 2015-07-08 |
| 发明（设计）人： | 杜兴伟;田宝江;王敬军;郭新杰;周晓柯;朱雪红;王亚杰;杨晓丽;周京 | 申请（专利权）人： | 国家电网公司;国网河南省电力公司;许昌继元电力科技有限公司 |
| 主分类号： | H03M9/00 | 分类号： | H03M9/00 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 罗满 |
| 地址： | 100031 *** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 一种 电路 | ||
1.一种串化-解串电路，其特征在于，包括：
发送端和接收端；
所述发送端的输出端通过高速串行通道与所述接收端的输入端相连接；
所述发送端包括并串行转换器和第一时钟信号发生器；
所述接收端包括串并行转换器、数据缓冲电路和第二时钟信号发生器，所述串并行转换器的输出端与所述数据缓冲电路的输入端相连接；
所述串并行数据转换器包括时钟和数据恢复电路和串行数据电路，所述时钟和数据恢复电路的输出端与所述串行数据电路的输入端相连接。
2.根据权利要求1所述的串化-解串电路，其特征在于，所述第一时钟信号发生器采用锁相环电路。
3.根据权利要求1所述的串化-解串电路，其特征在于，所述第二时钟信号发生器采用延迟锁相环。
4.根据权利要求3所述的串化-解串电路，其特征在于，所述延迟锁相环采用压控延迟线。
5.根据权利要求1所述的串化-解串电路，其特征在于，所述并串行转换器包括：
第一内置自测试发生器、多路复用器和线路驱动器；
所述内置自测试发生器的输出端与所述多路复用器的输入端相连接；
所述多路复用器的输出端与所述线路驱动器相连接。
6.根据权利要求5所述的串化-解串电路，其特征在于，所述串并行转换器还包括：
输入监控电路、校准电路、多路分解器和第二内置自测试发生器；
所述输入监控电路的输入端经衰减器与所述线路驱动器的输出端相连接；
所述多路分解器的输出端与所述校准电路的输入端相连接，所述校准电路的输出端分别与所述第二内置自测试发生器的输入端和所述多路复用器的输入端相连接。
7.根据权利要求5所述的串化-解串电路，其特征在于，所述多路复用器为10：1的多路复用器。
8.根据权利要求6所述的串化-解串电路，其特征在于，所述多路解复用器为10:1的多路解复用器。
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