[发明专利]一种等离子显示器驱动方法无效
申请号: | 201410094043.0 | 申请日: | 2014-03-14 |
公开(公告)号: | CN103903552A | 公开(公告)日: | 2014-07-02 |
发明(设计)人: | 周超;虞尚友;陈修强;卫伟;杨发明 | 申请(专利权)人: | 四川虹欧显示器件有限公司 |
主分类号: | G09G3/28 | 分类号: | G09G3/28 |
代理公司: | 成都九鼎天元知识产权代理有限公司 51214 | 代理人: | 詹永斌 |
地址: | 621000 四*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 等离子 显示器 驱动 方法 | ||
技术领域
本发明涉及一种等离子显示器驱动方法,特别是涉及一种适用于在显示不同画面时,兼顾控制寻址放电强弱的等离子显示器驱动方法。
背景技术
PDP模组驱动波形主要由复位期、寻址期及维持期组成,如图1和图2所示,表示了一个子场完整的驱动波形。
复位期:通过斜坡波形对屏施加较高的电压,使所有的放电单元产生放电,并使各单元在寻址期开始前,放电状态尽可能趋于一致。
寻址期:Y电极施加扫描脉冲,并且对需要点亮的单元在A电极施加寻址脉冲信号,使需要点亮的单元产生放电,并重新积累壁电荷,以便于维持期正常放电。
维持期:X、Y电极交替施加维持脉冲信号,需点亮的单元持续放电发光。
维持期最后一个维持脉冲的长度对下一子场复位期、寻址期放电有较大影响:
1)最后一个维持脉冲长,容易积累壁电荷,下一子场复位期放电多,寻址放电强,好处是可减少寻址放电失败导致的低放电;坏处是寻址放电时容易与相邻行的单元发生串扰,导致串扰性低放电不良,特别是在一些寻址开关次数多的画面下。
2)最后一个维持脉冲短,积累壁电荷少,可以减少寻址放电发生串扰的可能,但也会增加低放电发生的风险。
为适当设置最后一个维持脉冲长度避免产生或改善相应放电不良,一般措施是根据不同APL、不同的子场设定固定的最后一个维持脉冲长度。但有一定局限性,在显示不同画面时,难以兼顾控制寻址放电强弱。
发明内容
本发明要解决的技术问题是提供一种避免产生放电不良的等离子显示器驱动方法。
本发明采用的技术方案如下:一种等离子显示器驱动方法,具体方法为:对输入LVDS信号的处理,增加寻址开关数的计算,并通过寻址开关数控制X/Y电极输出波形的时序,调整前一子场最后一个维持脉冲长度。
更进一步的,根据当前子场的寻址开关次数划分为2个以上的区间,根据划分区间设置前一子场最后一个维持脉冲的长度。
更进一步的,根据当前子场寻址开关数所在的区间从小到大,前一子场最后一个维持脉冲长度从长到短进行设置。
当前子场寻址开关数在0~200000区间的,设置前一子场最后一个维持脉冲长度为40us。
当前子场寻址开关数在200001~500000区间的,设置前一子场最后一个维持脉冲长度为20us。
当前子场寻址开关数在500001~800000区间的,设置前一子场最后一个维持脉冲长度为10us。
当前子场寻址开关数在800001~1179648区间的,设置前一子场最后一个维持脉冲长度为5us。
与现有技术相比,本发明的有益效果是:根据不同画面有效调整寻址放电强度,避免因寻址放电过强或过弱导致的放电问题。
附图说明
图1为驱动波形组成示意图。
图2为等离子显示器电极结构示意图。
图3为寻址开关次数计算示意图。
图4为隔行点亮画面示意图。
图5为隔行点亮画面有384次寻址的示意图。
图6为需设定较短的最后一个维持脉冲的示意图。
图7为白场或单色场一根电极的寻址开关情况示意图。
图8为需设定较长的最后一个维持脉冲的示意图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白,以下结合附图及实施例,对本发明进行进一步详细说明。应当理解,此处所描述的具体实施例仅用以解释本发明,并不用于限定本发明。
本说明书(包括任何附加权利要求、摘要和附图)中公开的任一特征,除非特别叙述,均可被其他等效或者具有类似目的的替代特征加以替换。即,除非特别叙述,每个特征只是一系列等效或类似特征中的一个例子而已。
如图3所示,一种等离子显示器驱动方法,具体方法为:对输入LVDS信号的处理,增加寻址开关数的计算,并通过寻址开关数控制X/Y电极输出波形的时序,调整前一子场最后一个维持脉冲长度。
寻址开关次数多的画面,如逐行扫描模式下,隔行点亮的画面,在一个子场一根add电极输出的寻址信号有384次开关。如图5所示,以768行为例这种画面下,易产生串扰,即当前行寻址放电产生的部分带电粒子跑到下一行,导致下一行因弱放电或带电粒子中和壁电荷减少,引起下一子场低放电(即串扰性低放电)。因此,需要在当前子场设置较短的最后一个维持脉冲长度,如图6所示,以降低下一子场寻址放电强度。
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