[发明专利]具备副边反馈电流检测的开关电源控制电路有效
申请号: | 201410052347.0 | 申请日: | 2014-02-14 |
公开(公告)号: | CN103780064A | 公开(公告)日: | 2014-05-07 |
发明(设计)人: | 向磊;唐波;吴强;许刚颖;朱樟明 | 申请(专利权)人: | 成都启臣微电子有限公司 |
主分类号: | H02M1/08 | 分类号: | H02M1/08;G01R31/40;H02M3/335 |
代理公司: | 成都行之专利代理事务所(普通合伙) 51220 | 代理人: | 梁田 |
地址: | 611731 四川省成都市高*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 具备 反馈 电流 检测 开关电源 控制电路 | ||
技术领域
本发明属于集成电路设计领域,涉及一种开关电源控制电路,特别是一种具备副边反馈电流检测的开关电源控制电路。
背景技术
随着消费电子产品强劲的需求以及各种电子产品的更新换代,对电源模块的要求也越来越高。电源模块通常为功能模块提供恒定的电压或恒定的电流,以保证它们稳定的工作。
根据控制环路的采样方式,开关电源可以分为电流型开关电源和电压型开关电源,电压型仅对输出电压进行采样,采样后的信号输入到误差放大器中,误差放大器通过对输出电压的误差放大,产生COMP信号,利用COMP模拟电压调节脉冲宽度调制信号(PWM),从而控制功率开关管的开关占空比。电流型开关电源除对输出电压采样得到COMP信号外,还通过对电感电流的采样与COMP信号一起调节脉冲宽度调制信号(PWM),从而对功率开关管的开关占空比进行调节,实现方式通常是将这两个信号一起输入到PWM比较器中,PWM比较器输出PWM信号。电流采样方式对控制环路的调节更加迅速,但稳定性不足。
对电感电流的采样方式可以为从功率开关管取样,如图1所示,为典型的反激原边反馈检测电源转换器系统应用结构框图。在PWM信号控制功率NMOS管102导通期间,变压器104初级绕组电感和交流输入电压整流后的直流电源电压Vdc一起控制流过变压器初级绕组的电流上升斜率,该电流流过采样电阻103,并在CS端产生一个固定斜率上升的电压信号,当CS端电压上升到电流型开关电源控制电路101内部所设定的电压值以后,PWM输出信号控制关断功率NMOS管102;在PWM信号控制功率NMOS管102关断期间,变压器104次级绕组和与之相连的输出整流二极管105一起对输出电压提供能量。
在功率NMOS 管102的源极到地之间串联有采样电阻103,功率NMOS管102的电流流过采样电阻103产生电压信号CS输入到控制电路中,图1中VDD、GND分别表示电流型开关电源控制电路101的电源端和地端,INV表示输出电压反馈端,COMP表示误差放大器的误差信号输出端,PWM表示功率开关管的栅极信号输出端,PWM端直接控制功率开关管的开关占空比。
现有的 电流检测技术对电感电流的检测采用比较器检测方式,检测方法单一,对CS脚上的杂波干扰无法识别,且不能利用CS脚采用外置电压进行测试。
发明内容
为克服现有开关电源控制电路电流检测方式单一,不能识别干扰,且不能利用CS脚采用外置电压进行测试的技术缺陷,本发明公开了一种具备副边反馈电流检测的开关电源控制电路。
本发明所述
采用本发明所述的具备副边反馈电流检测的开关电源控制电路,采用计数周期判断功率管过流状态,参考功率管开关信号避免误判,同时在利用本发明测试时,可以避免退出测试模式时芯片重新上电启动过程,节约测试时间,降低测试成本。
附图说明
图1现有技术中典型电流型开关电源控制电路的信号采样示意图;
图2示出本发明一种具体实施方式结构示意图;
图3示出本发明检测到过流关断的一种具体状态各节点波形图;
图4示出利用本发明进行检测时各节点波形图;
图中附图标记名称为:1-电流检测逻辑电路 2-第一延时电路 3-第二延时电路 4-计时器 5-或逻辑电路 6-第三延时电路 7-电流比较器。
具体实施方式
下面结合附图,对本发明的具体实施方式作进一步的详细说明。
本发明所述的具备副边反馈电流检测的开关电源控制电路,包括电流检测引脚、功率管控制引脚、输入端与电流检测引脚连接的电流比较器;其特征在于,还包括输入端与电流比较器输出端连接的电流信号逻辑电路、输入端与电流信号逻辑电路输出端连接的第一延时电路;所述电流信号逻辑电路将电流比较器的输出信号逻辑不变的传递到第一延时电路;
所述第一延时电路实现如下功能:当输入信号发生表征电流检测引脚电压大于电流比较器预设的基准值的边沿跳变时, 第一延时电路输出以该边沿为起点,宽度为D1的低电平,其余时刻均输出高电平;
还包括输入端与功率管控制引脚连接的第二延时电路;所述第二延时电路实现如下功能:当功率管控制引脚表征关闭功率管的边沿到达时, 第二延时电路输出以该边沿为起点,宽度为D2的高电平,其余时刻均输出低电平;
还包括两个输入端分别与第一延时电路和第二延时电路输出端连接的或逻辑电路;
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