[实用新型]继电器配合晶体管检查电极的踩踏式报警器有效
申请号: | 201320014710.0 | 申请日: | 2013-01-11 |
公开(公告)号: | CN203055049U | 公开(公告)日: | 2013-07-10 |
发明(设计)人: | 曾艺 | 申请(专利权)人: | 王西伟 |
主分类号: | G08B13/10 | 分类号: | G08B13/10;G08B29/06 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 404704 *** | 国省代码: | 重庆;85 |
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摘要: | |||
搜索关键词: | 继电器 配合 晶体管 检查 电极 踩踏 报警器 | ||
技术领域
本实用新型涉及一种踩踏式防盗报警装置,特别是一种能够自动检查行、列电极状态的踩踏式报警器。
背景技术
“防宠物踩踏式报警器及其轮廓法测量面积区分脚型的方法”(申请号:2010102285159,申请公布号:CN 102339513 A,申请公布日:2012.02.01)公布的踩踏式报警器安排了两组电极,利用单片机逐根扫描、检测电极以区分人与小动物的踩踏。但是,该装置缺乏检查电极故障的措施,而且,行电极粘连要求其串入并出电路具有开集电极电路结构,否则可能损毁该输出口。
发明内容
为了克服“防宠物踩踏式报警器及其轮廓法测量面积区分脚型的方法”所述踩踏式报警装置的上述缺点,本实用新型提供一种继电器配合晶体管检查电极的踩踏式报警器,它既可以检测电极发生断线、同一组电极存在相邻电极粘连以及行电极与列电极发生交叉粘连,还使得行电极粘连不影响其串入并出电路。
本实用新型解决其技术问题所采用的技术方案是:它包括列电极组、行电极组、单片机系统、串入并出电路、并入串进电路、音乐电路以及电源。其中,列电极组和行电极组分别由一个长方形框架的两侧绝缘隔离并支撑着,每一组电极由彼此独立、间距均匀、裸露的导线组成,两组导线排列的方向相互垂直;单片机系统包括一块单片机及其晶振电路和上电复位电路、程序存储器以及随机存储器,单片机的输出口线P3.7连接到音乐电路的输入端,电源供电本装置的各部分电路;所述串入并出电路由74HC164级联组成:第一块74HC164的信号串行输入端A连接到单片机的输出口线P1.2,其最高位输出端QH连接到第二块74HC164的信号串行输入端A,第二块74HC164的最高位输出端QH连接到第三块74HC164的信号串行输入端A,依次类推,全部74HC164的清零端与信号串行输入端B都连接到电源的正极,全部74HC164的时钟信号输入端都连接到单片机的输出口线P1.3,每一块74HC164有8位并行输出端,全部74HC164的并行输出端一起依序构成串入并出电路的并行输出端;所述并入串进电路由74HC165级联组成:最后一块74HC165的并入串出信号端QH连接到前一块74HC165的信号串行输入端DS,依次类推,第一块74HC165的并入串出信号端QH连接到单片机的输入口线P1.5,全部74HC165的并入数据装载控制端/PL都连接到单片机的输出口线P1.6,全部74HC165的时钟信号输入端都连接到单片机的输出口线P1.7,全部74HC165的时钟使能输入端/CE都连接到电源的负极,全部74HC165的所有并行输入端一起依序构成并入串进电路的并行输入端。本实用新型还包括两个继电器及其激励电路以及两个晶体管接口电路;两个继电器及其激励电路的控制端各自连接到单片机的一根输出口线;列电极组的电极各自连接一个下拉电阻,它们的一端依序连接到并入串进电路的各个并行输入端,它们的另一端按照奇、偶排列顺序分别连接到一个继电器及其激励电路的各个输出端;行电极组电极的一端各自经过一个隔离二极管依序连接到串入并出电路的各个并行输出端,它们的另一端按照奇、偶排列顺序分别连接到一个晶体管接口电路的各个输入端,这两个晶体管接口电路的输出端各自连接到单片机的一根输入口线。
两个继电器及其激励电路的结构相同,分别由一个三极管、一个基极电阻、一个下拉电阻、一组二极管、一个继电器及其续流二极管组成;其中,基极电阻的一端构成该继电器及其激励电路的控制端,其另一端与三极管的基极以及一个下拉电阻并联,电源、继电器的线圈、三极管的集电极及其发射极构成串联回路,续流二极管采取与三极管集电极电流流向相反的方式并联在继电器线圈的两端,继电器的受控开关的一端连接到电源正极,该受控开关的另一端与一组二极管的正极并联,该组二极管的数目对应列电极组电极数目的一半,它们的负极构成该继电器及其激励电路的各个输出端。
两个晶体管接口电路的结构相同,各自由单个晶体管开关电路组成,而单个晶体管开关电路分别由一组二极管、一个晶体管、一个基极电阻、一个下拉电阻及一个上拉电阻组成,该组二极管的数目对应着行电极组电极数目的一半,它们的正极构成该晶体管接口电路的各个输入端,它们的负极都与基极电阻并联,基极电阻的另一端与晶体管的基极以及一个下拉电阻并联,电源、上拉电阻以及晶体管的两个非基极电极构成串联回路,该晶体管之非接电源负极的非基极电极构成该晶体管接口电路的输出端。
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