[发明专利]可充电电池保护器有效
申请号: | 201310205329.7 | 申请日: | 2013-05-29 |
公开(公告)号: | CN104218536A | 公开(公告)日: | 2014-12-17 |
发明(设计)人: | 黄乘黄 | 申请(专利权)人: | 株式会社理光 |
主分类号: | H02H7/18 | 分类号: | H02H7/18;H02H3/06 |
代理公司: | 上海市华诚律师事务所 31210 | 代理人: | 肖华 |
地址: | 日本东京都大*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 充电电池 保护 | ||
1.一种可充电电池保护器,其特征在于,包括:
VDD端口,经由电阻R1与所述可充电电池正极相连;
VSS端口,所述VSS端口与所述可充电电池负极相连,且所述VSS端口接地;
DOUT端口,与放电回路开关(DFET)相连;
COUT端口,与充电回路开关(CFET)相连;
V_端口,经由电阻R2与外接电路的负端相连,其中,所述外接电路的负端为所述可充电电池放电时从外接负载流出的一端,或者为充电器向所述可充电电池充电时所述充电器的负电源端;
相对参考电压产生单元,所述相对参考电压产生单元的一端与所述VDD端口相连,另一端与所述VSS端口相连,分别输出过充电检测相对参考电压和过放电检测相对参考电压;
第一固定参考电压产生单元,所述第一固定参考电压产生单元的一端与所述VSS端口相连,所述第一固定参考电压产生单元的另一端分别输出过充电检测阈值阈值电压(VDET1)和过放电检测阈值电压(VDET2);
第二固定参考电压产生单元,所述第二固定参考电压产生单元的一端与所述VSS端口相连,所述第二固定参考电压产生单元的另一端输出放电过电流检测阈值电压(VDET3);
第三固定参考电压产生单元,所述第三固定参考电压产生单元的一端与所述V_端口相连,所述第三固定参考电压产生单元的另一端输出充电过电流检测阈值电压(VDET4);
过充电检测器(VD1),所述过充电检测器(VD1)的输入端中的一端接收所述相对参考电压产生单元输出的所述过充电检测相对参考电压,所述过充电检测器(VD1)的输入端中的另一端接收所述第一固定参考电压产生单元的另一端中输出的过充电检测阈值电压(VDET1);
过放电检测器(VD2),所述过放电检测器(VD2)的输入端中的一端接收所述相对参考电压产生单元输出的所述过放电检测相对参考电压,所述过放电检测器(VD2)的输入端中的另一端接收所述第一固定参考电压产生单元的另一端中输出的过放电检测阈值电压(VDET2);
放电过电流检测器(VD3),所述放电过电流检测器(VD3)的输入端中的一端与所述V_端口相连,所述放电过电流检测器(VD3)的输入端中的另一端与所述第二固定参考电压产生单元输出放电过电流检测阈值电压(VDET3)的另一端相连;
充电过电流检测器(VD4),所述充电过电流检测器(VD4)的输入端中的一端与所述VSS端口相连,所述充电过电流检测器(VD4)的输入端中的另一端与所述第三固定参考电压产生单元输出充电过电流检测阈值电压(VDET4)的另一端相连;
负载短路检测器,所述负载短路检测器的输入端与所述V_端口相连;
第一逻辑单元,包括充电逻辑电路和电平转换器,所述充电逻辑电路的第一端与所述过充电检测器(VD1)的输出端相连,所述充电逻辑电路的第二端与所述充电过电流检测器(VD4)的输出端相连,所述充电逻辑电路的第四端与所述电平转换器的第一端相连,所述电平转换器的第二端与所述COUT端口相连;
第二逻辑单元,包括放电逻辑电路和延时电路,所述放电逻辑电路的第一端与所述过放电检测器(VD2)的输出端相连,所述放电逻辑电路的第二端与所述放电过电流检测器(VD3)的输出端相连,所述放电逻辑电路的第三端经由延时电路与所述负载短路检测器相连,所述放电逻辑电路的第五端与所述DOUT端口相连;
延时缩短电路,所述延时缩短电路的第二端与所述V_端口相连;
振荡器和计数器,所述振荡器的第一端、第二端、第三端和第四端分别与所述过充电检测器(VD1)的输出端、所述过放电检测器(VD2)的输出端、所述放电过电流检测器(VD3)的输出端、所述充电过电流检测器(VD4)的输出端相连,所述振荡器的第六端与所述延时缩短电路的第一端相连,所述振荡器的第五端与所述计数器的第一端相连,所述计数器的第二端和第三端分别与所述充电逻辑电路的第三端和所述放电逻辑电路的第四端相连;
放电过电流保护复位单元,包括FET开关N1和电阻R3,所述FET开关N1的栅极与所述放电逻辑电路的输出端相连,所述FET开关N1的源极与所述VSS端口相连,所述FET开关N1的漏极与所述电阻R3的一端相连,所述电阻R3的另一端与所述V_端口相连;
充电过电流保护复位单元,包括FET开关P1和电阻R4,所述FET开关P1的栅极与所述电平转换器的输出端相连,所述FET开关P1的源极与所述VDD端口相连,所述FET开关P1的漏极与所述电阻R4的一端相连,所述电阻R4的另一端与所述V_端口相连。
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