[发明专利]聚集页错误信令和处理有效
| 申请号: | 201180076471.5 | 申请日: | 2011-12-29 |
| 公开(公告)号: | CN104246694B | 公开(公告)日: | 2019-01-01 |
| 发明(设计)人: | B·靳兹伯格;R·罗恩;I·殴萨池依 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | G06F9/30 | 分类号: | G06F9/30;G06F9/38;G06F11/07;G06F13/00 |
| 代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 毛力 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 处理器 多页 存储器地址 指令流水线 错误信息 处理指示 地址指令 多存储器 通信接口 耦合的 信令 指令 关联 | ||
1.一种处理器,包括:
指令流水线,用于处理会指示多个存储器地址的多存储器地址指令;以及
所述处理器的存储器管理子系统中的多页错误聚集逻辑单元,所述存储器管理子系统包括存储器管理单元MMU并且与所述指令流水线耦合,所述多页错误聚集逻辑单元用于聚集针对多个页错误的页错误信息,所述多个页错误各自与所述多存储器地址指令的多个存储器地址之一相关联,其中,在所述多页错误聚集逻辑单元向操作系统通知所述多个页错误中的任一个之前聚集所述页错误信息,所述处理器的存储器管理子系统中的所述多页错误聚集逻辑单元还用于将聚集的页错误信息提供给页错误通信接口,所述页错误通信接口被所述处理器所使用以和所述操作系统交换信息。
2.如权利要求1所述的处理器,其特征在于,所述多页错误聚集逻辑单元还用于,向所述操作系统发起针对所述多个页错误的、单个的多页页错误。
3.如权利要求2所述的处理器,其特征在于,所述处理器还用于,从所述操作系统接收针对所述多个页错误的、来自所述单个的多页页错误的单个返回。
4.如权利要求1所述的处理器,其特征在于,所述多页错误聚集逻辑单元还用于向所述页错误通信接口提供多个出错的地址,其中每一出错的地址与所述多个页错误之一相对应。
5.如权利要求1所述的处理器,其特征在于,所述多页错误聚集逻辑单元还用于向所述页错误通信接口提供用于所述多个页错误的聚集错误代码信息。
6.如权利要求5所述的处理器,其特征在于,所述聚集错误代码信息包括所述多个页错误中的第一页错误所专有的第一错误代码信息以及所述多个页错误中的第二页错误所专有的第二错误代码信息。
7.如权利要求1所述的处理器,其特征在于,所述多页错误聚集逻辑单元还用于向所述页错误通信接口提供所述多个页错误的数量。
8.如权利要求1-7中任一项所述的处理器,其特征在于,所述多页错误聚集逻辑单元是所述处理器的存储器管理子系统的一部分。
9.如权利要求1所述的处理器,其特征在于,响应于来自处理器的单次访问的所有出错页是由所述操作系统来解决的。
10.一种在处理器中以信号通知聚集页错误的方法,包括:
检测多个页错误;
在向操作系统通知所述多个页错误中的任一个之前,用所述处理器的存储器管理子系统的管芯上逻辑来聚集针对所述多个页错误的页错误信息,所述存储器管理子系统包括存储器管理单元MMU;
将针对所述多个页错误的聚集页错误信息从所述处理器提供给页错误通信接口,所述页错误通信接口用于从所述处理器向操作系统提供信息;以及
在所述页错误信息的聚集之后,从所述处理器向所述操作系统用信号通知用于所述多个页错误的单个多页页错误。
11.如权利要求10所述的方法,其特征在于,还包括接收指示多个存储器地址的多存储器地址指令,并且用于检测所述多个页错误的步骤包括检测各自与所述多存储器地址指令所指示的多个存储器地址之一相对应的多个页错误。
12.如权利要求10所述的方法,其特征在于,还包括接收来自所述多页页错误的单个返回。
13.如权利要求10所述的方法,其特征在于,用于提供所述聚集页错误信息的步骤包括将所述聚集的页错误信息存储在寄存器和栈中的至少一者中。
14.如权利要求10所述的方法,其特征在于,用于提供所述聚集页错误信息的步骤包括向所述页错误通信接口提供多个出错的地址,其中每一出错的地址与所述多个页错误之一相对应。
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