[发明专利]一种在EPON系统中实现OLT与ONU之间时钟同步的方法有效
申请号: | 201110367113.1 | 申请日: | 2011-11-18 |
公开(公告)号: | CN102412923A | 公开(公告)日: | 2012-04-11 |
发明(设计)人: | 易涛;张前进;王瑞波 | 申请(专利权)人: | 烽火通信科技股份有限公司 |
主分类号: | H04J3/06 | 分类号: | H04J3/06 |
代理公司: | 北京捷诚信通专利事务所(普通合伙) 11221 | 代理人: | 魏殿绅;庞炳良 |
地址: | 430074 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 epon 系统 实现 olt onu 之间 时钟 同步 方法 | ||
技术领域
本发明涉及在以太网无源光网络EPON 中OLT与ONU之间时钟同步,具体说是一种在EPON系统中实现OLT与ONU之间时钟同步的方法。OLT是光网络局端(Optical Line Terminal),ONU是光网络单元(Optical NetworksUnit)。
背景技术
光纤通信由于其大容量、高速率、受电磁干扰的影响小等优点,从其出现便受到了人们的青睐。目前,高速率的光纤传输技术已广泛应用于各个主干网络中。以太网无源光网络(EPON)由于其低成本的可分时为用户提供高性能的接入,故而成为相关运营商的首选方案,为人们在信息的世界中遨游,提供了必要条件。如今,视频聊天,电话会议,网络互动游戏,数字点播,高清电视等越来越多的视频业务和交互式业务开始走进了千家万户。
然而伴随着多业务的发展,人们对网络带宽的需求也提出了新的需求。目前用于光纤到户(FTTx)的EPON接入系统,所提供的带宽已经影响了终端用户的上网需求及体验,不能很好的满足人们对视频信号更清晰以及其他传输数据更快速的要求。
在用户侧,由于某些应用场景需要使用到高精度的且与局端同步的时钟信号,使用最多的是采用GPS等方式获取时钟信号。但是这种获取时钟方式的成本较高,需要增加相应的设备投入。
在现在的EPON系统中,OLT与ONU的时钟大多都采用自适应时钟,通过内部的DSP(数字信号处理器)来动态调整时钟,即DSP通过软件不停的分析计算来调整,达到时钟的同步。但这种方法存在的问题是:
1、由于OLT与ONU两边都通过软件动态来调整,不能长时间都保证OLT与ONU之间时钟完全同步;
2、通过软件动态调整,ONU端的时钟要达到与OLT端时钟同步所需要花费的时间太长;
3、通过软件动态调整,增加了OLT与ONU的功耗;
4、时钟容易受到分组网络的性能影响,所以ONU侧恢复出来的时钟在抖动指标和漂移特性等方面不是很理想。
发明内容
针对现有技术中存在的缺陷,本发明的目的在于提供一种在EPON系统中实现OLT与ONU之间时钟同步的方法,要解决的技术问题是如何从根本上解决ONU与OLT之间的时钟同步问题,从而为ONU侧提供更好的业务质量。
为达到以上目的,本发明采取的技术方案是:
一种在EPON系统中实现OLT与ONU之间时钟同步的方法,其特征在于,具体步骤为:
步骤1,在EPON局端,E1数据接入到局端的TDM机盘,所述E1数据是外接要传输的数据信息,其携带有2.048MBit的时钟信息,
步骤2,局端的TDM机盘将时钟信息和数据信息分别提取出来,并将提取出来的时钟信息作为整个系统时钟同步的时钟源头,
局端的TDM机盘将E1码流转换成为以太网数据流,发往局端的主控机盘,通过主控机盘的交换送往EPON线卡机盘,EPON线卡机盘即OLT,
同时将2.048MHz的时钟作为整个系统的时钟,通过时钟接口芯片处理后发往EPON线卡机盘使用,
步骤3,EPON线卡机盘收到2.048Mhz的时钟后,送入PLL接口芯片,转换成125M的PON时钟,供PON芯片正常工作,经过PON芯片处理,把时钟通过光纤传至ONU侧,完成PON数据的传输,此数据携带有Bit的时钟信息;
步骤4,在光网络单元ONU端,在EPON上联盘中,光信号通过光模块、PON芯片,实现光信号与以太网包的转换,
通过在PON芯片上提取从OLT恢复的125MHZ时钟,将该时钟送给锁相环PLL产生19.44MHZ频率时钟,将此19.44MHZ时钟送给ONU侧的TDM机盘使用,从而实现OLT与ONU时钟同步。
在上述技术方案的基础上,ONU侧的TDM机盘收到19.44MHZ频率时钟后,送入CESOP芯片以此19.44MHZ的时钟为参考源,经过内部算法处理后将E1数据恢复出来,这个E1数据流中含有恢复出来的2Mbit时钟信号,它与局端的时钟同源。
在上述技术方案的基础上,步骤2具体操作如下:
局端的TDM机盘通过片内集成线路接口单元LIU接口芯片将时钟信息和数据信息分别提取出来,并将提取出来的时钟信息作为整个系统时钟同步的时钟源头,此时钟将同时送往锁相环PLL和分组网络电路仿真业务CESoP芯片,
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