[发明专利]一种时钟控制和复位控制的方法和装置有效

专利信息
申请号: 201110300866.0 申请日: 2011-09-28
公开(公告)号: CN103019300A 公开(公告)日: 2013-04-03
发明(设计)人: 唐新东 申请(专利权)人: 重庆重邮信科通信技术有限公司
主分类号: G06F1/04 分类号: G06F1/04;G06F1/24
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 逯长明
地址: 400065 *** 国省代码: 重庆;85
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摘要:
搜索关键词: 一种 时钟 控制 复位 方法 装置
【说明书】:

技术领域

发明涉及电子技术领域,特别涉及一种时钟控制和复位控制的方法和装置。

背景技术

芯片的时钟控制和复位控制设计在芯片硬件实现之后,通过软件进行时钟及复位的打开、关闭(或有效,无效)等开发控制。

芯片各模块的时钟控制按照时钟标识(Identity,ID)顺序执行,各模块的复位控制则按照复位ID顺序执行。

对于时钟开关,复位控制等这样的控制功能,软件实现时,通常做法需要将模块的ID编号值作为参数,传递给实际控制寄存器的底层函数,一个ID值就对应着某个寄存器中的一个控制比特(BIT)位。所以,需要将所有模块控制功能进行编号排序。那么,时钟ID是对所有时钟控制功能进行排序,得到的一个排序表;复位ID是将所有的复位控制功能进行排序,得到的一个ID顺序表。

以下对使用时钟ID和复位ID进行控制操作的过程进行说明,需要说明的是时钟ID和复位ID的使用方法是相同的,所以在本例中不对其进行区分,均称为ID;如图1所示,具体流程如下:

101:底层控制函数接收一个ID值;还可能同时接收到开关操作指示等参数;

102:底层控制函数获取该ID值对应的寄存器地址;获取的方式可以是:判断该ID值是否大于等于本寄存器的BIT0位置的ID值,且小于下一个寄存器BIT0位置的ID值,如果是则确定上述本寄存器的地址记录下来,记作地址A。

103:底层控制函数计算该ID值和该ID对应的寄存器BIT0位置的ID值的差值,然后根据这个差值计算该ID值对应的寄存器中的BIT位置,可以记作BIT位置B;

104:底层控制函数根据得到的寄存器地址和寄存器中的BIT位置(即:地址A和BIT位置B)执行相应的控制功能。控制功能可以有很多,例如:开关控制、复位控制等。

发明人在实现本发明实施例的过程中发现,由于在一个多模块的系统中,时钟和复位并不是一一对应的,因此时钟ID和复位ID的顺序不同。依照以上方法,时钟控制的实现需要维护一个时钟ID顺序表,需要对某个时钟进行开、关操作时,将此时钟的ID传递给时钟控制函数。复位控制的实现则需要维护一个复位ID顺序表,当需要对某个复位进行开、关操作时,将此复位ID传递给复位控制函数。如果同时实现时钟和复位控制,则一方面需要维护两套ID表,另一方面,在时钟控制函数和复位控制函数中,对寄存器地址A的获取及BIT位置B的获取进行的ID值获取分别独立;因而,软件复杂度和代码量均较大,可维护性也差;同时,导致了控制执行的效率低,软件开发时间长并且难维护的问题。

发明内容

本发明实施例提供了一种时钟控制和复位控制的方法和装置,降低软件复杂度和代码量,提高可维护性;同时,提高了时钟和复位控制执行的效率。

一种实现时钟控制和复位控制的方法,包括:

确认当前模块是否至少有时钟信号的控制或者复位信号的控制中的一种,若有,则根据时钟控制和复位控制的对应关系进行编号,将编号得到的标识序号加入标识表中;

根据标识序号与时钟控制和复位控制的对应关系,选择有效控制位或保留位设计复位控制寄存器以及时钟控制寄存器。

一种时钟控制和复位控制的装置,包括:

信号确认单元,用于确认当前模块是否至少有时钟信号的控制或者复位信号的控制中的一种;

标识表维护单元,用于信号确认单元确认结果为有,则根据时钟控制和复位控制的对应关系进行编号,将编号得到的标识序号加入标识表中;

寄存器设计单元,用于根据标识序号与时钟控制和复位控制的对应关系,选择有效控制位或保留位设计时钟控制寄存器以及复位控制寄存器。

从以上技术方案可以看出,本发明实施例具有以下优点:通过在寄存器中增加保留位,保证使用同一ID值可以用于时钟和复位控制,从而降低软件复杂度和代码量,提高可维护性;同时,提高时钟和复位控制执行的效率。

附图说明

为了更清楚地说明本发明实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简要介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域的普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。

图1为现有技术时钟和复位控制流程示意图;

图2为本发明实施例时钟和复位控制流程示意图;

图3为本发明实施例装置结构示意图;

图4为本发明实施例装置结构示意图;

图5为本发明实施例寄存器示意图。

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