[发明专利]用于数据存储装置的命令及中断分组有效
申请号: | 201080020319.0 | 申请日: | 2010-04-01 |
公开(公告)号: | CN102428451A | 公开(公告)日: | 2012-04-25 |
发明(设计)人: | 安德鲁·T·斯温;阿尔贝特·T·博尔歇斯;格兰特·格林德勒 | 申请(专利权)人: | 谷歌公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/42 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 刘国伟 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 数据 存储 装置 命令 中断 分组 | ||
1.一种数据存储装置(100),其包含:
多个存储器芯片(118a、118b);及
控制器(110),其可操作地耦合到所述存储器芯片(118a、118b)且经布置及配置以:
从主机(106)接收命令群组,其中所述群组中的所述命令中的每一者包括相同群组编号以将所述命令识别为所述群组的部分,
使用所述存储器芯片(118a、118b)来处理所述命令的所述群组,及
在所述命令的所述群组完成处理时产生单个中断并将所述单个中断发送到所述主机(106)。
2.根据权利要求1所述的数据存储装置(100),其中所述控制器(110)经配置以:
从所述主机(106)接收多个命令群组,其中所述命令中的每一者包括群组编号以将所述命令识别为所述群组中的一者的部分,
使用所述存储器芯片(118a、118b)来处理所述命令的所述群组;及
在所述命令的所述群组中的每一者完成处理时针对所述群组中的每一者产生单个中断并将所述单个中断发送到所述主机(106)。
3.根据权利要求2所述的数据存储装置(100),其中所述控制器(110)经配置以使用所述存储器芯片(118a、118b)按非邻接次序来处理所述命令的所述群组。
4.根据前述权利要求中任一权利要求所述的数据存储装置(100),其中所述命令中的每一者包括命令标头(314)且所述命令标头(314)包括所述群组编号。
5.根据前述权利要求中任一权利要求所述的数据存储装置(100),其中所述命令的所述群组中的最后命令包括命令标头(314)中的用以向所述控制器(110)指示所述最后命令的旗标。
6.根据前述权利要求中任一权利要求所述的数据存储装置(100),其中所述群组编号将所述命令中的每一者识别为所述群组的部分而不使用所述命令中的指针来指向所述群组中的下一命令。
7.根据前述权利要求中任一权利要求所述的数据存储装置(100),其中所述控制器(110)包含中断处理器(124),所述中断处理器(124)经布置及配置以在所述命令由所述控制器(110)处理时追踪所述命令的所述群组,且在所述命令的所述群组完成处理时产生所述单个中断并将所述单个中断发送到所述主机(106)。
8.根据权利要求7所述的数据存储装置(100),其中所述中断处理器(124)包含多个计数器,其中所述计数器中的每一者被指派给由所述控制器(110)接收的不同命令群组。
9.根据权利要求7或8所述的数据存储装置(100),其中所述中断处理器(124)包含多个不同中断机制。
10.根据权利要求9所述的数据存储装置(100),其中一个以上中断机制在相同时间启用。
11.根据权利要求9或10所述的数据存储装置(100),其中所述中断机制包括水印中断机制、超时中断机制及群组中断机制。
12.根据前述权利要求中任一权利要求所述的数据存储装置(100),其中所述存储器芯片(118a、118b)为快闪存储器芯片,且所述控制器(110)为现场可编程门阵列FPGA控制器。
13.根据权利要求12所述的数据存储装置(100),其进一步包含:
存储器板,在所述存储器板上所述快闪存储器芯片布置及配置成多个通道,其中所述通道中的每一者与所述快闪存储器芯片中的一者或一者以上相关联;及
控制器板(102),其可操作地连接到所述存储器板,其中所述控制器板(102)包含:
高速接口(108);及
所述控制器(110),其经布置及配置以使用所述高速接口(108)从所述主机(106)接收所述命令。
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