[实用新型]具多功能电源控制芯片接脚的控制电路及侦测电路无效
申请号: | 201020187580.7 | 申请日: | 2010-12-23 |
公开(公告)号: | CN201994627U | 公开(公告)日: | 2011-09-28 |
发明(设计)人: | 郑荣霈;黄培伦 | 申请(专利权)人: | 日隆电子股份有限公司 |
主分类号: | H02H3/20 | 分类号: | H02H3/20;H02H5/04;G01R19/165;G01K7/22 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 逯长明 |
地址: | 英属西印度群岛大开曼岛西湾路4*** | 国省代码: | 开曼群岛;KY |
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摘要: | |||
搜索关键词: | 多功能 电源 控制 芯片 控制电路 侦测 电路 | ||
技术领域
本实用新型涉及一种电源控制芯片(power control integrated circuit),特别是关于一种整合多种功能于一电源控制芯片接脚的控制电路及侦测电路。
背景技术
近年来,因能源危机及环保概念抬头,各国除积极开发新的替代能源,并严格规定电器的转换效率及空载待机能耗。此外,在系统保护方面,也要求需具完整的保护功能,以提高系统的安全性,此意味着电源控制芯片需增加额外的接脚来支持保护功能,造成电源控制芯片封装成本的增加。图1是现有架构下的电源控制芯片,其第一接脚为致能/禁能接脚EN/DIS,用以控制整个系统在致能/禁能(enable/disable)模式之间转换,在系统空载时禁能该控制芯片以降低待机能耗。若要加入过电压及过温度等保护功能,则控制芯片需额外增加保护接脚PRO,如此将使芯片从八支接脚变为十支接脚,因而需使用较大的封装,增加系统成本支出。因此,如何以有限的接脚数达到降低待机能耗与支持保护功能即为一项关键技术。
实用新型内容
本实用新型的目的之一,在于提出一种整合多种功能于一电源控制芯片接脚的控制电路及侦测电路。
根据本实用新型,一种整合多种功能于一电源控制芯片接脚的控制电路包括:一致能/禁能开关连接于该接脚及一第一电压端之间;一稽纳二极管逆向连接于一电压源及该接脚之间,其具有一崩溃电压;一第一电阻与该稽纳二极管串联于该接脚及该电压源之间;一热敏电阻连接于该接脚及一第二电压端之间,其具有一负温度系数;一电流源连接该接脚;以及一侦测电路连接该接脚,其监测该接脚的电压以触发禁能信号、过电压信号或过温度信号。
优选地,该致能/禁能开关包括一晶体管。
优选地,该第一电压端是一接地端。
该第二电压端是一接地端。优选地,该控制电路更包括一第二电阻与该热敏电阻串联于该接脚及该第二电压端之间。
优选地,该第二电压端是一接地端。
优选地,该电流源包括一定电流源。
优选地,该电流源在该电源控制芯片的内部。
优选地,该电流源在该电源控制芯片的外部。
优选地,该侦测电路包括:第一比较器比较该接脚的电压和第一电压门坎值,以产生该禁能信号;第二比较器比较该接脚的电压和第二电压门坎值,以产生该过电压信号;以及第三比较器比较该接脚的电压和第三电压门坎值,以产生该过温度信号。
优选地,该侦测电路更包括一抗突波脉冲器连接该第一比较器,在该禁能信号持续一段抗突波脉冲时间后再释放该禁能信号。
优选地,该侦测电路更包括一逻辑闸因应该过电压信号产生一闭锁信号。
优选地,该侦测电路更包括一抗突波脉冲器连接该第二比较器,在该过电压信号持续一段抗突波脉冲时间后再释放该过电压信号。
优选地,该侦测电路更包括一逻辑闸连接该抗突波脉冲器,以产生一闭锁信号。
优选地,该侦测电路更包括一逻辑闸因应该过温度信号产生一闭锁信号。
优选地,该侦测电路更包括一延迟器连接该第三比较器,在该过温度信号持续一段延迟时间后再释放该过温度信号。
优选地,该侦测电路更包括一逻辑闸连接该延迟器,以产生一闭锁信号。
另外,本实用新型还提供一种整合多种功能于一电源控制芯片接脚的侦测电路,包括:第一比较器连接该接脚,比较该接脚的电压和第一电压门坎值,据以触发一禁能信号;第二比较器连接该接脚,比较该接脚的电压和第二电压门坎值,据以触发一过电压信号;以及第三比较器连接该接脚,比较该接脚的电压和第三电压门坎值,据以触发一过温度信号。
优选地,该侦测电路更包括一抗突波脉冲器连接该第一比较器,在该禁能信号持续一段抗突波脉冲时间后再释放该禁能信号。
优选地,该侦测电路更包括一逻辑闸因应该过电压信号产生一闭锁信号。
优选地,更包括一抗突波脉冲器连接该第二比较器,在该过电压信号持续一段抗突波脉冲时间后再释放该过电压信号。
优选地,更包括一逻辑闸连接该抗突波脉冲器,以产生一闭锁信号。
优选地,该侦测电路更包括一逻辑闸因应该过温度信号产生一闭锁信号。
优选地,该侦测电路更包括一延迟器连接该第三比较器,在该过温度信号持续一段延迟时间后再释放该过温度信号。
优选地,更包括一逻辑闸连接该延迟器,以产生一闭锁信号。
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