[发明专利]片上系统(SOC)的功率测量技术有效
| 申请号： | 201010279917.1 | 申请日： | 2010-09-09 |
| 公开（公告）号： | CN102023256A | 公开（公告）日： | 2011-04-20 |
| 发明（设计）人： | S·拉达克里希南;S·S·塔恩;S·J·乔丹;L·P·洛伊;Y-F·刘 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G01R21/01 | 分类号： | G01R21/01;G06F1/16 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜;王英 |
| 地址： | 美国加*** | 国省代码： | 美国;US |
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| 摘要： | |||
| 搜索关键词： | 系统 soc 功率 测量 技术 | ||
1.一种方法，包括：
将片上系统(SOC)的一个或多个接口设置为空闲模式；
将所述SOC中的一个或多个处理器核心设置为空闲状态；
禁止对所述SOC的一个或多个时钟输入；
降低所述SOC的一个或多个逻辑块的电压电平，所述一个或多个逻辑块具有共同的电压面；以及
测量所述SOC的功耗。
2.根据权利要求1所述的方法，其中，将所述SOC的所述一个或多个接口设置为所述空闲模式包括：设置与所述SOC的所述一个或多个接口相关联的一个或多个模式寄存器。
3.根据权利要求1所述的方法，其中，所述SOC的所述一个或多个逻辑块包括一个或多个寄存器，并且其中，降低所述SOC的所述一个或多个逻辑块的所述电压电平包括：在使得每一个寄存器能够保持其状态的情况下降低所述一个或多个逻辑块的所述电压电平。
4.根据权利要求1所述的方法，其中，所述SOC的所述一个或多个接口包括直接媒体接口(DMI)、快速外围组件互连(PCI-E)接口，以及公共系统接口(CSI)中的一个或多个。
5.根据权利要求1所述的方法，其中，所述SOC的所述一个或多个接口的所述空闲模式至少部分地符合活动状态电源管(ASPM)空闲状态。
6.根据权利要求1所述的方法，其中，禁止对所述SOC的所述一个或多个时钟输入包括：关闭所述SOC的一个或多个锁相环(PLL)。
7.根据权利要求1所述的方法，其中，所述一个或多个处理器核心的所述空闲状态至少部分地符合高级配置和电源接口(ACPI)空闲状态。
8.一种方法，包括：
将片上系统(SOC)的一个或多个接口设置为活动模式；
将所述SOC中的一个或多个处理器核心设置为空闲状态；
启动对所述SOC的一个或多个时钟输入；
将通信业务提供给所述SOC；以及
测量所述SOC的功耗。
9.根据权利要求8所述的方法，其中，将所述SOC的所述一个或多个接口设置为所述活动模式包括：设置与所述SOC的所述一个或多个接口相关联的一个或多个模式寄存器。
10.根据权利要求8所述的方法，还包括将对等通信业务提供给所述SOC。
11.根据权利要求8所述的方法，其中，所述SOC的所述一个或多个接口包括直接媒体接口(DMI)、快速外围组件互连(PCI-E)接口，以及公共系统接口(CSI)中的一个或多个。
12.根据权利要求8所述的方法，其中，所述SOC的所述一个或多个接口的所述空闲模式至少部分地符合活动状态电源管理(ASPM)空闲状态。
13.根据权利要求8所述的方法，其中，所述一个或多个处理器核心的所述空闲状态至少部分地符合高级配置和电源接口(ACPI)空闲状态。
14.一种装置，包括：
功率管理逻辑，其用于：
控制一个或多个功率门，每一个功率门与电压输入和一个或多个逻辑块的功率域耦合；以及
控制对所述一个或多个逻辑块的一个或多个时钟输入。
15.根据权利要求14所述的装置，其中，所述功率管理逻辑还用于控制所述装置的一个或多个接口中的每一个的链路状态。
16.根据权利要求14所述的装置，其中，响应于每一个功率门的激活，每一个功率门将所述电压输入提供给所述一个或多个逻辑块的所述功率域。
17.根据权利要求14所述的装置，其中，响应于每一个功率门的停用，每一个功率门用于：
降低所述电压输入；以及
将所降低的电压输入提供给所述一个或多个逻辑块的所述功率域。
18.根据权利要求15所述的装置，其中，所述一个或多个接口包括直接媒体接口(DMI)、快速外围组件互连(PCI-E)接口，以及公共系统接口(CSI)中的一个或多个。
19.根据权利要求14所述的装置，其中，所述功率管理逻辑还用于控制所述装置的输入/输出(I/O)逻辑。
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