[发明专利]复位方法及复位控制装置有效

专利信息
申请号: 201010167811.2 申请日: 2010-04-30
公开(公告)号: CN101840259A 公开(公告)日: 2010-09-22
发明(设计)人: 邓志吉 申请(专利权)人: 北京星网锐捷网络技术有限公司
主分类号: G06F1/24 分类号: G06F1/24
代理公司: 北京同立钧成知识产权代理有限公司 11205 代理人: 王申
地址: 100036 北京市海*** 国省代码: 北京;11
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摘要:
搜索关键词: 复位 方法 控制 装置
【权利要求书】:

1.一种复位方法,其特征在于,包括:

接收到复位信号后,指示电子设备的CPU执行信息收集操作及数据保存操作,并启用一级硬件定时器;

当所述CPU执行所述信息收集操作及数据保存操作的延迟时间使所述一级硬件定时器超时时,启用二级硬件定时器;

当所述CPU执行所述信息收集操作及数据保存操作时发生的延迟次数使所述二级硬件定时器超时时,指示所述CPU停止执行所述信息收集操作但继续执行所述数据保存操作,并启用三级硬件定时器;

当所述CPU执行所述数据保存操作时发生的延时次数使所述三级硬件定时器超时时,发出整机复位指示信号,指示所述电子设备进行整机复位。

2.根据权利要求1所述的方法,其特征在于,所述启用一级硬件定时器之后还包括:当所述CPU完成所述信息收集操作及数据保存操作后的等待时间使所述一级硬件定时器超时时,发出整机复位指示信号,指示所述电子设备进行整机复位。

3.根据权利要求2所述的方法,其特征在于,所述启用三级硬件定时器之前还包括:当所述CPU完成数据保存操作后的等待时间使所述一级硬件定时器超时时,发出整机复位指示信号,指示所述电子设备进行整机复位。

4.根据权利要求3所述的方法,其特征在于,所述一级硬件定时器为第一非归零计数器,所述接收到复位信号后,指示电子设备的CPU执行信息收集操作及数据保存操作,并启用一级硬件定时器包括:

接收到复位信号后,将所述复位信号作为时钟信号触发D触发器输出高电平信号;

所述D触发器输出的高电平信号使能所述第一非归零计数器对所述时钟信号进行计数,当接收到来自于所述CPU的清零信号时,对所述第一非归零计数器进行清零操作;

由所述复位信号直接指示所述CPU执行信息收集操作及数据保存操作。

5.根据权利要求4所述的方法,其特征在于,所述二级硬件定时器为第二非归零计数器,所述当所述CPU执行所述信息收集操作及数据保存操作的延迟时间使所述一级硬件定时器超时时,启用二级硬件定时器包括:

所述D触发器输出的高电平信号使能所述第二非归零计数器对所述第一非归零计数器的第P位输出端输出的高电平信号进行计数,其中,P为自然数。

6.根据权利要求5所述的方法,其特征在于,所述当所述二级硬件定时器超时,指示所述CPU停止执行所述信息收集操作但继续执行所述数据保存操作,并启用三级硬件定时器包括:

由所述第二非归零计数器的第M位输出的高电平信号指示所述CPU停止执行所述信息收集操作但继续执行所述数据保存操作,并使能所述第三非归零计数器对所述第一非归零计数器的第N位输出端输出的高电平信号进行计数,其中,M和N为自然数,且M<N<P。

7.根据权利要求6所述的方法,其特征在于,当所述CPU执行所述数据保存操作时发生的延时次数使所述三级硬件定时器超时时,发出整机复位指示信号包括:所述第三非归零计数器的第M位输出端输出高电平信号作为所述整机复位指示信号。

8.根据权利要求7所述的方法,其特征在于,当所述CPU完成所述信息收集操作及数据保存操作后的等待时间使所述一级硬件定时器超时时,发出整机复位指示信号包括:所述第一非归零计数器的第R位输出端输出高电平信号作为所述整机复位指示信号,其中,R为自然数,且M<N<P<R。

9.根据权利要求8所述的方法,其特征在于,当所述CPU完成数据保存操作后的等待时间使所述一级硬件定时器超时时,发出整机复位指示信号,指示所述电子设备进行整机复位包括:所述第一非归零计数器的第Q位输出端输出的高电平信号与所述第二非归零计数器的第M位输出端输出的高电平信号进行与操作后输出所述整机复位指示信号,其中,Q为自然数,且M<N<P<Q<R。

10.根据权利要求9所述的方法,其特征在于,所述将所述复位信号作为时钟信号触发D触发器输出高电平信号之后还包括,所述D触发器输出的高电平信号使能第四非归零计数器对所述清零信号进行计数,并由该第四非归零计数器的第S位输出端输出高电平信号作为整机复位指示信号,指示所述电子设备进行整机复位,其中,S为自然数,且M<N<P<Q<R<S。

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