[发明专利]数据处理系统中的高速缓存一致性协议有效

专利信息
申请号: 200980115765.7 申请日: 2009-02-23
公开(公告)号: CN102016790A 公开(公告)日: 2011-04-13
发明(设计)人: 威廉·C·莫耶 申请(专利权)人: 飞思卡尔半导体公司
主分类号: G06F9/06 分类号: G06F9/06;G06F12/08;G06F9/00
代理公司: 中原信达知识产权代理有限责任公司 11219 代理人: 刘光明;穆德骏
地址: 美国得*** 国省代码: 美国;US
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摘要:
搜索关键词: 数据处理系统 中的 高速缓存 一致性 协议
【权利要求书】:

1.一种数据处理系统,包括:

第一主设备,所述第一主设备包括高速缓存;

第二主设备;

存储器,所述存储器经由系统互连可操作地耦接到所述第一主设备和所述第二主设备;

其中,所述高速缓存包括高速缓存控制器,所述高速缓存控制器为所述高速缓存的数据单元实现一组高速缓存一致性状态,所述高速缓存一致性状态包括:

无效状态;

未修改的非一致状态,所述未修改的非一致状态指示没有修改所述高速缓存的数据单元中的数据,并且不保证所述高速缓存的数据单元中的数据与所述数据处理系统的至少一个其他存储设备中的数据是一致的;和

未修改的一致状态,所述未修改的一致状态指示没有修改所述数据单元的数据,并且所述数据单元的数据与所述数据处理系统的至少一个其他存储设备中的数据是一致的。

2.如权利要求1所述的数据处理系统,其中,响应于所述高速缓存的读取未命中,进行从所述高速缓存的数据单元的所述无效状态到所述未修改的非一致状态的转换,其中,所述读取未命中的数据被写入到所述数据单元,其中,响应于所述读取未命中不对所述数据处理系统的任何其他高速缓存执行高速缓存一致性操作。

3.如权利要求1所述的数据处理系统,其中:

响应于写入高速缓存未命中,其中写入未命中的数据被写入的从所述高速缓存的数据单元的所述无效状态到所述未修改的非一致状态的转换不产生在所述数据处理系统的其他高速缓存中的高速缓存一致性操作。

4.如权利要求1所述的数据处理系统,其中,从所述高速缓存的数据单元的所述无效状态到所述未修改的非一致状态的转换不会引起所述数据处理系统的其他高速缓存内的查找操作,所述查找操作用于确定那些高速缓存是否包含对应于正被写入到所述数据单元的数据的存储器地址。

5.如权利要求1所述的数据处理系统,其中,当所述高速缓存的数据单元处于所述未修改的非一致状态时,指向那个数据单元的侦听事务不会导致那个数据单元的一致性状态的改变。

6.如权利要求1所述的数据处理系统,其中,响应于在其中高速缓存未命中的数据被写入到所述高速缓存的数据单元的高速缓存未命中:

响应于指示写入到所述数据单元的数据不需要写通的写通需求属性,进行从所述高速缓存的数据单元的所述无效状态到所述未修改的非一致状态的转换;

响应于指示写入到所述高速缓存的所述数据单元的数据需要写通的写通需求属性,进行从所述高速缓存的数据单元的所述无效状态到所述未修改的一致状态的转换。

7.如权利要求6所述的数据处理系统,其中:

所述高速缓存未命中是写入未命中;

如果所述写通需求属性指示所述写入未命中的数据需要写通,则所述写入未命中的数据不在后续的回写总线事务中被写入到存储器。

8.如权利要求1所述的数据处理系统,其中,所述高速缓存一致性状态进一步包括:

修改的非一致状态,所述修改的非一致状态指示修改了所述高速缓存的数据单元中的数据,并且不保证所述高速缓存的数据单元中的数据与所述数据处理系统的至少一个其他存储设备中的数据是一致的。

9.如权利要求8所述的数据处理系统,其中,响应于所述数据单元的数据的写入命中,进行从所述高速缓存的数据单元的所述未修改的非一致状态到所述修改的非一致状态的转换。

10.如权利要求9所述的数据处理系统,其中:

当处于所述未修改的一致状态时,所述高速缓存的数据单元的数据的写入命中产生到所述存储器的数据的写通;

当处于所述未修改的非一致状态时,所述高速缓存的数据单元的数据的写入命中不产生数据的写通操作。

11.如权利要求8所述的数据处理系统,其中,响应于不带有对于所述数据单元的无效高速缓存操作命令的刷新高速缓存操作命令以及所述写通需求属性指示所述数据单元的数据不需要写通,进行从所述高速缓存的数据单元的所述修改的非一致状态到所述未修改的非一致状态的转换。

12.如权利要求8所述的数据处理系统,其中,响应于所述数据单元的刷新高速缓存操作命令以及数据的所述写通需求属性指示所述数据需要写通,进行从所述高速缓存的数据单元的所述修改的非一致状态到所述未修改的一致状态的转换。

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