[发明专利]隐藏存储器访问模式有效

专利信息
申请号: 200710303558.7 申请日: 2007-12-27
公开(公告)号: CN101231621A 公开(公告)日: 2008-07-30
发明(设计)人: M·J·巴克斯顿;E·F·布里克尔;Q·A·雅克布森;H·王;B·V·帕特尔 申请(专利权)人: 英特尔公司
主分类号: G06F12/14 分类号: G06F12/14;G06F12/08
代理公司: 永新专利商标代理有限公司 代理人: 王英
地址: 美国加*** 国省代码: 美国;US
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摘要:
搜索关键词: 隐藏 存储器 访问 模式
【权利要求书】:

1.一种方法,包括:

对于与一个线程相关联的一组存储器单元中的每个存储器单元,设置与所述存储器单元相关联的指示,以使得如果所述存储器单元的数据被从高速缓存中清除,则请求一个信号;以及

响应于所述信号,将该组存储器单元重新加载到所述高速缓存中。

2.如权利要求1所述的方法,进一步包括以下述顺序中至少一种将该组存储器单元加载到所述高速缓存中:

随机顺序;以及

预定顺序。

3.如权利要求1所述的方法,其中所述信号进一步包括中断,所述方法进一步包括注册一个处理程序来响应所述信号。

4.如权利要求1所述的方法,其中该组存储器单元进一步包括其数据至少部分对所述线程私有的一组存储器单元。

5.如权利要求2所述的方法,其中所述信号包括中断,并且其中将该组存储器单元重新加载到所述高速缓存中进一步包括处理器逻辑以下述顺序中至少一种将该组存储器单元重新加载到所述高速缓存中:

随机顺序;以及

预定顺序。

6.如权利要求3所述的方法,其中将该组存储器单元重新加载到所述高速缓存中进一步包括所述处理程序以下述顺序中至少一种将该组存储器单元重新加载到所述高速缓存中:

随机顺序;以及

预定顺序。

7.如权利要求3所述的方法,其中设置与所述存储器单元相关联的指示进一步包括将与所述存储器单元的数据的高速缓存行相关联的属性位设定为预定值,所述方法进一步包括处理器逻辑检测所述存储器单元的数据被从所述高速缓存中清除并生成所述中断。

8.如权利要求1所述的方法,进一步包括所述线程检测到所述线程已经在上下文切换之后继续执行,以及所述线程至少部分响应于该检测而将该组存储器单元重新加载到所述高速缓存中。

9.一种系统,包括:

处理器;

与所述处理器可通信地耦合的存储器,进一步包括程序线程(线程),其中对于与所述线程相关联的一组存储器单元中的每个存储器单元,所述线程用于设置与所述存储器单元相关联的标记,以使得如果所述存储器单元的数据被从高速缓存中清除,则请求一个信号;以及

响应于所述信号,将该组存储器单元重新加载到所述高速缓存中。

10.如权利要求9所述的系统,其中所述线程进一步用于以下述顺序中至少一种将该组存储器单元加载到所述高速缓存中:

随机顺序;以及

预定顺序。

11.如权利要求9所述的系统,其中所述信号进一步包括中断,所述线程进一步注册一个处理程序来响应所述信号。

12.如权利要求9所述的系统,其中该组存储器单元进一步包括其数据至少部分对所述线程私有的一组存储器单元。

13.如权利要求10所述的系统,其中所述信号包括中断,并且其中将该组存储器单元重新加载到所述高速缓存中进一步包括处理器逻辑以下述顺序中至少一种将该组存储器单元重新加载到所述高速缓存中:

随机顺序;以及

预定顺序。

14.如权利要求11所述的系统,其中将该组存储器单元重新加载到所述高速缓存中进一步包括所述处理程序以下述顺序中至少一种将该组存储器单元重新加载到所述高速缓存中:

随机顺序;以及

预定顺序。

15.如权利要求11所述的系统,其中设置与所述存储器单元相关联的指示进一步包括将与所述存储器单元的数据的高速缓存行相关联的属性位设定为预定值,并且其中所述系统进一步包括用于检测所述存储器单元的数据被从所述高速缓存中清除并生成所述中断的逻辑。

16.如权利要求9所述的系统,其中所述线程进一步用于检测所述线程已经在上下文切换之后继续执行,并且用于至少部分响应于该检测而将该组存储器单元重新加载到所述高速缓存中。

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