[发明专利]组态设定电路及其方法有效
申请号: | 200710084511.6 | 申请日: | 2007-02-12 |
公开(公告)号: | CN101246385A | 公开(公告)日: | 2008-08-20 |
发明(设计)人: | 叶明郁 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | G06F1/22 | 分类号: | G06F1/22;G06F1/06 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 邵亚丽;李晓舒 |
地址: | 中国台湾新*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 组态 设定 电路 及其 方法 | ||
技术领域
本发明涉及一种电子电路,特别涉及一种组态设定电路及其方法。
背景技术
一般来说,每个集成电路(IC)都可以提供多种运作模式。集成电路的运作模式通常都是在电源开启或重置的时候就设定完成,以确保集成电路能够以正确的运作模式开始运作。一般在初始化时,都是借由提供工作电压或是地电压给集成电路的特定引脚(pin),来决定集成电路的初始化状态。因此当集成电路所能提供的运作模式增加时,为了应对运作模式的设定,集成电路的引脚也会跟着增加。而集成电路的设计上,集成电路的引脚越多,相对地集成电路的体积也越大。因此,如何减少集成电路初始化所需的引脚数仍是工程师们积极研发的目标。
发明内容
本发明的目的之一在于提供一种组态设定电路及其方法,借以解决现有技术所存在的诸多限制与缺点。
本发明的目的之一在于提供一种组态设定电路及其方法,以减少设定所需的引脚数。
因此,为达到上述目的,本发明所公开的组态设定电路,包括端子及连接端子的相位检测电路。
端子用于接收输入时钟信号,而相位判断电路接收参考时钟信号以及该输入时钟信号,通过检测该参考时钟信号与该输入时钟信号的相位差而借此输出组态信号。相位判断电路包括相位检测器和判断器。相位检测器用于检测参考时钟信号与该输入时钟信号的相位差,借此产生相位差信号。再由判断器根据相位差信号而产生组态数据。其中,判断器可以是计数器,其可依据时钟信号以计数该相位差信号的脉冲宽度,以产生组态数据。
其中,组态设定电路所输出的组态数据包括其中所有相位判断电路所产生的组态数据。
相位判断电路可设置于集成电路(IC)内,而端子可以是集成电路的引脚(pin)或是结合焊盘(bonding pad)。
其中,输入信号可以是多个不同相位的时钟信号其中之一。
并且,可利用多相位时钟产生电路来产生多个不同相位的时钟信号,并通过其它端子以输出这些时钟信号。而此多相位时钟产生电路可同样设置于集成电路内,或者设置于集成电路的外部。并且,用于输出时钟信号的端子可以是集成电路的引脚或是结合焊盘,或者是多相位时钟产生电路的输出端。
多相位时钟产生电路可以包括多相位时钟产生器和相位内插电路。其中,多相位时钟产生器会产生多个时钟信号,而相位内插电路则依据该多个参考时钟信号来产生更多个不同相位的时钟信号。
并且,在集成电路的初始化设定(即,组态设定模式)及正常运作(即,工作模式)下,可以共享端子来进行信号的传递。其中,可利用选择电路(例如是:开关模块或多工器)连接在多相位时钟产生电路或相位检测电路与端子之间,以根据工作模式而控制端子的运作。并且可以设计控制器以产生控制信号来控制选择电路(开关模块或多工器)的 运作。
有关本发明的特征与实践,现配合附图对最佳实施例详细说明如下。
附图说明
图1是根据本发明第一实施例的组态设定电路的概要框图;
图2是根据本发明第二实施例的组态设定电路的概要框图;
图3A、3B是根据本发明的实施例的判断器的运作示意图;
图4是根据本发明第三实施例的组态设定电路的概要框图;
图5是根据本发明第四实施例的组态设定电路的概要框图。
主要组件符号说明
100......电路板
102......集成电路
110......多相位时钟产生电路
112......多相位时钟产生器
114......相位内插电路
120_1~120_N......端子
130_1~130_M......端子
140_1~140_M...相位判断电路
142......相位检测器
144......判断器
150......开关模块
150......多工器
160、180......开关模块
170......控制电路
200......电路板
210......连接器
CK1~CKN......时钟信号
Sc1~ScM......输入信号
Dc1~DcM......组态数据
Df1~DfN......传递信号
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