专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [实用新型]一种由PWM信号驱动扩展的双IO电路-CN202222861457.4有效
  • 周荣;吴金炳;王庆伟 - 苏州路之遥科技股份有限公司
  • 2022-10-28 - 2022-12-02 - H03K19/0175
  • 本实用新型涉及电信号处理领域,具体涉及一种由PWM信号驱动扩展的双IO电路;RC滤波子电路的输入端接入PWM信号,RC滤波子电路的输出端与第一比较开关子电路的反相输入端、第二比较开关子电路的同相输入端以及第三比较开关子电路的同相输入端连接,基准电压产生子电路的三个基准电压输出端分别与第一比较开关子电路的同相输入端、第二比较开关子电路的反相输入端以及第三比较开关子电路的反相输入端连接,第一比较开关子电路的输出端与第三比较开关子电路的输出端连接并作为扩展的一个IO,第二比较开关子电路的输出端作为扩展的另一个IO。本实用新型可以实现一个PWM信号扩展出双IO且减少或消除信号噪声的目的。
  • 一种pwm信号驱动扩展io电路
  • [发明专利]驱动信号检测系统及方法-CN202011630499.6在审
  • 胡中武;王一超 - 上能电气股份有限公司
  • 2020-12-31 - 2022-07-01 - G01R31/28
  • 本发明适用于测试技术领域,提供了一种驱动信号检测系统及方法,用于对控制板的驱动电路中的各路驱动信号进行检测,系统包括控制板、上位机、及工装板;控制板上设有通讯、驱动口和IO,工装板上设有逻辑检测电路;逻辑检测电路的各路输入端通过驱动口分别与驱动电路的各路驱动连接,逻辑检测电路的输出端与IO连接,用于对所输入的各路驱动的电平信号进行逻辑运算后输出检测信号至IO;控制板根据上位机下发的测试命令,通过驱动口发出控制信号至工装板中,并根据IO采集的检测信号确定各路驱动信号的功能是否正常;上位机通过通讯监测控制板的测试数据。
  • 驱动信号检测系统方法
  • [实用新型]一种双核微处理器的FPGA验证电路-CN202221778581.8有效
  • 罗祥辉;李希超;曾启明 - 罗祥辉
  • 2022-07-11 - 2023-02-28 - G05B19/042
  • 本实用新型适用于通信电子技术改进领域,提供了一种双核微处理器的FPGA验证电路,所述双核微处理器的FPGA验证电路包括电源电路、复位电路、闪存电路IO扩展电路及JTAG下载端口电路,所述电源电路分别电性连接所述复位电路、闪存电路IO扩展电路及JTAG下载端口电路,所述复位电路的输出端连接双核微处理器的输入端,所述闪存电路IO扩展电路及JTAG下载端口电路分别通讯连接所述双核微处理器,所述电源电路电性连接所述双核微处理器该电路结构简单、使用方便,以双核微控制器为核心的FPGA验证开发板具有既满足FPGA芯片筛选验证的要求,又满足FPGA应用开发设计的功能。
  • 一种微处理器fpga验证电路
  • [发明专利]一种充电桩电磁锁控制电路及方法-CN202111107565.6有效
  • 姜德轩;陈林;朱磊 - 安徽尚特杰电力技术有限公司
  • 2021-09-22 - 2022-09-06 - E05B47/00
  • 本发明提供了一种充电桩电磁锁控制电路及方法,该电路包括:滤波电路、比较器、延迟电路和推挽电路;滤波电路与比较器连接,用于将过滤后的控制信号输出给比较器;比较器与延迟电路和推挽电路连接,用于将控制信号与参考信号进行比较,根据比较结果,控制输出电压;延迟电路用于延迟预设时间后,将输出的电压拉低。本发明只采用一个IO即可实现电磁锁的上锁和解锁控制,节省了IO资源,且控制过程中不需要额外的CPU监控,减轻了CPU的负担。IO的输出只有1或0状态,因此电磁锁不会接收到矛盾的控制指令。
  • 一种充电电磁控制电路方法
  • [发明专利]自动化FPGA验证系统-CN202011450820.2在审
  • 谢宝森 - 深圳安创芯工场科技有限公司
  • 2020-12-12 - 2021-03-16 - G06F30/347
  • 本申请实施例提供一种自动化FPGA验证系统,包括:用于装载逻辑设计代码的第一FPGA芯片组、用于IO MUX功能切换的第二FPGA芯片组以及多个外围电路,所述第二FPGA芯片组与所述外围电路连接;所述第一FPGA芯片组和所述第二FPGA芯片组通过通信接口和芯片IO连接,所述芯片IO用于对所述外围电路的功能信号进行功能复用,所述通信接口用于在所述芯片IO进行功能复用时,实现所述第一FPGA芯片组和所述第二
  • 自动化fpga验证系统
  • [实用新型]一种单片机IO的状态选择电路-CN201120177792.1有效
  • 涂柏生;朱梓铧 - 深圳市博巨兴实业发展有限公司
  • 2011-05-30 - 2011-12-28 - G05B19/042
  • 本实用新型公开了一种单片机IO的状态选择电路,包括单片机的IOIO检测端、电阻R1和单刀双掷开关S1,IO检测端与单片机的IO和电阻R1的一端连接,电阻R1的另一端与单刀双掷开关S1的可动端连接,单刀双掷开关S1的两个不动端分别与高电平和地连接,其特征在于,该电路还包括用于充放电的储能单元,储能单元连接在单刀双掷开关S1的可动端和地之间。本实用新型通过增加储能单元可以实现IO检测端的三种状态,单片机根据这三种状态可以控制不同的控制端执行相应的程序,而不需要增加单片机的IO,从而节约了成本。
  • 一种单片机io状态选择电路
  • [实用新型]一种晶振IO的ESD漏电保护结构-CN202220838996.3有效
  • 刘桂云;王媛 - 辉芒微电子(深圳)股份有限公司
  • 2022-04-12 - 2022-08-23 - H03B5/06
  • 本实用新型公开了一种晶振IO的ESD漏电保护结构,所述晶振IO包括用于连接晶振对地一端的第一IO(IO_1),所述ESD漏电保护结构包括:第一ESD单元(11),连接在所述第一IO(IO_1)和电源之间,用于为所述第一IO(IO_1)与电源之间的静电释放提供放电路径;漏电流转移单元(15),与第一ESD单元(11)连接,用于为第一ESD单元(11)产生的漏电流单独提供泄放路径以阻止所述漏电流流入所述第一IO(IO_1);漏电保护启用单元(16),与漏电流转移单元(15)连接,用于在第一ESD单元(11)产生漏电流时启用所述漏电流转移单元(15);本实用新型解决了既有的高温高压情况下因为该ESD单元漏电而导致晶振直流工作点的偏移甚至导致无法正常起振的缺陷
  • 一种ioesd漏电保护结构

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