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[发明专利]一种基于SOC的密码设备-CN201710209708.1在审
发明人：朱书杉;秦刚;曹刚 -专利权人：山东超越数控电子有限公司
申请日： 2017-03-31 - 公布日： 2017-09-22 - 主分类号： H04L9/06 文献下载
摘要：本发明涉及一种基于SOC的密码设备，其特征在于，包括SOC芯片、PHY芯片、USB芯片，SOC芯片包括系统管理模块、以太网控制模块、USB控制模块，所述系统管理模块连接有密码算法模块和策略匹配模块；SOC芯片上还设有以太网接口和USB接口，以太网控制模块通过以太网接口连接PHY芯片，USB控制模块通过USB接口连接USB芯片；该密码设备还包括噪声源，所述噪声源与密码算法模块连接；通过SOC芯片带有的CPU硬核来提供密码管理及上层软件功能，通过SOC芯片的FPGA部分实现USB接口、以太网接口以及密码算法，密码算法模块是采用硬件实现多种密码算法，可以根据不同环境和协议的需求更改算法。
一种基于 soc 密码设备

[发明专利]一种ASIC和FPGA异构紧耦合结构-CN201611071487.8有效
发明人：拾以娟;曹慧渊;孟涛;蒋炎河 -专利权人：无锡江南计算技术研究所
申请日： 2016-11-29 - 公布日： 2019-11-15 - 主分类号： H04L9/14 文献下载
摘要：本发明公开一种ASIC和FPGA异构紧耦合结构，包括FPGA密码算法单元、ASIC密码算法单元以及安全防护单元；所述FPGA密码算法单元与ASIC密码算法单元互联；所述安全防护单元与FPGA密码算法单元、ASIC密码算法单元连接；所述FPGA密码算法单元用于调用ASIC中的可重构密码算法单元构建不同的算法模块和算法框架；所述ASIC密码算法单元用于实现不同密码算法中可共用的中粒度运算单元。本发明实现灵活性强，处理性能高，并且降低了实现的复杂度，可以满足可配置安全计算平台对高适应性、高性能的可重构密码算法芯片的需求，提升了芯片的安全性，扩展了密码芯片的安全应用领域。
一种 asic fpga 异构紧耦合结构

[发明专利]一种基于PCI-E接口的全算法密码卡及其加密方法-CN201810954054.X在审
发明人：孟李林;刘伟;王泉景;马洪富;宋靖 -专利权人：西安得安信息技术有限公司;山东得安信息技术有限公司;北京得安信息技术有限公司;陕西友安信诚信息科技有限公司
申请日： 2018-08-21 - 公布日： 2019-01-04 - 主分类号： G06F21/34 文献下载
摘要：本发明公开了一种基于PCI‑E接口的全算法密码卡，包括：密码算法模块、FLASH存储器、PCI‑E总线接口、随机数发生器，还包括：具有NIOS软核处理器的FPGA主控芯片，FPGA主控芯片其内部集成有PCI‑E IP核和算法状态机，密码算法模块包括：对称密钥加密SM4算法芯片、对称密钥加密SM1算法芯片和非对称密钥加密SM2算法芯片。本发明还公开了上述密码卡的加密方法。本发明提供了一种高性能全算法的密码卡，同时减少硬件电路的复杂度和能耗，提高了密钥运算速度，并且密码卡采用国产密码算法，使得用户的密钥得到最安全的保护。
密码卡加密对称密钥加密密码算法模块算法密码算法芯片芯片随机数发生器非对称密钥算法状态机密码算法密钥运算内部集成硬件电路总线接口复杂度密钥算法能耗安全

[实用新型]支持国内外密码算法的加密键盘-CN201320304834.2有效
发明人：黎国俊;陈庆华 -专利权人：广州御银科技股份有限公司
申请日： 2013-05-29 - 公布日： 2013-11-06 - 主分类号： G06F3/02 文献下载
摘要：本实用新型公开了一种支持国内外密码算法的加密键盘，包括用于进行密码输入操作的键盘体，所述键盘体内置有支持国外密码算法的第一MCU和支持国产密码算法的第二MCU，所述第一MCU和第二MCU之间进行通讯连接本实用新型的加密键盘内部采用双MCU芯片设计，其中第一MCU采用支持DES、3DES、RSA等国外算法的芯片，所述第二MCU采用支持SM2、SM3、SM4等国产密码算法的芯片，解决了现有ATM加密键盘采用国外加密芯片不支持国产密码算法的问题，适合在需要国产密码算法的场合使用，同时解决了国内加密芯片安全性不高的问题。
支持国内外密码算法加密键盘

[发明专利]具有安全保护功能的密码芯片的制备方法-CN200310104117.6无效
发明人：范明钰;王光卫 -专利权人：电子科技大学
申请日： 2003-12-25 - 公布日： 2005-07-06 - 主分类号： H01L21/00 文献下载
摘要：本发明的目的是提供一种具有安全保护功能的密码芯片制备方法，它是采用硬件FPGA，将密码算法芯片通过两个部分来实现：一是密码算法运算部分，加电后从外部注入芯片，在芯片内完成运算过程；二是芯片的安全保护部分，是一种硬件形态，存于芯片内部的E²PROM中，由芯片可以运行的保护协议、签名算法组成。采用本发明的具有安全保护功能的密码芯片，除了具有原有密码芯片的运算功能外，还增加了自身安全保护的功能和算法安全修改的功能，从而既保证了芯片的实现和应用过程中的安全性，又改进了原来的密码芯片算法不能灵活修改的缺点
具有安全保护功能密码芯片制备方法

[发明专利]安全处理模块、SOC芯片及数据处理方法-CN202110332846.5在审
发明人：袁博浒;陈东坡;秦天浩 -专利权人：广东跃昉科技有限公司
申请日： 2021-03-29 - 公布日： 2022-09-30 - 主分类号： G06F21/60 文献下载
摘要：一种安全处理模块、SOC芯片及数据处理方法，所述安全处理模块应用于SOC芯片，包括参数计算单元和操作执行单元，其中：所述参数计算单元，适于根据已配置的密码算法类型、操作类型和密码算法初始参数，计算得到相应的密码算法运算参数，所述密码算法运算参数包括：与所述密码算法类型相应的密钥和用于进行运算操作的中间参数；所述操作执行单元，适于根据已配置的密码算法类型和操作类型，读取相应的密码算法运算参数，并对待处理数据执行相应密码算法中与所述操作类型对应的运算操作采用上述方案，能够提升数据处理效率和资源利用率，可有效控制芯片体积和功耗，扩大SOC芯片的适用范围。
安全处理模块 soc 芯片数据处理方法

[发明专利]密码卡及其加解密方法-CN201611001654.1在审
发明人：黄允春;刘岩梅;范宜强 -专利权人：航天信息股份有限公司
申请日： 2016-11-14 - 公布日： 2018-05-25 - 主分类号： H04L9/08 文献下载
摘要：本发明提供了一种密码卡及其加解密方法，其中密码卡包括：密码算法模块，包括多个密码算法芯片，每种密码算法芯片用于执行一种或多种密码算法的加密解密运算；现场可编程门阵列，其内部集成有PCI‑E IP核和密码计算调度机，其中PCI‑E IP核用于连接主机的PCI‑E接口，与主机进行数据交互，以接收来自于主机的待进行加解密的数据和计算指令，并在加解密完成后向主机提供加解密后的数据，密码计算调度机与密码算法模块连接，用于调用多个密码算法芯片进行密码计算本发明方案支持多种国密算法和国际算法，简化了硬件架构，可以有效发挥高速算法芯片的速度性能。
加解密现场可编程门阵列密码算法芯片主机密码计算密码卡密码算法模块调度机算法数字信号处理器读写操作高速算法计算指令解密运算密码算法内部集成数据交互硬件架构有效发挥后向调用加密芯片

[发明专利]一种基于安全芯片的安全启动装置及方法-CN201910380189.4有效
发明人：廖正赟;孙晓鹏;李鑫;彭金辉;刘武忠;周小欠;刘熙胖;梁松涛;卫志刚;徐瑞军 -专利权人：郑州信大捷安信息技术股份有限公司
申请日： 2019-05-08 - 公布日： 2020-11-06 - 主分类号： G06F21/57 文献下载
摘要：本发明提供一种基于安全芯片的安全启动装置，包括MCU、存储器、安全芯片，所述MCU分别与所述存储器和所述安全芯片连接，所述MCU内存储有PB预启动程序、非对称密码算法和哈希算法,与所述安全芯片的SPI接口、I2C或UART接口连接，所述存储器用于存储完整镜像文件，所述安全芯片支持对称密码算法、非对称密码算法和哈希密码算法，并用于存储可信根。另外，本发明还提供一种基于安全芯片的安全启动方法。
一种基于安全芯片启动装置方法

[发明专利]一种基于FPGA对数据进行算法处理的密码卡及其加密方法-CN201810953596.5在审
发明人：孟李林;刘伟;周晓刚;宋靖 -专利权人：西安得安信息技术有限公司;山东得安信息技术有限公司;北京得安信息技术有限公司;陕西友安信诚信息科技有限公司
申请日： 2018-08-21 - 公布日： 2019-02-15 - 主分类号： G06F21/72 文献下载
摘要：本发明公开了一种基于FPGA对数据进行算法处理的密码卡，包括：密码算法模块、FLASH存储器、PCI‑E总线接口、随机数发生器，还包括：具有NIOS软核处理器的FPGA主控芯片，FPGA主控芯片内部集成有PCI‑E IP核和算法状态机。本发明还公开了上述密码卡的加密方法。本发明通过上述技术方案优化了密码卡的通用架构，在实现相同算法功能的基础上提高了密码卡算法性能，减少硬件芯片数量并降低硬件电路的设计难度和密码卡功耗，有效地发挥了高速密码卡算法芯片的速度和性能，具有密码运算速度快
密码卡算法处理功耗加密芯片技术方案优化密码算法模块随机数发生器高速密码卡算法状态机密码运算内部集成算法功能算法芯片通用架构硬件电路硬件芯片总线接口有效地算法

[发明专利]演化密码芯片-CN200810197664.6无效
发明人：唐明;张焕国;张国平 -专利权人：武汉大学
申请日： 2008-11-17 - 公布日： 2009-04-22 - 主分类号： G06F21/02 文献下载
摘要：本发明涉及一种演化密码芯片，该密码芯片利用可编程芯片无限次重构的特点及智能计算的演化设计特点对密码关键部件的算法进行实时动态设计而制得。该密码芯片包括可编程芯片和装于芯片中的DES算法的各部分模块，DES算法的各部分模块与智能计算部分连接，智能计算部分包括适应值计算模块、演化算子模块和真随机数发生器，真随机数发生器通过演化算子模块与演化处理部分连接密码关键部件的算法通过智能计算方法实现。
演化密码芯片

[发明专利]一种密码算法硬件设计的安全检测方法-CN201410036110.3无效
发明人：郭炜;丁兆晶;魏继增 -专利权人：天津大学
申请日： 2014-01-24 - 公布日： 2014-05-21 - 主分类号： H04L9/06 文献下载
摘要：一种密码算法硬件设计的安全检测方法，包括：对密码算法进行分析，并根据分析结果对密码算法加入防护措施；密码硬件执行架构设计，制定并加入硬件防护措施；密码硬件编程，根据编程结果生成ASIC密码芯片电路版图；对密码芯片进行抗功耗分析，验证芯片的安全性，包括功耗信息的采集和数据的分析。本发明充分利用了EDA工具在芯片设计早期阶段能够模拟产生芯片运行功耗的特点来获得芯片的仿真功耗，这种仿真功耗比芯片的运行功耗更加精确，噪声少，功耗对齐简单，更容易被用来进行功耗攻击分析。发明仅采用仿真和综合后的结果进行分析，不需要获得真实的芯片，研究成本低廉，降低了公司生产密码芯片的总成本。
一种密码算法硬件设计安全检测方法

[发明专利]一种高性能密码卡以及其通信方法-CN202010851155.1有效
发明人：雷宗华;彭金辉;陈万顺;习道彬;王阳阳 -专利权人：郑州信大捷安信息技术股份有限公司
申请日： 2020-08-21 - 公布日： 2022-03-15 - 主分类号： G06F21/72 文献下载
摘要：本发明提出一种集成度高的高性能密码卡，包括密码集成芯片、随机源模块、FLASH芯片、PCI‑E接口和智能密码钥匙，密码集成芯片内部集成有主处理器单元、密码算法运算单元、外设接口单元、BAR寄存器和DMA控制器；所述密码集成芯片内还设置有BAR寄存器和DMA控制器；所述BAR寄存器还通过所述命令逻辑通道连接外部主机，接收外部主机下发的管理类指令数据、重构密码算子和DMA配置数据并存储至所述密码算法运算单元的寄存器；所述DMA控制器通过所述运算逻辑通道连接外部主机，通过片内总线连接所述非对称算法运算单元和所述可重构对称摘要算法运算单元，接收外部主机下发的密码运算类数据并转发至所述非对称算法运算单元或所述可重构对称摘要算法运算单元
一种性能密码及其通信方法

[发明专利]一种基于状态机的国密SM1算法控制方法-CN201310427047.1在审
发明人：苏振宇;于飞;李前;赵邦宇 -专利权人：浪潮电子信息产业股份有限公司
申请日： 2013-09-18 - 公布日： 2013-12-18 - 主分类号： G06F21/72 文献下载
摘要：本发明涉及信息安全技术领域，具体是提供一种专用密码算法，特别涉及一种基于状态机的国密SM1算法控制方法。本发明是利用了FPGA和专用密码算法芯片，通过硬件描述语言VHDL设计出高效的状态机，本发明采用现场可编程门阵列芯片与专用密码算法芯片的硬件方式实现了SM1对称密码算法，因此加解密的速度更快，效率更高。
一种基于状态机 sm1 算法控制方法

[发明专利]数字电视条件接收系统解密芯片升级方法-CN200910309279.0有效
发明人：刘威;刘贤洪;任飞 -专利权人：四川虹微技术有限公司
申请日： 2009-11-04 - 公布日： 2010-04-28 - 主分类号： H04N7/16 文献下载
摘要：本发明解决了目前数字电视条件接收系统解密芯片密码算法通常是单一固定的问题，提供了一种数字电视条件接收系统解密芯片升级方法，其技术方案可概括为：首先将解密芯片的EEPROM划分为敏感数据区、密码算法区及普通数据区，生成升级各种算法的主控密钥加上摘要随解密芯片操作系统一起掩码在密码芯片ROM上，按一定安全机制严格保护主控密钥和摘要的秘密性和完整性，构造解密芯片升级机制，使解密芯片能够安全、快捷地升级新的密码算法、工作密钥、配置数据，同时安全销毁旧密码算法、工作密钥、配置数据。其有益效果是，节省成本，适用于数字电视条件接收系统的解密芯片。
数字电视条件接收系统解密芯片升级方法

[实用新型]一种基于PCI‑E总线的高速密码卡-CN201720518894.2有效
发明人：朱云;李元骅 -专利权人：北京数盾信息科技有限公司
申请日： 2017-05-10 - 公布日： 2017-12-05 - 主分类号： H04L9/08 文献下载
摘要：本实用新型公开了一种基于PCI‑E总线的高速密码卡，包括FPGA逻辑芯片、主控CPU芯片、密码算法模块、噪声源WNG9芯片、PCI‑E接口模块、安全防护模块；主控CPU芯片连接有SRAM和SPI FLASH，主控CPU芯片通过串口与安全防护模块连接；密码算法模块包括SM1、SM2、SM3、SM4算法芯片，密码算法模块连接FPGA逻辑芯片；噪声源WNG9芯片设有2组，每组噪声源WNG9芯片设有2路，噪声源WNG9芯片连接FPGA逻辑芯片；PCI‑E接口模块连接FPGA逻辑芯片；安全防护模块连接FPGA逻辑芯片。
一种基于 pci 总线高速密码

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