专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [实用新型]一种光伏电站的异常报警系统-CN202320423249.8有效
  • 叶明月;王赞;胡瀚 - 河南至坚智慧新能源有限公司
  • 2023-03-08 - 2023-09-08 - G01R19/165
  • 本实用新型公开了一种光伏电站的异常报警系统,涉及异常检测报警技术领域,包括电压检测模块,用于通过电压检测电路设定电压上限值和电压下限值并对光伏发电模块进行电能检测;输出处理模块,用于信号处理并控制计数报警模块进行计数,达到计数阈值时控制报警电路进行报警;信号自锁模块,用于自锁控制延时控制模块对计数报警模块进行延时复位;延时复位模块,用于控制信号自锁模块的自锁复位。本实用新型光伏电站的异常报警系统由电压检测模块对光伏电站模块进行电压上限检测和电压下限检测,在不满足设定的限定值时通过输出处理模块控制触发计数报警模块在光伏电站模块频繁高低压跳变时进行报警,延时控制模块延时控制计数报警模块的复位
  • 一种电站异常报警系统
  • [发明专利]SOC系统处理器芯片中的高速同步外设时钟相位控制装置-CN200710044537.8有效
  • 胡建凯 - 上海摩波彼克半导体有限公司
  • 2007-08-03 - 2009-02-04 - G06F1/12
  • 本发明涉及一种SOC系统处理器芯片中高速同步外设时钟相位控制装置,输出接口模块的输出端和输入接口模块的输入端分别与高速同步外设连接,处理器内部逻辑模块时钟信号送入第一可配置延时模块输入端、第二可配置延时模块输入端和第二信号采样模块时钟输入端,第一可配置延时模块输出信号通过输出接口模块送入第二可配置延时模块输入端,第二可配置延时模块输出信号送入第一信号采样模块时钟输入端,输入接口模块输出信号依次经第一信号采样模块和第二信号采样模块送入处理器内部逻辑模块采用该SOC系统处理器芯片中高速同步外设时钟相位控制装置,逻辑设计简单可靠,配置灵活多样,成本较低,工作性能稳定,能自动调整相位,适用范围较广。
  • soc系统处理器芯片中的高速同步外设时钟相位控制装置
  • [实用新型]一种消隐延时可控的LED平板显示控制系统-CN201620308400.3有效
  • 俞浩;黄凌碧;严飞 - 天津昊天伟业电子科技有限公司
  • 2016-04-12 - 2016-08-24 - G09G3/32
  • 本实用新型提供了一种消隐延时可控的LED平板显示控制系统,包括数据接口芯片、数据处理模块延时模块、驱动输出接口和多组LED显示单元;数据接口芯片的输出端与数据处理模块的输入端信号连接;数据处理模块的消隐信号输出端与延时模块的输入端信号连接,延时模块的输出端信号并行输入驱动输出接口的并行输入端;驱动输出接口的并行输出端依次与多组LED显示单元的输入端信号连接。本实用新型所述的消隐延时可控的LED平板显示控制系统,使用计数器和比较器结合的程序可控器件作为延时器,增加了延时器的延时间隔可控及易于调整,提高了对多行消隐窄脉冲同时启动带来的低灰噪声问题的缓解性能,降低了控制系统的电磁干扰
  • 一种延时可控led平板显示控制系统
  • [发明专利]一种合唱特效处理方法及系统-CN200710121303.9无效
  • 徐磊;张晨 - 北京中星微电子有限公司
  • 2007-09-03 - 2008-02-13 - G10K15/12
  • 本发明公开了一种合唱特效处理方法,包括:采用延迟时间函数对原始信号进行延时处理,得到构成合唱信号的至少一路信号。此外,本发明还公开了一种合唱特效处理系统,至少包括:合成模块和至少一个函数延时模块。其中,合成模块,用于将所接收的各路信号进行叠加后,合成合唱信号;每个函数延时模块,用于采用延迟时间函数对原始信号进行延时处理后得到一路信号,并将所得到的一路信号向合成模块输出。
  • 一种合唱特效处理方法系统
  • [发明专利]基于FPGA存储单元实现数据延时处理的系统-CN202111298358.3在审
  • 赵成成;李添 - 上海创远仪器技术股份有限公司
  • 2021-11-04 - 2022-02-11 - G06F13/16
  • 本发明涉及一种基于FPGA存储单元实现数据延时处理的系统,包括数据输入控制模块,用于选择存储单元,按照存储单元顺序,依次循环存入数据块;数据存储模块,包括多个存储单元,多个存储单元与数据输入控制模块相连接,用于按顺序依次循环存储数据块;数据输出控制模块,与所述的多个存储单元均相连接,用于读取存储模块中的数据;数据交换输出模块,与所述的数据输出控制模块相连接,用于延时输出数据。采用了本发明的基于FPGA存储单元实现数据延时处理的系统,采用的是非传统的非移位寄存器或计数器方式的延时,利用数据存储选择实现延时,根据存储单元的深度,决定数据延时的个数,可以实现单路数据延时,也可以实现多路数据延时
  • 基于fpga存储单元实现数据延时处理系统
  • [实用新型]一种开关磁阻电机的控制系统-CN201520598236.X有效
  • 温嘉斌;汪奇;孙祖光 - 哈尔滨理工大学
  • 2015-08-10 - 2016-01-20 - H02P6/17
  • 本实用新型的FPGA控制器的位置检测电路的输出端连接位置信号处理模块,位置信号处理模块的输出端经过周期平均值计算模块分别与转速计算模块、导通延时计算模块和开通延时计算模块建立连接,导通延时计算模块和开通延时计算模块的输出端通过角度控制综合模块连接控制信号综合模块的输入端,NIOSII软核通过总线分别连接转速计算模块的输出端、开通延时计算模块的输入端、导通延时计算模块的输入端和PWM信号模块的输入端。
  • 一种开关磁阻电机控制系统

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