[发明专利]数字时钟倍频电路系统、数字时钟倍频信号生成方法在审
| 申请号： | 201910508700.4 | 申请日： | 2019-06-13 |
| 公开（公告）号： | CN110166028A | 公开（公告）日： | 2019-08-23 |
| 发明（设计）人： | 李路;陈波;方敏;周春元;罗俊 | 申请（专利权）人： | 珠海微度芯创科技有限责任公司 |
| 主分类号： | H03K5/156 | 分类号： | H03K5/156 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 519000 广东省珠海市高*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种数字时钟倍频电路系统，包括：占空比数字校准电路模块、或门电路模块；所述占空比数字校准电路模块包括脉冲发生器、半时钟周期延迟电路；输入时钟信号经过占空比数字校准电路模块、或门电路模块输出倍频后的输出时钟信号。此外，本发明还公开了一种数字时钟倍频信号生成方法。采用本发明基于50％占空比校准的数字时钟倍频电路系统有效地降低了输出时钟的抖动，节省了电路功耗和面积，同时输入时钟信号FIN到输出时钟信号FOUT之间的响应时间减少33％，可以支持高速响应场景。 | ||
| 搜索关键词： | 数字时钟 数字校准电路 倍频电路 占空比 或门电路模块 输出时钟信号 倍频信号 输入时钟 半时钟周期 脉冲发生器 占空比校准 电路功耗 高速响应 时间减少 输出时钟 延迟电路 有效地 抖动 倍频 场景 输出 响应 | ||
【主权项】：
1.一种数字时钟倍频电路系统，其特征在于，所述数字时钟倍频电路系统包括占空比数字校准电路模块、或门电路模块；所述占空比数字校准电路模块包括脉冲发生器、半时钟周期延迟电路；所述脉冲发生器的输出端连接至所述半时钟周期延迟电路的输入端及所述或门电路模块的第一输入端；所述半时钟周期延迟电路的输出端连接至所述或门电路模块的第二输入端；所述脉冲发生器接收任意占空比的数字时钟信号作为输入时钟信号，所述脉冲发生器将输入时钟信号转化生成窄脉冲信号并输出；所述半时钟周期延迟电路接收所述脉冲发生器生成的所述窄脉冲信号，所述半时钟周期延迟电路将所述窄脉冲信号延迟1.5个输入时钟周期后生成延迟窄脉冲信号并输出；所述或门电路模块接收所述脉冲发生器生成的所述窄脉冲信号及所述半时钟周期延迟电路生成的延迟窄脉冲信号，由所述或门电路模块对所述窄脉冲信号及所述延迟窄脉冲信号进行逻辑或运算得到作为输出时钟信号的二倍频时钟信号并输出。
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