[发明专利]一种基于异或门的可重构环形振荡器PUF电路有效

专利信息
申请号: 201810677599.0 申请日: 2018-06-27
公开(公告)号: CN109167664B 公开(公告)日: 2021-03-02
发明(设计)人: 李冰;刘奔;陈帅;陈剑;淡富奎;董乾;刘勇;张林;沈克强;王刚;赵霞 申请(专利权)人: 东南大学
主分类号: H04L9/32 分类号: H04L9/32;H04L9/08
代理公司: 南京经纬专利商标代理有限公司 32200 代理人: 徐莹
地址: 214135 江*** 国省代码: 江苏;32
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摘要: 发明公开了一种基于异或门的可重构环形振荡器PUF电路,包括PUF延迟模块和末端控制模块,其中PUF延迟模块包括n个串联延迟单元,末端控制模块包括类延迟单元和反馈控制单元;所述每个延迟单元作为FPGA的一个CLB及均包含由异或门和选择单元组成且结构不同的两个Slice,其中异或门根据输入的激励信号进行连线或形成反相器,选择单元根据激励信号决定正跳变信号所输入的异或门并形成通路,及得到单个RO振荡环的输出信号;所述类延迟单元将其作为输入及输出整个RO振荡环的输出信号,反馈控制单元将其和反馈控制信号作为两个输入,处理获得和输出整个RO振荡环的输出信号。本发明具有简单易实现,可靠性、稳定性、随机性高,消耗资源少,激励响应对多等特点。
搜索关键词: 一种 基于 可重构 环形 振荡器 puf 电路
【主权项】:
1.一种基于异或门的可重构环形振荡器PUF电路,其特征在于,包括PUF延迟模块和末端控制模块,其中PUF延迟模块包括n个串联的延迟单元,所述末端控制模块包括类延迟单元和反馈控制单元;所述每个延迟单元作为FPGA的一个可配置逻辑模块及均包含由异或门和选择单元组成且结构不同的两个Slice,该两个Slice中异或门根据输入的激励信号进行连线或形成反相器,所述选择单元根据激励信号决定正跳变信号所输入的异或门并形成通路,及由最后的Slice得到单个RO振荡环的输出信号;所述类延迟单元将单个RO振荡环的输出信号作为输入,及输出整个RO振荡环的输出信号;所述反馈控制单元将整个RO振荡环的输出信号和反馈控制信号作为两个输入,处理获得和输出整个RO振荡环的输出信号。
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