[发明专利]多个线程的存储器访问方法及系统有效
| 申请号： | 201711236620.5 | 申请日： | 2017-11-30 |
| 公开（公告）号： | CN108205500B | 公开（公告）日： | 2021-02-23 |
| 发明（设计）人： | 范博钧;丛培贵;蔡松芳;周嘉贤;赖守仁 | 申请（专利权）人： | 联发科技股份有限公司 |
| 主分类号： | G06F12/02 | 分类号： | G06F12/02 |
| 代理公司： | 北京市万慧达律师事务所 11111 | 代理人： | 白华胜;王蕊 |
| 地址： | 中国台湾新竹市*** | 国省代码： | 台湾;71 |
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| 摘要： | 提供了一种管理多个线程的片上存储器访问的系统。该系统包括：多个并行的处理器单元，用以执行所述多个线程；片上存储器，包括多个存储器单元且每个所述多个存储器单元包括第一区域和第二区域，其中所述第一区域和所述第二区域具有不同的存储器寻址方案，用于由所述多个线程的并行访问；以及地址解码器，耦合于所述多个并行处理单元和所述片上存储器，所述地址解码器根据来自所述多个并行处理单元的解码的多个地址信号，激活所述多个线程对所述第一区域和第二区域其中之一的多个存储器位置的访问。 | ||
| 搜索关键词： | 线程 存储器 访问 方法 系统 | ||
【主权项】：
1.一个管理多个线程的片上存储器访问的系统，其特征在于，包括：多个并行的处理器单元，用以执行所述多个线程；片上存储器，包括多个存储器单元且每个所述多个存储器单元包括第一区域和第二区域，其中所述第一区域和所述第二区域具有不同的存储器寻址方案，用于所述多个线程的并行访问；以及地址解码器，耦合于所述多个并行处理单元和所述片上存储器，所述地址解码器根据来自所述多个并行处理单元的解码的多个地址信号，激活所述多个线程对所述第一区域和所述第二区域其中之一的多个存储器位置的访问。
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