[发明专利]一种接口电路有效
| 申请号： | 201710505724.5 | 申请日： | 2017-06-28 |
| 公开（公告）号： | CN107094014B | 公开（公告）日： | 2023-10-03 |
| 发明（设计）人： | 孔亮;庄志青;职春星 | 申请（专利权）人： | 灿芯半导体（上海）股份有限公司 |
| 主分类号： | H03K19/0185 | 分类号： | H03K19/0185 |
| 代理公司： | 苏州简理知识产权代理有限公司 32371 | 代理人： | 柯夏荷 |
| 地址： | 201203 上海市浦东新区自由*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供一种接口电路，其包括：第一输出逻辑单元；第一输出驱动组合，其包括多个并联的第一输出驱动晶体管以及分别与各个第一输出驱动晶体管串联的多个第一电阻；第二输出逻辑单元；第二输出驱动组合，其包括多个并联的第二输出驱动晶体管及分别与各个第一输出驱动晶体管串联的多个第一电阻。在短自校准模式下，在输出数据为0时，将校验值输入所述第一输出逻辑单元，第一输出逻辑单元利用新的校验值更新原来的校验值，在输出数据为1时，将所述校验值输入所述第二输出逻辑单元，第二输出逻辑单元利用新的校验值更新原来的校验值。这样，可以让系统在不需停止读写的情况下完成短自校准。 | ||
| 搜索关键词： | 一种 接口 电路 | ||
【主权项】：
一种接口电路，其特征在于，其包括：第一输出逻辑单元，其接收输出数据输入和校验值输入，并基于输出数据和校验值得到第一组驱动信号，将该组驱动信号通过多个输出端输出；第一输出驱动组合，其包括多个并联的第一输出驱动晶体管以及分别与各个第一输出驱动晶体管串联的多个第一电阻，每个第一输出驱动晶体管的源极接电源，每个第一输出驱动晶体管的漏极与对应的第一电阻的一端相连，对应的第一电阻的另一端与接口电路的输出端相连，各个第一输出驱动晶体管的栅极分别与对应的第一输出逻辑单元的多个输出端相连；第二输出逻辑单元，其接收输出数据输入和校验值输入，并基于输出数据和校验值得到第二组驱动信号，将该组驱动信号通过多个输出端输出；第二输出驱动组合，其包括多个并联的第二输出驱动晶体管及分别与各个第一输出驱动晶体管串联的多个第一电阻，每个第二输出驱动晶体管的源极接地，每个第二输出驱动晶体管的漏极与对应的第二电阻的一端相连，对应的第二电阻的另一端与接口电路的输出端相连，各个第二输出驱动晶体管的栅极分别与对应的第二输出逻辑单元的多个输出端相连；在短自校准模式下，在输出数据为0时，将所述校验值输入所述第一输出逻辑单元，第一输出逻辑单元利用新的校验值更新原来的校验值，在输出数据为1时，第一输出逻辑单元不接收新的校验值；在短自校准模式下，在输出数据为1时，将所述校验值输入所述第二输出逻辑单元，第二输出逻辑单元利用新的校验值更新原来的校验值，在输出数据为0时，第二输出逻辑单元不接收新的校验值。
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