[发明专利]用于晶片翘曲减小的应力缓解结构有效

专利信息
申请号: 201580017821.9 申请日: 2015-03-25
公开(公告)号: CN106165094B 公开(公告)日: 2019-01-08
发明(设计)人: J-H·J·兰;D·F·伯蒂;C·左;D·D·金;C·H·尹;M·F·维纶茨;N·S·慕达卡特;R·P·米库尔卡;J·金 申请(专利权)人: 高通股份有限公司
主分类号: H01L23/522 分类号: H01L23/522;H01L23/532
代理公司: 上海专利商标事务所有限公司 31100 代理人: 杨丽
地址: 美国加利*** 国省代码: 美国;US
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摘要: 一种集成电路器件包括基板。该集成电路器件还包括第一导电栈,第一导电栈在相对于基板的第一标高处包括后端制程(BEOL)导电层。该集成电路器件还包括第二导电栈,第二导电栈在相对于基板的第二标高处包括BEOL导电层。第二标高不同于第一标高。
搜索关键词: 用于 晶片 减小 应力 缓解 结构
【主权项】:
1.一种集成器件,包括:支撑第一沉积层间电介质的基板;包括后端制程(BEOL)导电层的第一导电栈,所述第一导电栈处于相对于所述基板的第一标高处,其中第一导电栈包括第一导电层直接在所述基板的表面上、第一沉积层间电介质仅在第一导电层的表面上、第二沉积电介质层在第一导电层上、第二导电层在第二沉积电介质层上、以及第三导电层直接在第一沉积层间电介质上并且通过第一通孔耦合到第一导电层;以及包括BEOL导电层的第二导电栈,第二导电栈处于相对于所述基板的不同于第一标高的第二标高处,其中第二导电栈包括直接在所述基板的表面上的第三导电层。
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