[发明专利]用于数据路径的时钟树结构及具有其的存储器无效
申请号: | 201110230043.5 | 申请日: | 2011-08-09 |
公开(公告)号: | CN102347057A | 公开(公告)日: | 2012-02-08 |
发明(设计)人: | 周忠玲;黄崇礼 | 申请(专利权)人: | 北京时代全芯科技有限公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10 |
代理公司: | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人: | 张大威 |
地址: | 100176 北京市经济技术开发*** | 国省代码: | 北京;11 |
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摘要: | 本发明提出一种用于数据路径的时钟树结构及具有其的存储器,该时钟树结构包括多个数据发送端;多个第一FIFO单元,每个第一FIFO单元的输入均与一个数据发送端相连且输出均受来自第一时钟通路的第一时钟控制;多个第二FIFO单元,每个第二FIFO单元的输入均与一个第一FIFO单元的输出相连且输出均受第二时钟控制;可编程缓冲器,与多个第二FIFO单元的输出相连,且受第三时钟控制,其中,每个第二FIFO单元对应的时钟路径与其和可编程缓冲器之间的数据路径之和均相等以使其输出的数据同时到达可编程缓冲器。采用本发明的时钟树结构,具有结构简单且减少时钟信号互扰的优点,并能够保证多个发送端数据同时达到编程缓冲器。 | ||
搜索关键词: | 用于 数据 路径 时钟 结构 具有 存储器 | ||
【主权项】:
一种用于数据路径的时钟树结构,其特征在于,包括:多个数据发送端;多个第一FIFO单元,所述多个第一FIFO单元中的每一个的输入均与一个数据发送端相连,且所述多个第一FIFO单元的输出均受来自第一时钟通路的第一时钟控制;多个第二FIFO单元,所述多个第二FIFO单元中的每一个的输入均与一个第一FIFO单元的输出相连,且所述多个第二FIFO单元的输出均受来自第二时钟通路的第二时钟控制;可编程缓冲器,所述可编程缓冲器均与所述多个第二FIFO单元的输出相连,且所述可编程缓冲器受第三时钟控制,其中,对于所述第二FIFO单元,每个所述第二FIFO单元对应的第二时钟通路中的时钟路径与所述第二FIFO单元与所述可编程缓冲器之间的数据路径之和均相等以使所述多个第二FIFO单元输出的数据同时到达所述可编程缓冲器。
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