[发明专利]控制结处的晶格缺陷数目的方法有效

专利信息
申请号: 200410011589.1 申请日: 2004-12-21
公开(公告)号: CN1797719A 公开(公告)日: 2006-07-05
发明(设计)人: 谢炳邦;龚吉富 申请(专利权)人: 联华电子股份有限公司
主分类号: H01L21/322 分类号: H01L21/322;H01L21/265;H01L21/324;H01L21/336;H01L21/8238
代理公司: 北京市柳沈律师事务所 代理人: 陶凤波;侯宇
地址: 台湾省新竹*** 国省代码: 中国台湾;71
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摘要: 发明是关于一种控制结处的晶格缺陷数目的方法,其使用上是配合形成结的离子注入步骤及后续的退火步骤。此方法是在离子注入步骤之前或之后进行额外的注入步骤,以增加离开结位置的衬底区域的应力,而得以在后续退火步骤中加强衬底表层的再结晶效果,由此降低结处的应力以减少晶格缺陷数目。此方法可应用至CMOS元件的轻掺杂漏极或源/漏极工艺,其是在用以形成NMOS及PMOS晶体管的轻掺杂漏极或源/漏极区的多次离子注入步骤之前、之间或之后,进行前述的额外注入步骤。
搜索关键词: 控制 晶格 缺陷 目的 方法
【主权项】:
1、一种控制结处的晶格缺陷数目的方法,其使用上是配合在衬底中形成结的离子注入步骤及后续的退火步骤,其中:进行额外的注入步骤以增加离开结位置的衬底区域的应力,由此在该退火步骤中加强该衬底表层的再结晶效果,从而降低该结处的应力。
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