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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]存储器设备与用于存储器设备的系统-CN201580011497.X有效
发明人： C.P.莫扎克;K.S.拜恩斯 -专利权人：英特尔公司
申请日： 2015-03-31 - 公布日： 2021-10-22 - 主分类号： G06F12/02 文献下载
摘要：在实施例中，存储器设备可包含设备处理逻辑和模式寄存器。该模式寄存器可以是可指定存储器设备的操作模式的寄存器。模式寄存器中的字段可保持可指示与存储器设备相关联的命令是否被禁用的值。该值可被保持在字段中直至存储器设备被电力循环或重置为止。设备处理逻辑可获取命令的实例。设备处理逻辑可基于模式寄存器所保持的值而确定命令是否被禁用。如果设备处理逻辑确定命令被禁用，则设备处理逻辑可不执行命令的实例。如果设备处理逻辑确定命令未被禁用，则设备处理逻辑可执行命令的实例。
存储器设备用于系统

[发明专利]访问命令/地址寄存器装置中存储的数据-CN201410831992.2有效
发明人： K.S.拜恩斯;K.J.拉夫;G.弗吉斯;S.萨 -专利权人：英特尔公司
申请日： 2011-12-22 - 公布日： 2018-03-30 - 主分类号： G06F12/1009 文献下载
摘要：通过跨地址总线将数据传递给与数据总线连接的装置，由连接到数据总线的装置从中读取数据，来读取没有连接到数据总线的寄存器。寄存器驻留在经由地址总线连接到存储器装置(其连接到地址总线和数据总线)的寄存器装置中。主处理器触发寄存器装置通过地址总线向存储器装置上的寄存器传递信息。主处理器然后从存储器装置的寄存器中读取该信息。
访问命令地址寄存器装置存储数据

[发明专利]经由每DRAM可寻址性模式的多用途寄存器编程-CN201280067640.3有效
发明人： K.S.拜恩斯;S.萨 -专利权人：英特尔公司
申请日： 2012-01-20 - 公布日： 2017-06-16 - 主分类号： G11C11/409 文献下载
摘要：本文中描述了用于使用每DRAM可寻址性(PDA)将动态随机存取存储器(DRAM)装置的多用途寄存器(MPR)编程的设备、系统和方法的实施例。本发明的实施例允许独特的32比特模式对于列(rank)上的每个DRAM装置被存储，由此使得数据总线训练能够并行进行。此外，本发明的实施例为系统BIOS提供列上每DRAM装置32比特的存储以便存储诸如MR值的代码，或者用于其它用途（例如，要由BIOS过程使用的临时暂存存储）。
经由 dram 寻址模式多用途寄存器编程

[发明专利]访问命令/地址寄存器装置中存储的数据-CN201180075692.0有效
发明人： K.S.拜恩斯;K.J.拉夫;G.弗吉斯;S.萨 -专利权人：英特尔公司
申请日： 2011-12-22 - 公布日： 2014-08-20 - 主分类号： G06F12/00 文献下载
摘要：通过跨地址总线将数据传递给与数据总线连接的装置，由连接到数据总线的装置从中读取数据，来读取没有连接到数据总线的寄存器。寄存器驻留在经由地址总线连接到存储器装置(其连接到地址总线和数据总线)的寄存器装置中。主处理器触发寄存器装置通过地址总线向存储器装置上的寄存器传递信息。主处理器然后从存储器装置的寄存器中读取该信息。
访问命令地址寄存器装置存储数据

[发明专利]经由存储器的误差信号训练存储器信号的方法和装置-CN201180031921.9有效
发明人： S.乔扈里;J.H.萨尔蒙;K.S.拜恩斯 -专利权人：英特尔公司
申请日： 2011-06-20 - 公布日： 2013-03-06 - 主分类号： G11C29/42 文献下载
摘要：本文描述了用于经由存储器的误差信号训练存储器信号的方法和装置。该方法包括从存储器控制器传送命令-地址(C/A)信号到存储器模块；通过存储器控制器，经由来自存储器模块的误差引脚的误差信号来确定存储器模块中的误差，该误差与传送到存储器模块的C/A信号相关联；以及响应于确定存储器模块中的误差，通过存储器控制器修改C/A信号，其中误差引脚是存储器模块的奇偶校验误差引脚，并且其中存储器模块包括双倍数据率4(DDR4)接口。
经由存储器误差信号训练方法装置

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