专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种电源选择电路及存储器-CN202310736558.5在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2023-06-19 - 2023-09-19 - G11C11/16
  • 本公开提供了一种电源选择电路及存储器,涉及集成电路技术领域。其中,电源选择电路包括:第一供电电路,其输入端接收处于第一电压域的电源选择信号,其第一电源端接收第一电源信号,其输出端耦接至虚设字线,第一供电电路配置为根据第一电源信号产生控制电源信号,在控制电源信号的控制下将电源选择信号转换为处于第二电压域的第一控制信号,并根据第一控制信号控制第一电源信号从其输出端输出;第二供电电路,其输入端接收电源选择信号,其第一电源端接收第二电源信号,其输出端耦接至虚设字线,第二供电电路配置为根据电源选择信号控制第二电源信号从其输出端输出;本公开可以提高了电源选择电路的选择可靠性。
  • 一种电源选择电路存储器
  • [发明专利]反熔丝阵列架构及存储器-CN202210664729.3在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-06-13 - 2022-10-11 - G11C17/16
  • 本公开实施例涉及半导体电路设计领域,特别涉及一种反熔丝阵列架构及存储器,反熔丝阵列架构,包括:多个反熔丝存储阵列,其中,不同的反熔丝存储阵列基于不同的时钟信号驱动;第一控制模块,耦接多个反熔丝存储阵列,被配置为,基于初始时钟信号和多个选择信号产生一个子时钟信号,子时钟信号用于驱动相对应的一个反熔丝存储阵列。本公开实施例通过设计一种新的反熔丝阵列架构,以引入更多反熔丝存储单元,且对反熔丝电路内逻辑电路的改动较小,适用于集成度日益增加的DRAM芯片。
  • 反熔丝阵列架构存储器
  • [发明专利]一种反熔丝阵列及可编程非易失性存储器-CN202210451536.X在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-04-26 - 2022-07-15 - G11C17/16
  • 本公开涉及集成电路技术领域,公开一种反熔丝阵列及可编程非易失性存储器。该反熔丝阵列的读取电路包括比较电路、第一输出控制电路和锁存电路,比较电路连接第二节点、第三节点和第四节点,并具有第一信号端和第二信号端,第一信号端或第二信号端连接数据端口,比较电路能够在时钟控制信号为第一电平时响应于第二节点的信号根据第一信号端和第二信号端的信号比较结果向第三节点输出第一感应信号以及向第四节点输出第二感应信号;第一输出控制电路连接第二节点和接地端,用于在时钟控制信号为第一电平时导通第二节点和接地端;锁存电路连接第三节点和第四节点,能够根据第一感应信号和第二感应信号输出反熔丝阵列存储的数据。
  • 一种反熔丝阵列可编程非易失性存储器
  • [发明专利]一种可编程非易失性存储器-CN202210316446.X在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-03-28 - 2022-07-05 - G11C16/26
  • 本公开涉及集成电路技术领域,公开一种可编程非易失性存储器,该可编程非易失性存储器包括使能信号控制电路,使能信号控制电路接收阵列选择信号和初始使能信号,并基于阵列选择信号和初始使能信号向其中一列反熔丝阵列输出使能控制信号;反熔丝阵列包括读取电路,读取电路连接使能信号控制电路,被配置为根据使能控制信号读取反熔丝阵列存储的数据;多个输出电路,每个输出电路连接一行反熔丝阵列中的读取电路并接收阵列选择信号,被配置为根据阵列选择信号输出读取电路读取的数据。利用阵列选择信号仅向选通的反熔丝存储单元的读取电路输出使能信号,而未被选通的反熔丝存储单元的读取电路则不被使能,从而可节省存储器的功耗。
  • 一种可编程非易失性存储器
  • [发明专利]一种延迟电路和半导体存储器-CN202210220799.X在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-03-08 - 2022-06-24 - H03K5/134
  • 本公开实施例提供了一种延迟电路和半导体存储器,该延迟电路包括至少一个第一延迟单元和至少一个第二延迟单元;第一延迟单元与第二延迟单元交错设置,且第二延迟单元用于接收第一延迟单元的输出信号;位于延迟电路首位的第一延迟单元或第二延迟单元的输入端用于接收初始输入信号,位于延迟电路末位的第一延迟单元或第二延迟单元用于输出延时后的初始输入信号。这样,通过多个延迟单元组合实现输入信号上升沿或者输入信号下降沿的延时,延时结果仅由输入信号的单个信号沿和延迟单元的延迟能力决定,不受输入信号的脉冲宽度影响,从而避免延时失败的情况,提高延时可靠性。
  • 一种延迟电路半导体存储器
  • [发明专利]一种振荡电路-CN202210314365.6在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-03-28 - 2022-06-24 - H03B5/12
  • 本公开涉及集成电路技术领域,公开一种振荡电路,该振荡电路包括:振荡模块,包括奇数个第一反相器级联,每一级所述第一反相器的输出端连接下一级第一反相器的输入端,最后一级所述第一反相器的输出端连接第一级所述第一反相器的输入端;供电模块,与所述振荡模块连接,用于为第一级所述第一反相器提供工作电压;电压调整模块,连接至所述振荡模块和所述供电模块的连接处,用于加快所述连接处节点电压的建立时间。电压调整模块和供电模块可同时向第一级的第一反相器提供相应的供电信号,从而第一级的第一反相器可以获取到供电模块和电压调整模块同时提供的供电信号,由此可以加快该连接处的节点电压的建立时间,加快该振荡电路的启动速度。
  • 一种振荡电路
  • [发明专利]稳压器及其控制方法-CN202210246743.1在审
  • 陈啸宸 - 长鑫存储技术有限公司
  • 2022-03-14 - 2022-05-31 - G05F1/625
  • 本公开实施例涉及半导体技术领域,提供一种稳压器及其控制方法,稳压器包括:比较模块,被配置为比较基准电压和反馈电压并基于比较生成误差电压;输出电压调节模块,与比较模块的输出端耦接于第一节点,被配置为基于误差电压来调整输出电压调节模块接收的输入电压,以向输出节点提供输出电压;反馈电路,耦接于输出节点和接地电压之间,反馈电路被配置为对输出电压进行分压以提供反馈电压;驱动电压调节模块,与第一节点耦接,用于在稳压器工作的启动阶段调节第一节点处的电位。本公开实施例至少有利于加速稳压器的启动。
  • 稳压器及其控制方法

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