专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]基于FPGA的可配置的时钟频率合成装置-CN201210261705.X有效
  • 刘大同;彭宇;刘连胜;刘川;见其拓 - 哈尔滨工业大学
  • 2012-07-26 - 2013-01-16 - H04J3/06
  • 基于FPGA的可配置的时钟频率合成装置,属于收发器的发送时钟设计技术领域。它解决了使用普通晶振作为收发器的发送时钟源,会由于发送时钟信号抖动过大导致收发器不能正常产生恢复时钟信号,因而不能正确输出接收数据的问题。它的时钟发生单元的时钟信号输出端连接频率合成单元的时钟信号输入端,频率合成单元的控制信号输入端连接频率合成控制逻辑单元的控制信号输出端,频率合成单元的两对设定频率的差分时钟信号输出端与收发器的两对发送时钟信号输入端一一对应连接,频率合成控制逻辑单元内部的配置寄存器通过FPGA内部的其他逻辑单元或由上位机通过PCI接口进行21位数据配置,实现时钟频率合成。本发明适用于时钟频率的合成。
  • 基于fpga配置时钟频率合成装置
  • [发明专利]一种应用于PowerPC最小系统的引导装置及引导方法-CN201210239097.2有效
  • 刘大同;彭宇;刘连胜;刘川;见其拓;彭喜元 - 哈尔滨工业大学
  • 2012-07-11 - 2012-11-28 - G06F9/455
  • 一种应用于PowerPC最小系统的引导装置及引导方法,涉及一种引导装置及引导方法。它解决了在没有仿真器时,PowerPC最小系统的引导过程复杂、引导时间长的问题。其装置:PowerPC的片选信号输出端通过CPLD连接Data Flash芯片的片选信号输入端;PowerPC的写使能和输出使能信号端分别通过总线收发芯片和CPLD与Data Flash芯片的写使能和输入使能信号端连接;PowerPC的地址数据总线端通过总线收发芯片与Data Flash芯片的地址数据总线端连接;PowerPC的数据输出或输入端通过总线收发芯片与Data Flash芯片的数据输入或输出端连接。其方法:在PowerPC最小系统引导调试后,采用Data Flash芯片对PowerPC最小系统进行引导。本发明适用于PowerPC最小系统。
  • 一种应用于powerpc最小系统引导装置方法

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