专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]用于非易失性存储器的基于行的交替读写-CN200680049987.X有效
  • 丹尼尔·C·古特曼 - 桑迪士克股份有限公司
  • 2006-12-27 - 2009-03-11 - G11C16/34
  • 以邻近于一组存储元件的选择栅极线的字线WLn开始编程所述组存储元件。在编程所述第一字线之后,跳过邻近于所述第一字线的下一字线WLn+1且编程邻近于WLn+1的下一字线WLn+2。接着编程WLn+1。编程根据序列{WLn+4、WLn+3、WLn+6、WLn+5,…}而继续,直到已编程所述组的除最后字线外的所有字线为止。接着编程所述最后字线。通过以此方式进行编程,所述组的所述字线中的一些字线(WLn+1、WLn+3等)不具有经随后编程的相邻字线。这些字线的存储器单元将不经历因经随后编程的相邻存储器单元所致的任何浮动栅极到浮动栅极耦合阈值电压移位影响。在不使用基于相邻存储器单元的偏移或补偿的情况下读取不具有经随后编程的相邻字线的字线。使用基于两个经随后编程的相邻字线内的数据状态的补偿读取其它字线。
  • 用于非易失性存储器基于交替读写
  • [发明专利]对非易失性存储器的并行编程-CN200580025143.7有效
  • 丹尼尔·C·古特曼 - 桑迪士克股份有限公司
  • 2005-06-02 - 2007-10-17 - G11C16/04
  • 本发明的一个实施例包括:对一位线施加一第一值(A或B,图12),对与所述位线(图9上晶体管566的漏极)及一共用选择线(图9上晶体管500的源极)相关联的字线(图9上的WLO/WL31)进行升压以基于所述第一值形成一第一状态,及切断与所述共用选择线相关联的一边界非易失性存储元件(例如图9上的532)以为与所述位线及所述共用选择线相关联的一特定非易失性存储元件(例如图9上的518)保持所述第一状态。对所述位线施加一第二值,并对所述字线的至少一子集进行升压以为与所述位线及共用选择线相关联的一不同的非易失性存储元件(例如图9上的550)形成一第二状态。所述第二状态是基于所述第二值。所述第一状态与所述第二状态在时间上重叠。根据这两个非易失性存储元件的相关联的状态对这两个非易失性存储元件并行编程。
  • 非易失性存储器并行编程
  • [发明专利]多状态存储器的智能检验-CN200380105121.2有效
  • 杰弗里·S·冈沃尔;丹尼尔·C·古特曼;尤平·卡温·方 - 桑迪士克股份有限公司
  • 2003-12-01 - 2006-01-11 - G11C11/56
  • 本发明提出一种“智能检验”技术,由此通过使用对于基于依序状态检验实施的多状态检验范围的基于检验结果的动态调整来编程多状态存储器。此项技术可在维持依序检验的多状态存储器实施内的可靠操作的同时,提高多状态写入速度。其通过提供“智能”方法最小化写入序列的每个编程/检验/锁定步骤的依序检验操作的数量从而实现上述目的。在所选择存储元件的编程/检验循环序列期间多状态存储器的写入序列的示范性实施例中,在进程开始时,在检测阶段中,仅对于所选择存储元件正被编程到其中的多状态范围的最低状态进行检测。一旦一或多个所选择元件达到第一存储状态,则将多状态序列中的下一个状态加入到检验进程中。所述下一个状态可在序列中最快的元件达到其前一个状态时,立即加入,或者也可以在若干编程循环的延迟之后加入。将状态加入到检验阶段中正被检验集合中的加入过程继续依序进行经过多状态集合的剩余部分,直到最高状态已被加入。此外,当所有局限于这些水平的所选择存储元件都被成功地检验为符合那些目标值,且当其被锁定无法进一步被编程时,可将较低状态从所述检验集合中移除。
  • 状态存储器智能检验

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