专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种基于日志合并树结构的轻量级合并方法-CN201611246968.8有效
  • 万继光;庄晓照;姚婷;谭志虎;谢长生;桂清鑫 - 华中科技大学
  • 2016-12-29 - 2019-12-20 - G06F16/28
  • 本发明公开了一种基于日志合并树结构的轻量级合并方法,本发明方法在日志合并树结构中使用了大小动态变化的有序键值对表,同时将下层有序键值对表的元数据存储在键值范围重叠的上层有序键值对表中;根据日志合并树中各个有序键值对表层的均衡程度,选取相应的有序键值对表作为合并对象;合并选取的有序键值对表中的元数据,并将合并后的元数据以及相应的键值对数据以追加的方式写入键值范围重叠的下层有序键值对表;调整有序键值对表的键值范围使同层次的有序键值对表负载达到均衡状态;使用分段二分法查找方式,对键值对数据进行快速高效查找。本方法可以降低日志合并树的合并操作开销,减少写放大,提升日志合并树结构的性能。
  • 一种基于日志合并结构轻量级方法
  • [发明专利]一种液晶基图像与波前双模电调成像探测芯片-CN201510897604.5有效
  • 张新宇;雷宇;信钊炜;魏冬;桑红石;王海卫;谢长生 - 华中科技大学
  • 2015-12-07 - 2019-11-12 - G01J5/00
  • 本发明公开了一种液晶基图像与波前双模电调成像探测芯片,包括液晶微光学结构、面阵可见光探测器和驱控预处理模块;液晶微光学结构在时序加电态下为面阵电控液晶微透镜;面阵可见光探测器被面阵电控液晶微透镜依其阵列规模划分成多个子面阵可见光探测器,每单元电控液晶微透镜与一个子面阵可见光探测器对应,构成测量波前模态;液晶微光学结构在时序断电态下为延迟入射波束的液晶相位板,它与面阵可见光探测器构成成像模态。本发明的一种液晶基图像与波前双模电调成像探测芯片基于时序电信号捕获目标的出射波前与高像质平面图像,探测效能高,使用方便,易与常规成像光学系统耦合。
  • 一种液晶图像双模成像探测芯片
  • [发明专利]一种基于环状虚拟双控的多控制器实现方法-CN201610912391.3有效
  • 万继光;庄晓照;刘丽琼;谭志虎;谢长生;李大平;桂清鑫 - 华中科技大学
  • 2016-10-19 - 2019-07-09 - G06F3/06
  • 本发明公开了一种基于环状虚拟双控的多控制器的实现方法,本方法将一个物理磁盘控制器映射成两个虚拟控制器,多个物理磁盘控制器映射的虚拟控制器构成虚拟控制器环,相邻且不属于同一个物理磁盘控制器的两个虚拟控制器形成一组虚拟双控,构成环状虚拟双控;存储卷通过多组虚拟双控映射访问,每组虚拟双控根据接收的请求的类型进行分类处理。每组虚拟双控中的两个虚拟控制器相互形成镜像;当增加或移出物理磁盘控制器,系统可以快速重构为一个新的虚拟控制器环,并对控制器的负载进行重新分布。本方法能提高系统读写性能,同时保证数据的可靠性和负载均衡;具有良好的可扩展性和故障处理能力。
  • 一种基于环状虚拟控制器实现方法
  • [发明专利]一种基于局部性优先的RS纠删码数据布局方法及系统-CN201710149372.4有效
  • 黄建忠;曹强;谢长生;王爽;蔡奇 - 华中科技大学
  • 2017-03-14 - 2019-07-09 - G06F11/08
  • 本发明公开了一种基于局部性优先的RS纠删码数据布局方法及系统,本发明方法在每轮构建条带时,由包含待选分块最多的节点依次提供待选分块构建条带所需的数据分块,并将计算所得校验分块分开迁移至未提供待选分块的节点,若计算校验分块的待选分块数量不够时,则依次从包含待选分块最多的节点中迁移一个待选分块到本轮不包含待选分块的节点中,其中所述待选分块为还未参与构建条带的数据分块。本发明还实现了一种基于局部性优先的RS纠删码数据布局系统。采用本发明技术方案能够实现构建条带的过程中节点之间的网络传输量最少,除此之外还能实现同一条带的数据分块和校验分块均匀分布在集群的每个节点中,因此可提升集群系统的整体性能。
  • 一种基于局部性优先rs纠删码数据布局方法系统
  • [发明专利]一种基于闪存页错误特性降低LDPC译码延迟的方法-CN201710563434.6有效
  • 吴非;谢长生;张猛;崔兰兰 - 华中科技大学
  • 2017-07-12 - 2019-06-28 - H03M13/11
  • 本发明公开了一种基于闪存页错误特性降低LDPC译码延迟的方法,随着MLC NAND闪存制成工艺的提升,存储单元的尺寸越来越小单元之间的耦合干扰变得更加强烈,引起高的比特错误率,高的比特错误率严重影响着数据的可靠性。具有强纠错能力的LDPC码被广泛使用以保证数据可靠性。然而,当采用LDPC码时,MLC NAND闪存的MSB页和LSB页有着不平衡的译码延迟,LSB页的译码延迟高于MSB页的译码延迟由于LSB页有着较高的比特错误率,造成差的MLC闪存读性能。本发明根据MSB页的译码结果和保存错误模式为LSB页译码提供有利信息用以降低LSB页的译码延迟,从而缩小这两个页之间译码延迟的差距以提高MLC闪存读性能。
  • 一种基于闪存错误特性降低ldpc译码延迟方法

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