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[发明专利]半导体结构及其制造方法-CN202210672429.X在审
发明人：温文莹 -专利权人： 新唐科技股份有限公司
申请日： 2022-06-15 - 公布日： 2023-07-11 - 主分类号： H01L29/778 文献下载
摘要：本申请公开一种半导体结构及其制造方法，其中，所述半导体结构包含基板及通道层，通道层设置于基板之上。通道层具有第一掺杂区与第二掺杂区。第二掺杂区的一部分嵌入第一掺杂区，且第一掺杂区的掺杂类型与第二掺杂区的掺杂类型相反。所述半导体结构也包含阻障层，阻障层设置于通道层之上。所述半导体结构更包含栅极、源极与漏极，栅极、源极与漏极设置于阻障层之上并穿过阻障层。栅极设置于第二掺杂区之上，且源极与漏极分别设置于栅极的两侧。本发明可以提高半导体结构整体的电性能。
半导体结构及其制造方法

[发明专利]裸晶测试系统及其测试方法-CN202210938726.4在审
发明人：洪嘉宏 -专利权人： 新唐科技股份有限公司
申请日： 2022-08-05 - 公布日： 2023-07-11 - 主分类号： G01R31/28 文献下载
摘要：本公开提供一种裸晶测试系统及其测试方法。裸晶测试系统包括用以提供测试命令的控制装置与测试装置。测试装置包括具有温度补偿电阻串与校准电阻串的待测裸晶，测试装置依据测试命令进行频率测试操作。频率测试操作包括：在第一温度下，依序调整温度补偿电阻串为多个温度补偿电阻值，并依序调整校准电阻串来对待测裸晶进行输出频率校准，以产生多个校准电阻值；对多个温度补偿电阻值与多个校准电阻值进行插值运算；依序在第二温度与第三温度下依据多个经插值温度补偿电阻值与多个经插值校准电阻值进行输出频率测试以产生多个输出频率。
测试系统及其方法

[发明专利]预看进位加法器、安全加法器及执行预看进位加法的方法-CN202211309495.7在审
发明人：吴坤益;李钰珊 -专利权人： 新唐科技股份有限公司
申请日： 2022-10-25 - 公布日： 2023-07-11 - 主分类号： G06F7/50 文献下载
摘要：本发明提供预看进位加法器、安全加法器及执行预看进位加法的方法。第一掩膜单元根据第一掩膜值对第一输入数据执行第一掩膜运算以得到第一已掩膜数据。第二掩膜单元根据第二掩膜值对第二输入数据执行第二掩膜运算以得到第二已掩膜数据。第一互斥或门接收第一和第二掩膜值以提供一变数。半加法器接收第一和第二已掩膜数据，以产生一传播值和一中间产生值。第三掩膜单元根据第三掩膜值对传播值执行第三掩膜运算以得到第三已掩膜数据。预看进位产生器根据进位输入、产生值和传播值而提供一进位输出以及一进位值。第二互斥或门接收第三已掩膜数据以及进位值，以提供一总和输出。本申请能够降低安全加法器的耗电量并减少集成电路的面积，降低制造成本。
进位加法器安全执行加法方法

[发明专利]加法掩膜值产生器、加密器以及产生串流金钥的方法-CN202211315849.9在审
发明人：吴坤益;李钰珊 -专利权人： 新唐科技股份有限公司
申请日： 2022-10-26 - 公布日： 2023-07-11 - 主分类号： G06F21/60 文献下载
摘要：本发明提供加法掩膜值产生器、加密器以及产生串流金钥的方法，其中加法掩膜值产生器的第一运算电路根据第一输出掩膜值和第四输出掩膜值而得到第一中间数据。第二运算电路以根据第一中间数据和第四输入掩膜值而得到第一掩膜组的加法输出掩膜值。第三运算电路根据第二输出掩膜值和第三输出掩膜值而得到第二中间数据。第四运算电路根据第二中间数据和第二输入掩膜值而得到第二掩膜组的加法输出掩膜值。第一掩膜组的第一加法输入掩膜值和第二加法输入掩膜值分别为第一输入掩膜值和第二输入掩膜值。第二掩膜组的第一加法输入掩膜值和第二加法输入掩膜值分别为第三输入掩膜值和第一中间数据。
加法掩膜值产生器加密以及产生串流方法

[发明专利]节省进位加法器、安全加法器以及执行安全节省进位加法的方法-CN202211176891.7在审
发明人：吴坤益;李钰珊 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-26 - 公布日： 2023-07-11 - 主分类号： G06F7/501 文献下载
摘要：本发明提供节省进位加法器、安全加法器以及执行安全节省进位加法的方法。该节省进位加法器包括：一第一掩膜单元根据一第一掩膜值和一输入变量对第一掩膜值所对应的一第一输入数据执行一第一掩膜运算，以得到一第一变量。一第二掩膜单元根据第一掩膜值和一第二掩膜值对第二掩膜值所对应的一第二输入数据执行一第二掩膜运算，以得到一第一已掩膜数据。一第三掩膜单元根据第一掩膜值和一第三掩膜值对第三掩膜值所对应的一第三数据执行一第三掩膜运算，以得到一第二已掩膜数据。一异或门接收第一已掩膜数据和第二已掩膜数据以及第一变量，以提供第一输入数据、第二输入数据和第三输入数据的一总和输出。
节省进位加法器安全以及执行加法方法

[发明专利]密码加速器以及加解密运算的差分故障分析方法-CN202211172833.7在审
发明人：吴坤益;李钰珊 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-26 - 公布日： 2023-07-11 - 主分类号： H04L9/06 文献下载
摘要：本发明提供密码加速器及加解密运算的差分故障分析方法。加解密电路用以根据控制信号执行加解密运算。加解密运算包括多个正常回合以及多个冗余回合。控制器用以根据第一变数和第二变数提供控制信号至加解密电路，以控制加解密电路执行正常回合以及冗余回合的顺序。第一存储器用以存储执行正常回合的状态。第二存储器用以存储执行冗余回合的状态。加解密电路根据第一变数将正常回合划分成第一正常部分与第二正常部分，并根据第二变数将冗余回合划分成第一冗余部分与第二冗余部分。加解密电路是依序执行第一正常部分、第一冗余部分、第二正常部分以及第二冗余部分。本申请能避免攻击者在正常回合和冗余回合制造相同的故障，改善时间冗余机制。
密码加速器以及解密运算故障分析方法

[发明专利]微控制芯片及存取方法-CN202211114680.0在审
发明人：杜俞辉 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-14 - 公布日： 2023-07-11 - 主分类号： G06F12/14 文献下载
摘要：一种微控制芯片及存取方法，微控制芯片耦接一外部存储器，并包括一中央处理器、一地址对应电路以及一地址汇流排。中央处理器用以提供一内部地址。地址对应电路计算一唯一编号以及一种子码，用以产生一基础参数，并根据基础参数，对内部地址进行一乱序运算，用以产生一加密地址。地址汇流排耦接于地址对应电路与外部存储器之间，用以提供加密地址予外部存储器。外部存储器根据加密地址储存一特定数据。
控制芯片存取方法

[发明专利]芯片检测方法及其检测载具-CN202211077473.2在审
发明人：洪健哲 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-05 - 公布日： 2023-07-11 - 主分类号： G01R31/28 文献下载
摘要：本发明提供了一种芯片检测方法及其检测载具，该芯片检测方法包括下述步骤：首先，提供一检测载具，其中，该检测载具包括一载具本体、多个电检测头以及一检测单元，该载具本体上形成有一凹槽，所述多个电检测头耦接该检测单元，所述多个电检测头位于该凹槽之中，该检测单元设于该载具本体之上。接着，提供一待测芯片，其中，该待测芯片包括一第一表面、一第二表面以及多个电接点，该第一表面相反于该第二表面，所述多个电接点分布于该待测芯片的边缘。再，将该待测芯片置于该凹槽之中，所述多个电检测头分别直接抵接所述多个电接点，检测单元通过所述多个电检测头对该芯片进行检测。
芯片检测方法及其

[发明专利]控制电路及其系统编程方法-CN202210897806.X在审
发明人：张志源 -专利权人： 新唐科技股份有限公司
申请日： 2022-07-28 - 公布日： 2023-07-11 - 主分类号： H04N5/765 文献下载
摘要：一种控制电路及其系统编程方法，其中该控制电路设置于一第一电子装置，第一电子装置通过高画质多媒体接口HDMI总线与一第二电子装置电连接。控制电路包括：一快闪存储器，其中快闪存储器包括一应用编程区及一系统编程区；以及一运算单元。当第一电子装置接收到一高画质多媒体接口‑消费者电子控制HDMI‑CEC指令时，运算单元判断HDMI‑CEC指令是否符合一特定条件。因应于HDMI‑CEC指令符合特定条件，控制电路系控制第一电子装置进入一系统编程模式以更新在应用编程区或系统编程区的固件。
控制电路及其系统编程方法

[发明专利]超前进位加法器、安全加法器及执行超前进位加法的方法-CN202210665430.X在审
发明人：吴坤益;李钰珊 -专利权人： 新唐科技股份有限公司
申请日： 2022-06-14 - 公布日： 2023-07-11 - 主分类号： G06F7/503 文献下载
摘要：本发明提供超前进位加法器、安全加法器及执行超前进位加法的方法。所述超前进位加法器包括：第一异或门接收第一遮罩值和第二遮罩值以提供一变数。第一遮罩单元根据变数对第一输入数据执行第一遮罩运算以得到第一已遮罩数据。半加法器接收第一已遮罩数据和第二输入数据以产生一传播值和一中间产生值。第二遮罩单元根据第三遮罩值对传播值执行第二遮罩运算以得到第二已遮罩数据。逻辑电路根据传播值、中间产生值和第二遮罩值而提供一产生值。超前进位产生器根据进位输入、产生值和传播值而提供一进位输出以及一进位值。第二异或门接收第二已遮罩数据以及进位值，以提供一总和输出。
超前进位加法器安全执行加法方法

[发明专利]控制电路及控制方法-CN202211114689.1在审
发明人：刘则言;张佑任 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-14 - 公布日： 2023-07-11 - 主分类号： G05B19/042 文献下载
摘要：一种控制电路及控制方法，该控制电路包括一正交解码电路、一计数电路以及一截断电路。正交解码电路根据一第一外部信号以及一第二外部信号，产生一第一边缘信号以及一第一方向信号。计数电路根据第一边缘信号及第一方向信号，执行一计数操作。当一计时信号被致能时，截断电路阻挡第一边缘信号及第一方向信号进入计数电路，并提供一第二边缘信号以及一第二方向信号至计数电路，使得计数电路根据第二边缘信号及第二方向信号，执行计数操作。
控制电路控制方法

[发明专利]数据保持电路和方法-CN202211065969.8在审
发明人：黄启睿 -专利权人： 新唐科技股份有限公司
申请日： 2022-09-01 - 公布日： 2023-07-11 - 主分类号： G06F1/30 文献下载
摘要：本发明提供了一种数据保持电路和方法。其中，数据保持电路包括一主闩锁电路、一从属闩锁电路和一控制电路。控制电路耦接主闩锁电路和从属闩锁电路。控制电路用以从一时钟电路接收一时钟信号和从一电源管理单元接收一电源管理信号。当在一正常操作模式时，控制电路将时钟信号传送给主闩锁电路和从属闩锁电路。当在一睡眠模式时，主闩锁电路的电源被关闭，且控制电路将电源管理信号传送给从属闩锁电路，以保存数据。
数据保持电路方法

[发明专利]除错系统、微处理装置及除错方法-CN202211047181.4在审
发明人：马纪哲 -专利权人： 新唐科技股份有限公司
申请日： 2022-08-29 - 公布日： 2023-07-11 - 主分类号： G05B19/042 文献下载
摘要：本发明提供了一种除错系统、微处理装置及除错方法。除错系统包括一除错器和一目标装置。除错器可用以输出一输出信号。上述输出信号是一第一编码信号或一重置信号，且上述第一编码信号是由一第一数据信号和一第一时钟信号编码后所产生。目标装置包括一串列除错界面电路和一串列除错存取埠。串列除错界面电路耦接上述除错器，以接收上述输出信号。此外，串列除错界面电路可解码上述第一编码信号，以产生上述第一数据信号和上述第一时钟信号。串列除错存取埠耦接串列除错界面电路。串列除错存取埠从串列除错界面电路接收上述数据信号和上述时钟信号，以进行目标装置的除错。
除错系统处理装置方法

[发明专利]控制装置及其操作方法-CN202210497327.9在审
发明人：李柏谊;田志新 -专利权人： 新唐科技股份有限公司
申请日： 2022-05-09 - 公布日： 2023-07-11 - 主分类号： G05B19/042 文献下载
摘要：本申请提供一种控制装置及其操作方法，所述控制装置包括检测单元、控制单元、存储单元、时钟源单元与多个信号传输单元。检测单元检测电压信号，以产生检测信号。控制单元耦检测单元，接收检测信号，并依据检测信号，产生指示旗标、电压信息、第一控制信号与多个第二控制信号至少其一。存储单元耦接控制单元，接收并存储指示旗标与电压信息。时钟源单元耦接控制单元，接收第一控制信号，并依据第一控制信号，产生第一时钟信号或第二时钟信号。多个信号传输单元耦接控制单元，接收第二控制信号，并依据第二控制信号，传输或不传输多个功能信号。
控制装置及其操作方法

[发明专利]半导体结构及其形成方法-CN202110422809.3有效
发明人：陈柏安 -专利权人： 新唐科技股份有限公司
申请日： 2021-04-19 - 公布日： 2023-07-07 - 主分类号： H01L29/06 文献下载
摘要：本发明提供一种半导体结构及其形成方法，该方法包含：在基板上依序形成外延层及半导体层。在半导体层上形成图案化硬遮罩层。使用图案化硬遮罩层作为刻蚀遮罩，并刻蚀半导体层及外延层，以使外延层具有凹槽。移除图案化硬遮罩层。形成第一电极介电层于凹槽的侧壁及底面上且于半导体层上，以使第一电极介电层具有沟槽。形成第一电极于沟槽中。形成一对第二电极于第一电极上，以使该对第二电极沿着水平方向彼此对应地设置。形成第三电极于该对第二电极上。
半导体结构及其形成方法