专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种免时钟同步的芯片数据传输方法、系统及电子设备-CN201710952195.3有效
  • 李五文;吴语棋 - 深圳探科技术有限公司
  • 2017-10-12 - 2020-12-22 - H04L1/00
  • 本申请涉及一种免时钟同步的芯片数据传输方法、系统及电子设备。所述传输方法包括:步骤a:发送端将待发送数据打包成数据块,并通过数据传输线将所述数据块传输至接收端;其中,所述数据块中包括训练比特串和数据比特流;步骤b:接收端接收所述数据块,并通过解码器获取数据块中的训练比特串,根据所述训练比特串分别获取数据块起始位置以及比特位时域长度;步骤c:根据所述数据块起始位置以及比特位时域长度对数据比特流进行解码。本申请通过发送端将待发送数据打包成包括训练比特串的数据块,接收端接收到数据块后,根据训练比特串获取发送端的比特位时间宽度并以此作为依据对数据块中的数据比特流进行解码,实现单数据线传输的目的。
  • 一种时钟同步芯片数据传输方法系统电子设备
  • [发明专利]集成电路仿真同步处理的方法、模块、存储介质及系统-CN202010415363.7在审
  • 李五文;吴语棋 - 深圳探科技术有限公司
  • 2020-05-15 - 2020-08-18 - G06F30/331
  • 本发明公开了集成电路仿真同步处理的方法、模块、存储介质及系统,通讯器采用分组并行通讯方式,将待仿真芯片的时钟树与通讯器之间形成映射关系,使一个通讯器负责一个时钟信号;时钟树包括实施控制作用的时钟信号;将受同一时钟信号控制的逻辑模块归属于同一通讯器之下;然后进行仿真;在同一通讯器之下的所有仿真进程完成后再继续下一循环。通过将待仿真芯片的时钟树与通讯器之间形成映射关系,使一个通讯器负责一个时钟信号,然后将受同一所述时钟信号控制的逻辑模块归属于同一通讯器之下,该通讯器通过并行处理,同步开始仿真进程;在同一通讯器之下的所有逻辑模块的仿真进程完成后再继续下一循环,有效的实现不同逻辑模块之间的同步控制。
  • 集成电路仿真同步处理方法模块存储介质系统

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