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- [发明专利]半导体装置-CN201480007500.6有效
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小野泽勇一;吉村尚;泷下博
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富士电机株式会社
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2014-03-18
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2018-04-20
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H01L29/861
- 在n‑半导体基板的背面的表面层,从活性区域(10)到边缘终端结构部(11)设置有n+阴极层(4)。在n+阴极层(4)的整个表面设置有阴极电极(7)。在n‑漂移区域(1)内部的n+阴极层(4)侧,从活性区域(10)到边缘终端结构部(11)设置有n缓冲层(5)。在n‑漂移区域(1)内部的n+阴极层(4)侧,在距离基板背面比n+阴极层(4)要深的位置设置有浮空的p埋层(6)。p埋层(6)在与n+阴极层(4)相接的规定范围内均匀地进行设置。p埋层(6)的端部(6a)位于n‑半导体基板的侧面(1a)的内侧。由此,能够提供可实现软恢复化,且反向恢复容限较大的半导体装置。
- 半导体装置
- [发明专利]半导体装置的制造方法-CN201380005432.5有效
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宫崎正行;吉村尚;泷下博;栗林秀直
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富士电机株式会社
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2013-03-29
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2017-09-08
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H01L29/739
- 在作为n‑漂移层的半导体基板的内部,在背面侧的表面层设置有p+集电极层,在比背面侧的p+集电极层深的区域设置有n+电场终止层。集电极与p+集电极层相接。形成p+集电极层和n+电场终止层时,在半导体基板的背面离子注入杂质离子(步骤S5)。接下来,通过第一退火使杂质离子活性化,形成p+集电极层(步骤S6)。接下来,对半导体基板的背面进行质子照射(步骤S7)。接下来,通过第二退火使质子施主化,形成电场终止层(步骤S8)。第一退火是在比第二退火高的退火温度下进行。之后,在半导体基板的背面形成集电极(步骤S9)。由此,能够避免电特性不良的产生。
- 半导体装置制造方法
- [发明专利]半导体装置-CN201380019387.9有效
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小野泽勇一;高桥英纪;吉村尚
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富士电机株式会社
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2013-10-11
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2014-12-17
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H01L29/78
- 本发明通过提供一种半导体装置,从而能够以较少的工艺工序数目的增加来抑制成本增加、合格率降低,并且改善导通特性,所述半导体装置的特征在于,具备:沿第一沟槽(21)的一侧的侧壁而设置在第一绝缘膜的内侧,并且设置在第二沟槽(40)的内部的第一栅电极(22a);沿第一沟槽(21)的另一侧的侧壁设置在第二绝缘膜的内侧,并且设置在第三沟槽(50)的内部的屏蔽电极(22b);通过延长第二沟槽(40),一部分被设置在第一栅电极(22a)上,并与第一栅电极(22a)连接的栅极浇道;通过延长第三沟槽(50),一部分被设置在屏蔽电极(22b)上,并与屏蔽电极(22b)连接的发射极多晶硅层(25a)。
- 半导体装置
- [发明专利]半导体装置及半导体装置的制造方法-CN201280023905.X有效
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吉村尚;栗林秀直;小野泽勇一;仲野逸人;尾崎大辅
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富士电机株式会社
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2012-05-18
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2014-01-22
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H01L29/739
- n型FS层(14)具有使在施加额定电压时扩散的耗尽层停止于n型FS层(14)内部的总杂质量,并具有n-型漂移层(1)的总杂质量。此外,n型FS层(14)具有如下的浓度梯度,即n型FS层(14)的杂质浓度从p+型集电极层(15)向p型基极层(5)减少,且其扩散深度为大于或等于20μm。并且,在n型FS层(14)与p+型集电极层(15)之间包括n+型缓冲层(13),该n+型缓冲层(13)的峰值杂质浓度比n型FS层(14)的峰值杂质浓度要高,为大于或等于6×1015cm-3,且小于或等于p+型集电极层(15)的峰值杂质浓度的十分之一。因此,能够提供一种场阻断(FS)绝缘栅双极晶体管,兼顾改善发生短路时对元器件损坏的耐受性以及抑制热失控损坏,并且,能减少导通电压的变化。
- 半导体装置制造方法
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