[发明专利]USB接口复用电路及USB接口复用方法有效
申请号: | 202110422339.0 | 申请日: | 2021-04-20 |
公开(公告)号: | CN113076272B | 公开(公告)日: | 2022-08-23 |
发明(设计)人: | 杨帆;汪帮磊 | 申请(专利权)人: | 南京甄视智能科技有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/40 |
代理公司: | 北京德崇智捷知识产权代理有限公司 11467 | 代理人: | 季承 |
地址: | 210000 江苏省*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | usb 接口 用电 方法 | ||
1. 一种USB接口复用电路,其特征在于,所述USB接口复用电路包括:主芯片、第一差分开关、第二差分开关、USB HUB电路、延时电路和设备连接器;
所述第一差分开关分别与所述主芯片、所述第二差分开关、所述USB HUB电路和所述延时电路相连;
所述第二差分开关分别与所述USB HUB电路、所述延时电路和所述设备连接器相连;
所述主芯片与所述延时电路相连;
当所述延时电路控制所述第一差分开关和所述第二差分开关都处于第一差分对模式时,通过所述设备连接器外接的上行设备与所述主芯片的USB接口进行上行通信;
当所述延时电路控制所述第一差分开关和所述第二差分开关都处于第二差分对模式时,通过所述设备连接器外接的下行设备与所述主芯片的USB接口进行下行通信;
所述延时电路包括延时器和或门;所述延时器的输入端为所述延时电路的输入端,所述延时器的输出端与所述或门的第一输入端相连,所述或门的第二输入端与所述主芯片的输出端相连,所述或门的输出端为所述延时电路的输出端;所述延时电路的输入端与所述主芯片的输入端相连。
2.根据权利要求1所述的电路,其特征在于,
若在所述主芯片启动之前,所述延时电路的输入端接收到第一信号,则所述延时器在所述第一信号的触发下向所述或门输出第一时长的高电平信号,所述或门在所述高电平信号的控制下向所述第一差分开关和所述第二差分开关输出第一时长的高电平信号,所述第一差分开关和所述第二差分开关在所述第一时长的高电平信号的控制下处于所述第一差分对模式,所述第一差分对模式用于实现所述上行设备向所述主芯片烧录固件。
3.根据权利要求1所述的电路,其特征在于,
若在所述主芯片启动时,所述延时电路的输入端和所述主芯片的输入端接收到第二信号,则所述延时器在所述第二信号的触发下向所述或门输出第二时长的高电平信号,所述或门在所述高电平信号的控制下向所述第一差分开关和所述第二差分开关输出第二时长的高电平信号,所述第一差分开关和所述第二差分开关在所述第二时长的高电平信号的控制下处于所述第一差分对模式,所述第二信号用于控制所述主芯片上电启动。
4.根据权利要求1所述的电路,其特征在于,
若在所述主芯片启动之后,所述或门接收到所述主芯片输出的第三时长的高电平信号,则所述或门在所述高电平信号的控制下向所述第一差分开关和所述第二差分开关输出第三时长的高电平信号,所述第一差分开关和所述第二差分开关在所述第三时长的高电平信号的控制下处于所述第一差分对模式,所述第一差分对模式用于实现所述上行设备向所述主芯片发送上行信息。
5.根据权利要求1所述的电路,其特征在于,
若所述主芯片启动之后,所述或门接收到所述主芯片和所述延时器输出的低电平信号,则所述或门在所述低电平信号的控制下向所述第一差分开关和所述第二差分开关输出低电平信号,所述第一差分开关和所述第二差分开关在所述低电平信号的控制下处于所述第二差分对模式,所述第二差分对模式用于实现所述主芯片向所述下行设备发送下行信息。
6.根据权利要求1至5中任一项所述的电路,其特征在于,所述USB HUB电路包括USBHUB和n个下行从设备,n≥2;
所述USB HUB的输入端为所述USB HUB电路的输入端,所述USB HUB的n个输出端分别与所述n个下行从设备的输入端相连,所述n个下行从设备中的一个下行从设备的输出端为所述USB HUB电路的输出端。
7.根据权利要求6所述的电路,其特征在于,
所述第一差分开关的第一端口与所述USB接口相连,所述第一差分开关的第二端口与所述延时电路的输出端相连;
所述第一差分开关的第三端口与所述第二差分开关的第一端口相连,所述第一差分开关的第四端口与所述USB HUB电路的输入端相连。
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