专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]具有温湿度控制的PCIE转接卡装置及控制方法-CN202310934504.X在审
  • 梁树;黄秋容;汪洋 - 南宁泰克半导体有限公司
  • 2023-07-27 - 2023-10-27 - G06F13/40
  • 本发明公开了一种具有温湿度控制的PCIE转接卡装置及控制方法,其中,温度传感器、湿度传感器、控制器、加湿器、加热器和散热器均装配于PCB板上;所述温度传感器、所述湿度传感器、所述加湿器、所述加热器和所述散热器均与所述控制器连接;所述加湿器环绕设置于所述PCB板上并连接于外壳;所述控制器获取和实时采样所述温度传感器和所述湿度传感器的数据进行预设处理和运算得到温度差值和湿度差值,并根据预设算法、所述温度差值和所述湿度差值控制所述加湿器、所述加热器和所述散热器以调节整个装置的温湿度。这实现了对PCIE转接卡装置的温湿度控制,提高了装置的稳定性和可靠性。
  • 具有温湿度控制pcie转接装置方法
  • [发明专利]一种FPGA开发板的扩展防呆电路及方法-CN202311014447.X在审
  • 张跃;李锡广;陈金霞 - 昆腾微电子股份有限公司
  • 2023-08-11 - 2023-10-27 - G06F13/40
  • 本申请公开了一种FPGA开发板的扩展防呆电路及方法,应用于芯片验证技术领域,用以解决现有技术中存在的FPGA开发板与扩展板不匹配使用导致FPGA开发板损坏的问题。具体为:FPGA开发板的每个第一FMC接口的第一标识传输口从第一FMC接口连接的存储模块中获取扩展板的标识信息,基于标识信息和预存的标识组判断FPGA开发板的比特文件与扩展板是否匹配,在不匹配的情况下控制第一FMC接口禁止传输数据,这样,通过设置存储器件和占用FMC接口中少量的I/O口,实现对FPGA开发板的比特文件与扩展板的匹配判断,避免两者之间的不匹配造成FPGA开发板损坏的情况。
  • 一种fpga开发扩展电路方法
  • [发明专利]一种接口复用电路和服务器-CN202310947632.8在审
  • 李楠 - 苏州浪潮智能科技有限公司
  • 2023-07-31 - 2023-10-27 - G06F13/40
  • 本发明公开了一种接口复用电路,包括:插槽,用于接入第一模组或第二模组;第一控制器,第一控制器与插槽通过I2C总线连接;第一开关,包括第一开关的输入端与第一控制器连接以接收第一控制器发出的PCIE信号;第二开关,包括第一输入端、第二输入端、第一输出端、第二输出端,第一输入端与第一开关的输出端连接,第二输入端与插槽的预设pin脚连接,第一输出端与插槽连接;转换芯片,转换芯片与第二输出端连接,用于将第二输出端输出的PCIE信号转换成USB信号;第三开关,包括第三输入端、第四输入端、第五输入端、第三输出端,第三输入端与预设pin脚连接,第三输出端与插槽连接。本发明还公开了一种服务器。
  • 一种接口用电服务器
  • [发明专利]一种网卡的热插拔设备及服务器-CN202311084136.0在审
  • 王一鸣 - 浪潮(山东)计算机科技有限公司
  • 2023-08-25 - 2023-10-27 - G06F13/40
  • 本发明公开了一种网卡的热插拔设备及服务器,涉及热插拔领域,包括服务器内的处理器及可编程逻辑器件;可编程逻辑器件用于在网卡插入服务器或从服务器拔出时,向处理器发送中断信号及在接收到处理器发送的查询信号时将网卡信息发送至处理器;处理器用于在接收到中断信号时确定存在网卡插入服务器或从服务器拔出,发送查询信号至可编程逻辑器件,根据接收到的网卡信息确定插入服务器或从服务器拔出的网卡的标识及网卡是否在位。在网卡实现热插拔时,可编程逻辑器件会将中断信号发送至处理器,处理器即可确定热插拔事件的发生,同时还可以通过可编程逻辑器件获取网卡信息,以便进行后续的连接。无需运维人员额外操作,简化了操作流程。
  • 一种网卡热插拔设备服务器
  • [发明专利]一种基于重排序缓冲器的读请求处理方法及相关装置-CN202310328701.7在审
  • 任子木 - 腾讯科技(深圳)有限公司
  • 2023-03-24 - 2023-10-27 - G06F13/40
  • 本申请公开一种基于重排序缓冲器的读请求处理方法及相关装置,从多个预设设备发送的多个预设读请求中确定第一读请求,通过共享请求转换器将第一读请求转换为第一总线请求,该第一读请求携带多个预设设备中第一设备的第一设备标识。若多个用于向总线发送总线请求的预设请求标识中存在使用状态为空闲状态的预设请求标识,从多个预设请求标识中确定空闲状态的第一请求标识;若基于第一设备标识从共享重排序缓冲器的多个预设缓冲地址中查找到使用状态为空闲状态的第一缓冲地址,将第一缓冲地址对应第一请求标识。以第一请求标识向总线发送第一总线请求得到总线返回的携带第一请求标识的第一读数据;基于第一请求标识向第一缓冲地址写入第一读数据。
  • 一种基于排序缓冲器请求处理方法相关装置
  • [发明专利]集成电路间(I2C)装置-CN202080040340.0有效
  • S.弗内卡尔;V.埃勒 - AMS国际有限公司
  • 2020-05-28 - 2023-10-27 - G06F13/40
  • 一种I2C装置(100)包括:主设备(102)和两个从设备,它们通过I2C总线连接,由此使用相同的默认设备地址来编程该两个从设备。第一从设备(108)以常规配置连接到总线,而第二从设备(110)以交叉连接配置连接到总线,使得第二从设备的时钟引脚连接到串行数据线,并且第二从设备的数据引脚连接到串行时钟线。响应于第二从设备的数据引脚连接到串行时钟线的检测,第二从设备交换从时钟引脚和数据引脚到第二从设备的处理逻辑的线;以及修改其默认设备地址以确保每个从设备具有唯一的设备地址。
  • 集成电路i2c装置
  • [发明专利]AXI总线的延时调整装置-CN202210672939.7有效
  • 请求不公布姓名 - 沐曦集成电路(南京)有限公司
  • 2022-06-14 - 2023-10-27 - G06F13/40
  • 本发明涉及一种AXI总线的延时调整装置,AXI总线设置了X个AXI通道,1≤X≤5,X个AXI通道划分为Y个相互独立的AXI通道组{U1,U2,…UY},装置包括设置在Uy上的第y延时调整模块;第y延时调整模块包括Ny个依次连接的第y延时调整子模块;Uy包括X(y)个AXI通道,第y延时调整子模块包括X(y)个延时调整单元{AS1y,AS2y,…ASX(y)y};ASiy包括沿Sgiy传输方向依次连接的组包器PKiy、第一寄存器片RSi1y和解包器RKiy,PKiy用于将获取到Sgiy中除有效标识信号Viy外的信号进行组包得到Piy,将Piy和Viy输入至RSi1y延时一个时钟周期然后输出至RKiy,RKiy基于Viy对Piy进行解包,得到延时后的Sgiy。本发明降低了芯片中AXI总线延时调整的复杂度,提高了芯片中AXI总线延时调整的灵活性。
  • axi总线延时调整装置
  • [发明专利]一种基于串口通讯的帧数据流软件接收方法-CN202311087657.1有效
  • 阮琪璋;伍文杰 - 成都量芯集成科技有限公司
  • 2023-08-28 - 2023-10-27 - G06F13/40
  • 本发明涉及串口通讯技术领域,尤其涉及一种基于串口通讯的帧数据流软件接收方法,包括将字节流数据写入字节流环形缓冲器;对写入的字节流数据进行分帧,标记为帧数据,将帧数据的帧属性写入帧数据流环形缓冲器;当有帧属性写入,从字节流环形缓冲器中提取对应的帧数据;检测帧数据的帧长度的正确性,触发回调事件,输出帧数据,供业务逻辑使用。本发明采用多级循环先进先出的机制进行串口字节流数据的读写同步,使用串口在不同波特率下传输单位字节所花费的时间作为超时时间基准来描述一帧数据是否接收完成,以此实现数据帧的分割,然后再通过从字节流被分割的帧实现帧流数据的写入和读出,使数据接收和处理同步,具有协同性。
  • 一种基于串口通讯帧数软件接收方法
  • [实用新型]一种RS485串口和多方式对时电路搭配装置-CN202321168944.0有效
  • 孙磊;阮青亮;曹冰;岳峰;陈继洪;唐宝文;刘海洋 - 南京国电南自电网自动化有限公司
  • 2023-05-15 - 2023-10-27 - G06F13/40
  • 本实用新型公开了一种RS485串口和多方式对时电路搭配装置,包括:主板和副板;其中,主板包括电B码对时模块和解码控制模块;副板包括光B码对时模块和RS485串口模块;电B码对时模块,用于将电B码输入源发送的电B码信号转换为第一TTL电平信号,并将第一TTL电平信号发送到解码控制模块;光B码对时模块,用于将光纤输入的光对时脉冲信号转换成第二TTL电平信号,并将第二TTL电平信号发送到解码控制模块;解码控制模块,用于对第一TTL电平信号和第二TTL电平信号进行解码得到时间信息,并将时间信息发送到供目标监控装置进行时钟同步;RS485串口模块,用于接入RS485信号。本实用新型缓解了现有技术中存在的成本和管理复杂性高的技术问题。
  • 一种rs485串口多方电路搭配装置

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