[发明专利]中断控制器和管理中断控制器的方法在审
申请号: | 202110402330.3 | 申请日: | 2021-04-14 |
公开(公告)号: | CN113535613A | 公开(公告)日: | 2021-10-22 |
发明(设计)人: | J·本哈马迪;S·迈耶 | 申请(专利权)人: | 意法半导体(格勒诺布尔2)公司;意法半导体(ALPS)有限公司 |
主分类号: | G06F13/24 | 分类号: | G06F13/24 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 董莘 |
地址: | 法国格*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 中断 控制器 管理 方法 | ||
1.一种电子设备,包括:
中断控制器,具有输出、以及用于接收控制器时钟信号的输入,所述中断控制器被配置成:当所述控制器时钟信号有效时,在所述输出上递送输出中断信号;以及
控制电路,包括:输入接口,用于接收有可能从所述设备外部的至少一项装备发出的至少一个中断信号;时钟输入,用于接收外部时钟信号;以及第一控制器,被连接到所述输入接口和所述时钟输入,所述第一控制器被配置成从所述至少一个中断信号被断言时直到递送对应的输出中断信号为止,根据所述外部时钟信号自动生成所述控制器时钟信号。
2.根据权利要求1所述的设备,其中所述输入接口被配置成:接收有可能分别从多项不同的外部装备发出的多个中断信号,并且所述第一控制器被配置成:在所述多个中断信号中的至少一个中断信号存在的情况下,根据所述外部时钟信号自动生成所述控制器时钟信号。
3.根据权利要求2所述的设备,其中所述输入接口包括或门,所述或门具有被配置成接收所述多个中断信号的输入、以及被连接到所述第一控制器的输出。
4.根据权利要求1所述的设备,其中所述第一控制器包括逻辑,所述逻辑包括被连接到所述输入接口的第一输入、以及被连接到所述时钟输入的第二输入,所述逻辑被配置成:通过不中断所述外部时钟信号来对所述外部时钟信号进行门控,以自动生成所述控制器时钟信号,并且通过中断所述外部时钟信号,自动不生成所述控制器时钟信号。
5.根据权利要求4所述的设备,其中所述逻辑包括与门,所述与门具有与所述第一输入和所述第二输入耦合的输入。
6.根据权利要求4所述的设备,其中:
所述中断控制器被配置成:在所述控制器时钟信号的一个周期中递送所述输出中断信号;
所述逻辑的所述第一输入被直接连接到所述输入接口;并且
所述逻辑被配置成:在所述中断信号被断言时,在所述逻辑的所述第一输入上递送至少一个中断信号,从而授权生成所述控制器时钟信号,并且在所述中断信号被解除断言之后,通过中断所述外部时钟信号来禁止递送所述控制器时钟信号。
7.根据权利要求4所述的设备,其中:
所述中断控制器被配置成:在所述控制器时钟信号的多个周期期间,递送所述输出中断信号;并且
所述第一控制器还包括控制级,所述控制级被连接到所述输入接口、所述逻辑的所述第一输入和所述中断控制器的所述输出,
所述控制级被配置成:
在所述至少一个中断信号被断言时,只要所述对应的输出中断信号尚未被递送,就在所述逻辑的所述第一输入上递送逻辑信号,从而授权生成所述控制器时钟信号;以及
一旦所述输出中断信号已被递送,通过中断所述外部时钟信号来禁止递送所述控制器时钟信号。
8.根据权利要求7所述的设备,其中所述控制级包括存储器,所述存储器由所述外部时钟信号控制,并且被配置成存储指示至少一个中断信号存在的值,直到所述输出中断信号被生成为止。
9.根据权利要求8所述的设备,其中所述控制级包括与门,所述与门具有被连接到所述中断控制器的所述输出的第一反相输入、以及被连接到所述存储器的输出的第二输入。
10.根据权利要求1所述的设备,其中所述中断控制器是安全中断控制器,并且所述至少一个中断信号是至少一个安全故障信号。
11.一种微控制器,包括:
不安全域,包含不安全处理核,所述不安全处理核包含不安全程序代码;
安全域,包含至少一个安全处理核,所述安全处理核包含安全程序代码以及根据权利要求10所述的设备,所述设备被配置成将所述输出中断信号递送给所述安全处理核;以及
在所述设备外部的至少一项安全装备,其中控制模块与所述至少一项安全外部装备相关联,并且所述控制模块被配置成:在由所述不安全处理核尝试访问所述至少一项安全装备的情况下,将所述安全故障信号递送给所述设备。
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