[发明专利]一种适用于ISO14443协议的BPSK信号同步电路有效

专利信息
申请号: 201110340177.2 申请日: 2011-11-01
公开(公告)号: CN103095447B 公开(公告)日: 2017-03-15
发明(设计)人: 覃钧彦 申请(专利权)人: 上海华虹集成电路有限责任公司
主分类号: H04L7/033 分类号: H04L7/033;H04L7/04
代理公司: 上海浦一知识产权代理有限公司31211 代理人: 丁纪铁
地址: 201203 上海市浦东*** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 适用于 iso14443 协议 bpsk 信号 同步 电路
【说明书】:

技术领域

发明涉及非接触式卡领域,特别是涉及一种适用于ISO14443协议的BPSK信号同步电路。

背景技术

ISO14443协议的规定里,BPSK(Binary Phase Shift Keying)信号可以在任何时刻返回,和A类型的曼切斯特编码不同的是,使用曼切斯特编码必须在规定和ETU成倍数关系,而BPSK不存在这样的限制,BPSK信号可以在任何时刻返回。这样在读卡器端,解码时就存在一个同步的问题,并且由于占空比、累计误差等原因的影响,很容易会造成误解码的问题。

发明内容

本发明要解决的技术问题是提供一种适用于ISO14443协议的BPSK信号同步电路能使本地时钟与接收的BPSK信号同步,利于对BPSK信号的正确解码。

为解决上述技术问题,本发明的BPSK信号同步电路,包含:

一RF模块,用于接收具有数据信息的射频(RF)信号和恢复时钟信号;

一数字锁相环,用于同步本地时钟和RF模块产生的BPSK信号;

一解码模块,用于BPSK信号的解码;

一倒相器,用于对使能信号DPLL_EN进行取反。

所述RF信号是基于ISO/IEC14443协议的BPSK信号。

所述数字锁相环能使用通用的数字锁相环;

所述解码模块能使用通用的BPSK解码电路;

所述能调节锁定时的相位误差及锁定时间。

本发明的BPSK信号同步电路使用数字锁相环,在使能信号期间进行同步本地的847K时钟和接收到的BPSK信号之间的相位关系,这样在使能信号之后,就可以使用同步后的847K时钟对BPSK信号进行解码。经过数字锁相环的同步后,消除了本地时钟与接收到的BPSK信号的相位不确定性,使两者相位关系固定。

本发明的BPSK信号同步电路能使本地时钟与接收的BPSK信号同步,利于对BPSK信号的正确解码。

附图说明

下面结合附图与具体实施方式对本发明作进一步详细的说明:

图1是本发明一实施例的电路结构示意图。

附图标记说明

100是RF模块            110是数字锁相环

120是解码模块          130是倒相器。

具体实施方式

如图1所示,本发明的一实施例包括:RF模块100、数字锁相环110、解码模块120、倒相器130;

RF模块100,用于发送和接收具有数据信息的RF信号和恢复时钟信号,完成解调后,将接收的根据ISO14443通讯协议编码的信号送给数字锁相环110和后续的解码模块120;

数字锁相环110,使用通用的数字锁相环电路,其时钟信号使用RF模块110恢复的时钟信号,通过同步后,得到的本地时钟clk847和RF模块110产生的pause(暂停)信号相位固定;数字锁相环110可以通过输入信号Kmode来改变数字锁相环的跟踪步长和锁定时的相位误差,输入信号Kmode的模值可以改变,模值的大小决定了数字锁相环的跟踪步长,模值越大,跟踪步长越小,锁定时的相位误差越小,但捕获时间越长;相反,模值越小,跟踪步长越大,锁定的相位误差越大,但捕获时间越小;

解码模块120,使用经过数字锁相环110得到的同步时钟clk847对RF模块100产生的pause信号进行解码,其使用的是通用的BPSK解码电路;

倒相器130,对输入使能信号DPLL_EN进行相位取反,取反前得使能信号DPLL_EN作为数字锁相环110的使能信号,取反后的信号作为解码模块120的使能信号,即两者不同时工作,需同步完成后,解码模块120才开始工作。

以上通过具体实施方式和实施例对本发明进行了详细的说明,但这些并非构成对本发明的限制。在不脱离本发明原理的情况下,本领域的技术人员还可做出许多变形和改进,这些也应视为本发明的保护范围。

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