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- [发明专利]频率合成器-CN201710145939.0在审
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吕亚博;戴鹏;佘胜团
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广州海格通信集团股份有限公司
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2017-03-13
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2017-06-27
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H03L7/18
- 本发明涉及频率合成器，包括参考频率模块、锁相环模块、DDS内插单元、带通滤波器以及控制器；其中，所述DDS内插单元包括直接数字频率合成模块和边带抑制混频器；所述参考频率模块分别与所述锁相环模块的第一输入端和直接数字频率合成模块的输入端相连；所述控制器分别与所述锁相环模块的受控端和所述直接数字频率合成模块的受控端相连；所述边带抑制混频器的第一输入端与所述直接数字频率合成模块的输出端相连，所述边带抑制混频器的第二输入端与所述锁相环模块的输出端相连，所述边带抑制混频器的输出端通过所述带通滤波器与所述锁相环模块的第二输入端相连。
- 频率合成器
- [发明专利]间歇式锁相环频率综合器-CN201610594381.X有效
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阴亚东;施隆照
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福州大学
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2016-07-27
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2019-03-12
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H03L7/10
- 本发明涉及一种间歇式锁相环频率综合器，包括时钟同步单元、锁相环单元以及模式控制单元；时钟同步单元分别与模式控制单元以及锁相环单元相连；模式控制单元与所相环单元相连；时钟同步单元以及模式控制单元作为输入端，分别接收参考时钟信号以及模式控制信号；模式控制单元接收时钟同步单元发送的同步时钟信号；锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号，接收时钟同步单元发送的同步时钟信号，并分别发送反馈时钟信号至时钟同步单元以及模式控制单元；锁相环单元作为输出端，输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器，其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
- 间歇式锁相环频率综合
- [实用新型]一种频率源-CN202320459075.0有效
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康园园
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海德斯通信有限公司
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2023-03-02
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2023-09-26
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H03L7/08
- 本申请公开了一种频率源。该频率源包括第一锁相环、第二锁相环及振荡电路。第一锁相环用于接入低口调制信号，并基于低口调制信号产生低口调制频偏信号；第二锁相环与第一锁相环连接，用于接入时钟参考信号；振荡电路与第二锁相环连接，用于接入高口调制信号，基于高口调制信号产生高口调制频偏信号，并反馈给第二锁相环，第二锁相环将高口调制频偏信号与时钟参考信号进行同步处理并反馈给第一锁相环，第一锁相环基于时钟参考信号、低口调制频偏信号及高口调制频偏信号实现频率源的两点调制。通过上述方式，本申请能够扩宽频率源的频率范围，能够提高其频率调整的灵活性。
- 一种频率
- [发明专利]快速锁定的频率产生电路-CN201410581688.7有效
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冷鹏
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海能达通信股份有限公司
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2014-10-27
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2017-10-03
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H03L7/099
- 本发明公开了一种快速锁定的频率产生电路，该电路包括锁相环电路、压控振荡器、与所述锁相环电路相连的用于提供参考频率的参考频率源、用于配置锁相环频率并输出控制信号的主控芯片，还包括连接在所述锁相环电路与所述压控振荡器之间的宽带环路滤波电路、连接在所述锁相环电路与所述压控振荡器之间的窄带环路滤波电路、连接在所述宽带环路滤波电路与所述窄带环路滤波电路之间的用于跟随以保证所述宽带环路滤波电路与所述窄带环路滤波电路电压一致的控制电路。上电时，该频率产生电路通过控制电路保证宽带环路滤波电路与窄带环路滤波电路保持电压相同，以达到快速锁定锁相环的目的。
- 快速锁定频率产生电路
- [实用新型]频率合成器-CN201320804314.8有效
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姚宗诚;林洪钢
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成都赛英科技有限公司
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2013-12-09
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2014-05-21
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H03L7/18
- 本实用新型公开了一种频率合成器，包括低相位噪声恒温晶振；所述的低相位噪声恒温晶振连接第一PLL锁相环芯片，所述低相位噪声恒温晶振连接第二PLL锁相环芯片；所述频率合成器还包括FPGA、2选1开关；所述FPGA与所述第一PLL锁相环芯片连接，所述FPGA向所述第一PLL锁相环芯片输出控制信号；所述FPGA与所述第二PLL锁相环芯片连接，所述FPGA向所述第二PLL锁相环芯片输出控制信号；所述FPGA与所述2选本实用新型能同时实现高杂散抑制度和高速频率切换以及低功耗小体积的要求，为雷达和通信系统提供高质量的信号源，从而提升雷达和通信系统的整体性能。
- 频率合成器
- [实用新型]一种抗干扰单工射频发射电路-CN201922124998.7有效
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黄锋
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黄冈师范学院
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2019-12-02
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2020-06-02
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H04B1/04
- 本实用新型涉及射频发射电路技术领域，提供一种抗干扰单工射频发射电路，其中，在双模锁相环频率合成芯片的振荡输入引脚和振荡输出引脚之间电连接有晶振滤波电路，双模锁相环频率合成芯片的锁定检测引脚通过所述锁相显示电路接地，双模锁相环频率合成芯片的鉴相输出引脚通过环路滤波电路与压控谐振电路的输入端电连接，压控谐振电路的输出端通过分频电路与双模锁相环频率合成芯片的分频信号输入引脚电连接，压控谐振电路的输出端还通过功率放大电路与射频天线电连接，克服了抗干扰单工射频发射电路受到呈现环路锁相状态限制的问题，提升了抗干扰单工射频发射电路的抗干扰性和稳定性，提高了电路输出性能。
- 一种抗干扰射频发射电路
- [发明专利]锁相环频率锁定的判断方法及电路-CN200410082395.0有效
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黄立中
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华为技术有限公司
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2004-12-31
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2006-07-12
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H03L7/08
- 本发明涉及一种锁相环频率锁定的判断方法及电路。本发明主要是将PLL(锁相环)中的PFD(Phase－Frequency Detector，鉴相器)电路输出的相差判别信号用于PLL频率锁定判断电路，从而可以监测相位的滑动情况，并将出现周期性的相位差滑动作为失锁的判决条件，用来确定锁相环频率是否锁定。因此，本发明显著改善了频率锁定判断电路的部分性能，并可以检测出锁相环因相位突变造成的短暂失锁。而且，本发明中，将频率检测电路和计数锁频判断电路分开设计，配置应用非常灵活且有效降低了对锁相环其他指标的要求。
- 锁相环频率锁定判断方法电路
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