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- [发明专利]大规模半导体逻辑器件-CN88100886.9无效
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山际明;岡部年宏
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株式会社日立制作所
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1988-02-15
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1990-09-05
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H03K19/096
- 多相位时钟信号从时钟信号输入针通过至少三级缓冲电路传送到分散在芯片上的大量负载电路。第一级缓冲电路设置在输入针附近，而第二级缓冲电路设置在芯片的中心部分。在接连的两级缓冲电路之间进行等长度布线，并且对应于各相位的某级缓冲电路中的每一个连接相同数目的后级缓冲电路、以便提供相同的电阻和电容。还在末级缓冲电路与对应的负载电路之间进行等长度布线，并且每个末级缓冲电路连接相同数目的负载电路。这样，在从输入针到各相位下的负载电路的各时钟信号通路中形成相等的时间延迟。
- 大规模半导体逻辑器件
- [发明专利]大规模并列核酸分析方法-CN200810128824.1无效
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松永浩子;神原秀记;梶山智晴
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株式会社日立制作所
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2008-06-20
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2008-12-24
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C12Q1/68
- 本发明的目的在于提供将多种核酸试样的混合物中所含的核酸各个分别并列扩增的技术。本发明为一种核酸分析方法，其具有下述扩增机构：将至少多个模板核酸和表面固定有一种以上扩增用探针的固相载体保持在由均匀溶剂形成的反应溶液中进行扩增反应，在1个固相载体不会复制来自2个以上模板核酸的扩增产物。通过本发明，可以将成为解析对象的多种混合状态的核酸试样各个并列地分别扩增。由于为1个固相载体1个核酸，因此易于集聚获得了扩增产物的固相载体，与扩增产物的解析处理量提高有关。另外，由于扩增反应工序均在均匀的溶剂条件下进行反应，因此操作工序简单且适于自动化。
- 大规模并列核酸分析方法
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