[发明专利]相加－比较选择电路无效
| 申请号： | 99104106.2 | 申请日： | 1999-03-17 |
| 公开（公告）号： | CN1235429A | 公开（公告）日： | 1999-11-17 |
| 发明（设计）人： | 李相凤 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | H03M13/12 | 分类号： | H03M13/12 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 栾本生,李亚非 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种用于具有分支测量计算器和测量存贮器的Viterbi算法处理设备的高速相加－比较选择设备被描述。第一和第二以前测量值从测量存贮器供给第一和第二寄存器。来自第一寄存器的第一以前测量值和由分支测量计算器计算的当前状态分支测量值被相加,来自第二寄存器的第二以前测量值和由分支测量计算器计算的下一个状态的分支测量值被相加。所得的值被比较并相应地算出残余测量值。 | ||
| 搜索关键词： | 相加 比较 选择 电路 | ||
【主权项】：
1．一种高速相加-比较选择设备，用于具有分支测量计算器和测量存贮器的Viterbi算法处理设备，包括：第一和第二寄存器；给第一和第二寄存器供应来自测量存贮器的第一和第二以前的测量值的装置；第一相加器，用于将来自第一寄存器的第一以前的测量值和由分支测量计算器计算的当前状态的分支测量值相加；第二相加器，用于将来自第二寄存器的第二以前的测量值和由分支测量计算器计算的下一个状态的分支测量值相加；和比较器，用于将第一和第二相加器的输出作比较并相应地计算残余测量值。
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