[发明专利]在数据处理系统中数据混合串并总线接口及其方法有效
| 申请号： | 98105828.0 | 申请日： | 1998-03-19 |
| 公开（公告）号： | CN1195821A | 公开（公告）日： | 1998-10-14 |
| 发明（设计）人： | 古义明;T·Q·纽伊恩 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06F13/00 | 分类号： | G06F13/00 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 陈景峻,张志醒 |
| 地址： | 美国*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种微控制器系统包括具有至少一条并行输入/输出总线和一个串行数据口的微控制器;具有一个串行数据口的串/并接口逻辑电路,一条并行地址总线,和一条并行数据总线,该串行数据口与微控制器的串行数据口联系,在微控制器串行数据口上传递的第一数据值出现在并行数据总线上,串/并接口逻辑电路在其并行地址总线上提供地址;和总线设备,用于接收串/并接口逻辑电路的并行地址总线上的地址,总线设备访问数据总线,以便传递并行数据值。 | ||
| 搜索关键词： | 数据处理系统 数据 混合 总线接口 及其 方法 | ||
【主权项】：
1.一种微控制器系统包括：具有至少一条并行输入/输出(“I/O”)总线和一个串行数据口的微控制器；串/并接口逻辑电路，具有一个串行数据口，一条并行地址总线，和一条并行数据总线，所述串行数据口用于与所述微控制器的所述串行数据口联系，其中在所述微控制器的所述串行数据口上传递的第一数据值作为一个并行数据值出现在所述并行数据总线上，所述串/并接口逻辑电路在所述串/并接口逻辑电路的所述并行地址总线上提供一个地址；以及总线设备，用于接收所述串/并接口逻辑电路的所述并行地址总线上的所述地址，所述总线设备访问所述数据总线，以便传递所述并行数据值。
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