[发明专利]一种基于FPGA的动态可重构系统设计方法在审
| 申请号： | 202310851065.6 | 申请日： | 2023-07-11 |
| 公开（公告）号： | CN116911218A | 公开（公告）日： | 2023-10-20 |
| 发明（设计）人： | 覃昊洁;戴淯全;方玉堃;喻牧泉;彭卓霖 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | G06F30/327 | 分类号： | G06F30/327;G06F15/78;G06F111/04 |
| 代理公司： | 重庆速腾专利代理事务所(普通合伙) 50315 | 代理人： | 李兴洲 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本发明公开了一种基于FPGA的动态可重构系统设计方法，涉及可重构系统设计领域，包括如下步骤：S1：根据项目将电路功能划分得到静态逻辑单元，并根据需求的并行程度和资源利用确定可重构区域的数量；S2：对模块框架进行设计并将设计结果生成网表文件S3：根据网表文件将可重构区域物理约束至FPGA芯片上得到Pblocks区域，并将对应的约束关系生成得到约束文件；S4：使用EDA软件根据约束文件生成比特流文件；S5：根据比特流文件在静态逻辑单元实现可重构配置信号。本发明根据卷积神经网络在嵌入式场景限制，在FPGA芯片上设计了一个动态可重构系统，以在有限的硬件资源下完成对一个或多个神经网络的动态加速，完成边缘节点的功能，并保持运行和待机的低功耗。 | ||
| 搜索关键词： | 一种 基于 fpga 动态 可重构 系统 设计 方法 | ||
【主权项】：
暂无信息
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