[发明专利]全加器在审
| 申请号： | 202310659324.5 | 申请日： | 2023-06-05 |
| 公开（公告）号： | CN116860203A | 公开（公告）日： | 2023-10-10 |
| 发明（设计）人： | 谢翔;邓成将;王自强 | 申请（专利权）人： | 清华大学 |
| 主分类号： | G06F7/501 | 分类号： | G06F7/501;H03K19/21;H03K19/20 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 杨丽爽;臧建明 |
| 地址： | 100084*** | 国省代码： | 北京;11 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本申请提供一种全加器，包括第一同或逻辑门、第二反相器、第一异或逻辑门和选择器，第一同或逻辑门用于实现第一信号和第二信号的同或，输出进位传播信号的互补信号，第二反相器的输入端连接第一同或逻辑门的输出端，第二反相器的输出端用于输出进位传播信号。第一异或逻辑门的第一控制端连接第二反相器的输出端，第二控制端连接第一同或逻辑门的输出端，输入端接收进位输入信号，输出端输出和位输出信号。通过第二反相器产生进位传播信号，能够节省电路实现面积以及负载电容，实现较低的动态功耗，并能够消除延迟较大限制性能的进位传播信号产生模块，提高全加器的性能。 | ||
| 搜索关键词： | 全加器 | ||
【主权项】：
暂无信息
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