[发明专利]基于链表树的硬件逻辑设计层次结构信息提取方法及系统在审
| 申请号： | 202310074294.1 | 申请日： | 2023-01-17 |
| 公开（公告）号： | CN116050312A | 公开（公告）日： | 2023-05-02 |
| 发明（设计）人： | 潘国腾;付文杰;铁俊波;周理;罗莉;荀长庆;周海亮;邓林;龚锐;石伟;张剑锋;刘威;冯权友;唐潇;卢辉鸿;赵王;唐诗雯;廖焕乾 | 申请（专利权）人： | 中国人民解放军国防科技大学 |
| 主分类号： | G06F30/327 | 分类号： | G06F30/327;G06F30/343 |
| 代理公司： | 湖南兆弘专利事务所(普通合伙) 43008 | 代理人： | 谭武艺 |
| 地址： | 410073 湖南*** | 国省代码： | 湖南;43 |
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| 摘要： | 本发明公开了一种基于链表树的硬件逻辑设计层次结构信息提取方法及系统，本发明基于链表树的硬件逻辑设计层次结构信息提取方法包括使用综合工具将硬件设计的RTL代码综合为一组网表文件，提取网表文件中的信息，得到硬件设计综合报告文件，处理硬件设计综合报告文件生成基于链表树的硬件逻辑设计层次结构信息，本发明从一组硬件模块网表文件中提取设计层级结构信息，并以链表树的方式组织和存储，为逻辑划分算法提供输入，本发明具有层次结构信息提取方便、存储空间资源占用少的优点，并且可进行可视化展示以便于FPGA原型验证系统开发人员直观地理解硬件逻辑设计层次结构。 | ||
| 搜索关键词： | 基于 链表树 硬件 逻辑设计 层次 结构 信息 提取 方法 系统 | ||
【主权项】：
暂无信息
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