[发明专利]验证系统及在验证系统的多个FPGA之间同步时钟的方法在审
| 申请号： | 202210775444.7 | 申请日： | 2022-07-01 |
| 公开（公告）号： | CN115392157A | 公开（公告）日： | 2022-11-25 |
| 发明（设计）人： | 于佳奇;赵烁 | 申请（专利权）人： | 芯华章科技股份有限公司 |
| 主分类号： | G06F30/30 | 分类号： | G06F30/30 |
| 代理公司： | 北京风雅颂专利代理有限公司 11403 | 代理人： | 李莎 |
| 地址： | 211800 江苏省南京*** | 国省代码： | 江苏;32 |
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| 摘要： | 本公开提供一种验证系统及在验证系统的多个FPGA之间同步时钟的方法，其中所述系统用于对芯片设计进行仿真和验证。该系统包括一个验证板，所述验证板包括：接口，用于接收第一用户指令和第二用户指令；多个FPGA；时钟源，用于产生根时钟信号和同步信号；资源配置单元，用于根据所述第一和第二用户指令分别将所述多个FPGA中的第一部分配置为第一组FPGA、第二部分配置为第二组FPGA；多个时钟同步单元，连接到所述时钟源和所述资源配置单元，并且包括连接到所述第一组和第二组FPGA的第一和第二时钟同步单元，所述第一和第二时钟同步单元用于分别根据所述第一和第二用户指令生成施加到所述第一组和第二组FPGA的第一和第二时钟信号。 | ||
| 搜索关键词： | 验证 系统 fpga 之间 同步 时钟 方法 | ||
【主权项】：
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