[发明专利]一种用于降低锁相环路整数边界杂散的电路及其方法在审
| 申请号： | 202210431464.2 | 申请日： | 2022-04-22 |
| 公开（公告）号： | CN114745000A | 公开（公告）日： | 2022-07-12 |
| 发明（设计）人： | 蔡振越;张志坚 | 申请（专利权）人： | 福建利利普光电科技有限公司 |
| 主分类号： | H03L7/099 | 分类号： | H03L7/099;H03L7/18 |
| 代理公司： | 福州君诚知识产权代理有限公司 35211 | 代理人： | 戴雨君 |
| 地址： | 363005 福*** | 国省代码： | 福建;35 |
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| 摘要： | 本发明公开一种用于降低锁相环路整数边界杂散的电路及其控制方法，当锁相环路设置值N1接近整数N2时，CPU强制将设置值N1改成整数N2,FPGA将参数值发送给锁相环路,由于N2为整数，锁相环路将不产生整数杂散。锁相环路产生的频率N2,产生的频率误差为|N2‑N1|。FPGA采集的模数转换器数据频率为N2,误差为|N2‑N1|,FPGA采集后的数据进行下变频，变频的参数由N1变成|N1+(N2‑N1)|=N2，经过下变频后的数据仍然为零中频数据,进行后续的数据处理。本发明用于降低锁相环路整数杂散，可以解决锁相环路整数杂散，又可以不采用额外的硬件成本，实现更好的电路性能。 | ||
| 搜索关键词： | 一种 用于 降低 环路 整数 边界 电路 及其 方法 | ||
【主权项】：
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