[发明专利]用于为FPGA提供促进高速数据传输的SERDES块的方法和装置在审
| 申请号： | 202210013721.0 | 申请日： | 2022-01-05 |
| 公开（公告）号： | CN114510447A | 公开（公告）日： | 2022-05-17 |
| 发明（设计）人： | 格兰特·托马斯·詹宁斯;王添平;林晓志 | 申请（专利权）人： | 广东高云半导体科技股份有限公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42;G06F13/36 |
| 代理公司： | 广州三环专利商标代理有限公司 44202 | 代理人： | 江银会 |
| 地址： | 510663 广东省广*** | 国省代码： | 广东;44 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 本申请公开了一种包含主机和具有现场可编程门阵列(FPGA)的设备的系统。该系统包括一组可配置逻辑块(LB)、总线和通用串行总线(USB)接口。在一个方面，该可配置LB能够被选择性地编程以执行一个或多个逻辑功能。该总线包含用于根据高速USB协议传输信号的P通道和N通道。该USB接口被配置为包括用于识别P通道处的逻辑0状态的第一差分比较器和用于识别N通道处的逻辑0状态的第二差分比较器。 | ||
| 搜索关键词： | 用于 fpga 提供 促进 高速 数据传输 serdes 方法 装置 | ||
【主权项】：
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