[发明专利]一种基于Verilog减法运算的CPLD平台除法实现方法在审
| 申请号： | 202110888440.5 | 申请日： | 2021-08-03 |
| 公开（公告）号： | CN113765458A | 公开（公告）日： | 2021-12-07 |
| 发明（设计）人： | 刘运录;罗阳;杜俊 | 申请（专利权）人： | 贵阳航空电机有限公司 |
| 主分类号： | H02P23/00 | 分类号： | H02P23/00;H02P6/08 |
| 代理公司： | 贵阳春秋知识产权代理事务所(普通合伙) 52109 | 代理人： | 杨云 |
| 地址： | 550009 贵州*** | 国省代码： | 贵州;52 |
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| 摘要： | 本发明公开了一种基于Verilog减法运算的CPLD平台除法实现方法，包括如下步骤：CPLD寄存器接收并转换无刷电机转速信息数据，二进制保存以得到二进制的转速信息结果；将转速信息结果进行二分法的减法算法，并将二分法减法算法转换为二进制除法运算；利用移位方式在CPLD逻辑芯片中，实现PI控制算法中的乘除积分运算，实现CPLD平台的除法算法形成除法器。本发明在CPLD平台上，通过二分法的减法转换方式实现除法运算，进而实现在CPLD平台的无刷直流电机的PI控制，其CPLD为逻辑芯片能进行PI的乘、除、积分的逻辑运算，实现CPLD平台的除法计算，可实现高速计算从而满足在CPLD平台上的PI控制。 | ||
| 搜索关键词： | 一种 基于 verilog 减法 运算 cpld 平台 除法 实现 方法 | ||
【主权项】：
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